答题 | 哇！一种很新颖的差分走线方式

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# k8 c6 O# R) _' R; w, {$ J5 z' O哇！一种很新颖的差分走线方式
$ l7 m- ?- b) W【文：黄刚】

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6 v& |( P, k# U7 n6 N/ `问答大家对于这种差分线方式有什么想法？
/ x# C2 C+ E1 `' f4 X0 W" a7 x高速先生这几天在我们的后台看了下，参与回复“赞美”和“批判”的网友数量可能是平时的2-3倍。还是那句话，先谢谢大家的热情参与哈。
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: Y0 t8 b7 |% s有一些网友比较专业，直接来“批判”说高速先生在上篇主文章里面写的都是对这个差分线结构的优势，当然我们不能那么片面的去看问题。就好像有的网友也把高速先生问得无言以对，就是“如果真有你说得那么好，为什么现在在PCB设计领域没有大规模的应用啊？”那我们这篇答题文章就说说到底这种差分线结构有什么缺点哈。
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• 层偏：恩，其实这个既是这种差分线结构的优点，也是这种结构的缺点。在PCB叠层构造上我们有两种不同类型的东西来压合层与层，一种就是PP，另外一种就是core。要是你用前者作为这两层的介质，PP的确会有一定的层偏。但是如果用core呢？层偏的因素就会有极大的改善。高速先生这块测试板用的就是core在中间的情况了。另外也有一些敏锐的网友提出了，用这种新的差分线结构是很难算到100欧姆的差分阻抗的，这个，大家可以利用手上的阻抗计算软件来试试哈；
  
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• 串扰：同这种方式的差分线结构的串扰会是怎么样呢？这个问题其实很难回答，因为你很难建立两个一样叠层的模型来验证普通走线和这种走线形式。但是从理论上来说，本来的相邻层走线的串扰在相同距离情况下会比同层的串扰要小。因为相邻层是宽边耦合的串扰，同层的耦合只是铜厚；
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• 成本：成本方面高速先生没想明白为什么有不少的网友觉得这种差分结构会更高。因为和普通走线一样，同样的加工方式，不会多什么特殊工艺，要背钻也一起背钻。对了，说到背钻，这种新的差分结构是需要2个不同层的背钻，比普通走线多一种背钻，是因为这个原因使大家觉得成本更高吗？
  
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• Skew：这里很多人也提到了对内的skew是不一样的，因为两个不同的层，过孔的长度肯定会不一样。是的，这个可能是这种差分结构最大的劣势。怎么可以解决这种问题呢？高速先生想能不能从走线的绕线来补偿过孔的长度差，就好像同层的BGA差分线也是在里面也是天然会产生不等长是一样的；另外有一个point大家有没有想过，从高速先生的这种测试走线来看，并没有在远端或者终端去补偿过孔的skew，大家可以想想高速先生是怎么做到的哈？？
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• PCB设计软件不支持？这个我们组内的PCB工程师画这块测试板的时候就发现了，真的是不行。这个后面有没有可能可以支持，高速先生也很着急哈！
  
  
  

后面神补刀一句，无论这种方法成还是不成，我们高速先生只是基于扩展大家的视野而研究的。Anyway，看到这篇文章非常高的阅读量和回复数量，我们的目标算是达到了。(#^.^#)
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9 h5 I; r7 |1 I: u4 M( g$ |（以下内容选自部分网友答题）
这种很早就有研究过了，有优势也有劣势，好处你都讲了，不好的有没有考虑参考GND的pp或者core不同，导致单线不对称，第二层间偏位，一般单板层偏都有5mil了，你设计两者一样，其实加工出来各种各样，带来阻抗一致性，skew等各种问题，第三过孔问题，一个深一个浅，带来了差分线不对称。这种走法我想终究会用到的，就是要解决各种加工精度问题   
7 j8 q" S6 ^* u5 g& Y, F: Z+ i+ g@ 白开水
评分：3分
这种差分结构太新奇了。1.层叠压合时，蚀刻做线时对位偏移问题。方法:不对位。使用板芯直接蚀刻，这样线路偏移在0.1mm以内。2.换层过孔不对称问题。方法:a.放送芯片放顶层，P和N差别为+d；接受芯片放底层，差别为-d；负负得正，将错就错能变对。b.不用过孔，吴老师的著作中有一章讲把电容电阻放在板内，不知道也能把芯片放在板内。3.差分画线不习惯。方法:a.以前99画同层差分线、绕等长是控制好间距不变绿一根一根画，一点一点扭。由于上下线路对称，画好一根后直接克隆到下层。b.以客户为中心，倾听客户心声是华为文化之一。画图员作为软件的使用者，能否向供应商放映用户体验和建议呢。   
" r* r! ~# T! o$ y0 S@ 山水江南
评分：2分
" h2 ?6 B" [& L; `. j! U+ a看起来很不错。对于设计来说其实也可以很容易实现，但是是否考虑过成本的考虑，一般情况下GSSG这种结构是为了节约成本，如果一对差分线就占去两层，恐怕与节约成本相违，另外也的考虑加工问题等。虽然说信号，时延等比较好，但是还得综合考虑下   
@  Jamie
/ N. A9 n, N6 i% `1 n评分：3分
+ u# ?7 [/ F! R; a% I1 k( _/ ~以前这么设计过一次，实际证明很浪费层，原本只阻断一层的走线通道，这样设计后，发现两层都被阻断了   
@ 飞飞
评分：2分
) S) d: i1 o5 _. @  A7 s, U$ }严格差分是不用这种的，楼主的仿真应该过于理想化，很多时候分两层走各自的参考平面是不一致的，速度高起来了，这种方式想达到楼主仿真效果，极度浪费空间与叠层   
  d! ]& b/ q' s. L@ nice
" _! ]/ c. T/ D$ \) ]2 Y; u评分：2分
" a) T  t& s) S  Y5 N6 h2 {8 E主要还是成本，这种方式制板成本会增加！   
2 F4 L9 @. T8 M1 y" F+ B@ 开颜
( e4 F' d9 t. V  {1 L5 W) Y评分：2分
: k. }, Q' @' N7 w% _怎么可能不换层，你这个设计明显是内层走线，始终要到表层连到设备上的，过孔不可避免   
@ 吉祥
8 P2 S$ B/ L. D( i6 K: m. ^评分：2分
6 O. N; V, q3 \. y这个方式，之前弄FPC   cable 时候有想到过PCB 上也可以这么玩，没做过仿真。问题也有，一个是换层，VIA 处不好处理，下孔处以及via   stab，二是参考层面，上下两层都需要铺GND，灵活性利用性不大   
! \6 g* @  @) x2 w) E0 _@ 箴言
* s0 w: g- `$ l5 c8 b评分：2分
针对阻抗这个层间距是不是可调范围变小了。而且生产精度需要提高   
- `8 H  ?! ~6 f7 V& y* F" G8 }@ 骷髅头
! S. d4 Z' ^4 p2 Z$ H" D! d- G# w评分：2分
这么做，差分阻抗不好做高啊，一般做个70~80欧姆就不错了。要想匹配90.100欧，挺难的，会牺牲其它方面，比如厚度   
@ 胜利
评分：2分
  U+ x4 I  b, k4 _# j3 a% m; ~* F- _1 v这么做，差分阻抗不好做高啊，一般做个70~80欧姆就不错了。要想匹配90.100欧，挺难的，会牺牲其它方面，比如厚度   
@ 胜利
6 a/ h" @8 o8 z- o) e评分：2分
9 D5 C) L/ G; s" g& s" U( [  b这么做，差分阻抗不好做高啊，一般做个70~80欧姆就不错了。要想匹配90.100欧，挺难的，会牺牲其它方面，比如厚度   
' v& m/ h7 _5 J% F, r@ 胜利
, K' @  L/ E/ P/ @1 f评分：2分
0 U) L) j7 k$ t. J+ J6 k% z首先为此点赞。积极，探索，创新
2 e* j2 [1 L1 i0 L而个人理解：理论上确实可以，实际上问题很多的。
设计上的控制方式，不好约束；
生产制造的不理解，沟通困难，不便于操作
, b7 T7 w( o  D8 B9 [( G7 H除非极为特殊的情况，否则不推荐。   
@ 小黑
' k- a1 ?  T) w( U: U. ?9 V* ]. s. `评分：3分
, F7 [6 F7 ?8 y: Q  ?0 x记得之前有篇文章讲工艺就提到，GSSG，间隔平行线本来没有串扰，层叠偏移造成串扰严重。这个层叠也会遇到工艺问题吧，5mil以下的线宽感觉不好控制   
@ 牛锴
9 a7 V( p0 X$ d+ z# E* H" F评分：3分
差分对中除PN耦合外还有对地的耦合，如果是带状线还好，如果是微带线   那表层的线阻抗很难控制把？   
# h( V1 F% m  D& V* \/ Q1 g8 {7 q0 T@ 咚咚
评分：2分
还不具备工程应用普及吧，就目前的EDA软件实现上就用难度，目前画图软件都是层的设计架构，这种跨层的设计方法，实现工具上不支持；不过目前看对比结果，不错的性能，脑洞够大，世界够宽   
0 \0 T$ K, Y- j3 z@ GFY
0 a6 L; C; }$ _( Y评分：3分
4 q! \0 W) w, R$ S+ j$ v多一种方式，多一种选择，有创新当然是好事情；优势:对于emi来说，回路平面在切面，可以更好地发挥地环的保护作用；能改善玻纤效应；当然创新之初对于推广有一些难点:si9000之类不支持该模型，难不成我要用hfss去仿真；cadence软件如何去设置也是问题；既然贵司有做这方面的产品，请不吝赐教方法！   
@ 张广平
; v" `0 D! @, p; z评分：3分
这种差分线的队内耦合程度相比普通的差分线要强，抗共模干扰的能力也强些，但是不好设计，难度包括，得考虑相邻层的间距，画图软件上不好实施，两层走线的左右两边都要预留包地的间隙，相当于减小了走线空间。
& Z4 ~" S) K) o; w: b; }9 Q@ 涌
评分：3分
  \- _% j8 d# y( B从pn   balance的角度讲，确实有优势，但是缺点估计在因为pn的参考地其实不是同一个地，邻层噪声耦合以及回流阻力不一致的问题，估计你的模型没有充分考虑到。还有就是per   preg的不一致导致的pn阻抗均值的偏差不知怎么量化……   
4 X% b, j- U0 ^' k- o- Y3 ?@ TROY
' c/ [& r' o) L3 Z评分：2分
/ E: o, H; L9 @/ M% v% }  H% T; P) Z1 m虽然能减小玻纤效应的影响，但是阻抗控制，延时控制，在设计中是存在压力的，对于层叠设计压力也会比较大，限制因素还是比较多的，推广的话，还需要优化一些问题点   
@ zaki
7 _, o8 n- z0 o) q- ?3 S# ]0 C! y/ c评分：3分
! J1 f6 S8 C- B3 R3 d就问问咋个走规则咋个设置？阻抗咋个计算？如果这样走的话，那么这两层如果还有其他线的话，阻抗影响会不会很大   
$ I& c. g! ]& c( y9 I@ jie
! k% x- d/ H1 ^3 f9 }# n评分：2分
这种方式非常新颖，赞！单独做个实验板验证一下没问题，但感觉在实际工程应用上还要考虑考虑，各层的阻抗控制.延时等。加工难度和加工成本可能要增加啦。各层的耦合情况，过孔处理等可能在工程实际中不像实验板那么理想。   
@ 杆
2 w: D7 L8 e( |$ {& o$ f评分：3分
6 X9 }% n/ q  I' l; K从理论来说，相邻层这种差分走线耦合会更好，也会在一些类似T拓扑结构差分更好走线，但是考虑过孔影响，两条差分信号都在中间层还容易保持对称，但是有时候是一个在表面一个在内层就会有过孔的影响存在导致P/N不对称，所以个人认为这种差分走线方式还是要依情况而定，就像好多高速信号走线布局也很灵活。   
@ libery.li
% n5 h" J: d4 b: _0 F" P评分：3分
& l* x. `! ?7 Z8 Z7 T0 B1 y5 |这个方式串扰好像要比同层的差些，可以对比下。层偏应该也会对性能有影响。   
@ 两处闲愁
: m+ I: o5 u8 [' h, R4 h! w7 n评分：2分
1,这种有线方式适用于超高速信号2,有线花的时间多，修改花的时间也多3,一般6.25g以下的信号不建议这样有线，过设计   
# e8 B, R/ d% i) J0 F@ 欧阳
3 m* C8 R/ M3 p0 `3 @  p0 [评分：2分
11度走线设计难度大，耗时长，但是对于超高速信号来说，是有好处的，但不宜什么信号都走11度，不应该过设计，毕竟时间就是金钱，人力也是金钱。
. R1 j% T' L, G3 T另外，普通走线搭配制板旋转一定角度，也可以达到11度走线的效果，就是板材利用率低一些，单价贵一些。   
7 K% i) t( F0 e: Q+ \@ Ben
评分：2分
使用多阶hdi或者任意层过孔，过孔并不是什么大问题。两个叠着放的L   L。参考层的距离倒是不太好在设计中把握。   
8 B9 \1 X( ^2 ]) r@ 海绵宝宝
评分：2分
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4 a$ ]4 x! d4 {0 L1 k* o* }————你可能错过的往期干货————
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" O( I' F6 d9 D' t( i7 y哇！一种很新颖的差分走线方式
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