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楼主: dzyhym@126.com
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IPC网表文件详解和相应软件的操作

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 楼主| 发表于 2015-6-30 16:50 | 只看该作者
本帖最后由 dzyhym@126.com 于 2015-6-30 16:52 编辑 2 u2 Z9 e* ~) Z, E

0 u3 n: X8 z9 k) m2 r" J" }cam350对比网表首先就是要将ipc坐标和光绘的坐标对齐,要不然无从谈起网表对比,其它结果分析对比就和genesis一样了。(AD、Pads软件容易出现坐标不一致)0 @9 |# ~+ S3 y
. y3 b# N; Q% g0 j- m* c9 j

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用ad出单板gerber之后自带的cam文件中显示正常,用place--Embedded Board Array放阵列的文件出gerber就出现了你图中所显示的情况了,有两个问题 1.如何做到place--Embedded Board Array和单板的原点在同一个位置,  详情 回复 发表于 2018-1-11 11:17

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发表于 2015-7-6 09:21 | 只看该作者
谢谢分享

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发表于 2015-7-6 13:51 | 只看该作者
学习了,多谢分享

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发表于 2015-7-6 14:19 | 只看该作者
dzyhym@126.com 发表于 2015-6-19 15:16. q3 y3 ^% z# e0 b. w# y# K' i: O
再详细就是genesis操作了 input=操作 需要讲?
1 d5 n3 n$ i% S
比如说:有椭圆形孔,怎么弄,过孔的属性,盘的属性如何编辑" n( W- |% }, C

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genesis中直接定义成钻孔层即可 过孔和盘这些属性不用定义  详情 回复 发表于 2015-7-6 14:56

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 楼主| 发表于 2015-7-6 14:56 | 只看该作者
仁爱 发表于 2015-7-6 14:19
/ S$ O6 {% o7 m$ {比如说:有椭圆形孔,怎么弄,过孔的属性,盘的属性如何编辑

$ Z  x$ V% X7 c- q4 n' X% egenesis中直接定义成钻孔层即可 过孔和盘这些属性不用定义1 X" c. e0 @) Q7 O+ r5 h5 h% e* Q# e
. a  Z) p4 Y  S# M, i

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发表于 2015-7-6 15:16 | 只看该作者
本帖最后由 仁爱 于 2015-7-6 15:36 编辑
5 I# y% e5 Z1 \) h- r1 m# @. C8 i! d( s# a( R
那我这个是什么情况,怎么相差这么多

QQ图片20150706151817.png (22.98 KB, 下载次数: 1)

QQ图片20150706151817.png

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请发文件给我看看 图片没有办法分析  详情 回复 发表于 2015-7-6 16:39

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 楼主| 发表于 2015-7-6 16:39 | 只看该作者
仁爱 发表于 2015-7-6 15:169 h  h" n  U3 [  _3 k. g
那我这个是什么情况,怎么相差这么多
/ Z% h# [4 D/ x* y5 E  L
请发文件给我看看 图片没有办法分析
$ K0 f! f5 ^! z* g/ o1 h2 u

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谢谢,已经解决,原来是钻孔文件的比例没有弄好  详情 回复 发表于 2015-7-7 10:19

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发表于 2015-7-7 10:19 | 只看该作者
dzyhym@126.com 发表于 2015-7-6 16:39
" d3 U" B4 ]# C9 ~& u请发文件给我看看 图片没有办法分析
  W6 [& s3 S$ ]6 M( f
谢谢,已经解决,原来是钻孔文件的比例没有弄好
& k: e; C5 o! Z5 e

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网表对比 首先就是要确保文件调入正确  详情 回复 发表于 2015-7-8 11:12

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发表于 2015-7-8 09:11 | 只看该作者
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 楼主| 发表于 2015-7-8 11:12 | 只看该作者
仁爱 发表于 2015-7-7 10:19' j8 A) m! K' ]3 I# o4 {2 s
谢谢,已经解决,原来是钻孔文件的比例没有弄好
/ Y7 s5 G& t0 k9 ]
网表对比 首先就是要确保文件调入正确; f- A4 H; s- k7 G

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我前面在文件调入的时候都是绿色,且OK的,连黄色都没有,所以就没有去细看了  详情 回复 发表于 2015-7-9 08:38

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发表于 2015-7-9 08:38 | 只看该作者
dzyhym@126.com 发表于 2015-7-8 11:128 V1 P5 s0 C4 J2 K* g
网表对比 首先就是要确保文件调入正确

/ U& o4 E3 s3 X9 _' f/ T我前面在文件调入的时候都是绿色,且OK的,连黄色都没有,所以就没有去细看了- ]0 b; {' N4 ~! E/ J5 e5 L

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发表于 2015-7-14 10:14 | 只看该作者
很赞!!!!

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发表于 2015-7-24 08:48 | 只看该作者
必须给一万个谢谢,谢谢分享

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发表于 2015-8-28 10:28 | 只看该作者
请教下,对比网表有什么好处呢?
. _) c4 ^# L; Y

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可以预防pcb软件输出线路时候出现问题(部分设计师文件没有问题,但输出光绘设置出问题,比如将字符的框输出到线路层。。。=原因吧),虽然这个概率很小。  详情 回复 发表于 2015-8-28 10:49

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 楼主| 发表于 2015-8-28 10:49 | 只看该作者
蓝色的天口 发表于 2015-8-28 10:28
7 z2 m; J$ {7 r& c% H; z7 V9 M4 u请教下,对比网表有什么好处呢?
: Y% j2 P0 e9 y; @+ d8 t
可以预防pcb软件输出线路时候出现问题(部分设计师文件没有问题,但输出光绘设置出问题,比如将字符的框输出到线路层。。。=原因吧),虽然这个概率很小。
4 d) K7 y( V- g5 e' J- N7 v0 z! C
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