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allgero布线完成以后,如何检查网络表?

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发表于 2010-5-11 14:37 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我用allegro画pcb,已经布完板子了,现在想检查以下,
2 X! g; P& N. }( W% N- k# @1  是否所有的器件都已经链接到网络上,有没有专门的操作可以检查?
( ?* I& k1 P5 x0 M4 ?- k0 \5 n2  我想用pcb生成一个网络表,用cadence生成一个网络表,然后对比,看是否相同,如果相同,证明pcb的网络已经全部链接上,没有漏掉的,而且都正确,请问是否有这样的操作,99se中是有这种操作的!
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发表于 2010-5-11 15:38 | 只看该作者
用summary报表可以看

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发表于 2010-5-11 16:24 | 只看该作者
在setup/drawing option那里就可以看啊

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 楼主| 发表于 2010-5-11 21:45 | 只看该作者
好像有个report-unconnect pin,是不是说,如果unconnect中没有显示未链接的pin,就说明所有的网络都连上了?

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发表于 2010-5-12 09:57 | 只看该作者
在display\status就可以看到零件是否全部放置在板子上,是否有未連接的net存在,點前面的小方塊,就可以看到具體的錯誤信息的

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 楼主| 发表于 2010-5-12 10:25 | 只看该作者
在display\status就可以看到零件是否全部放置在板子上,是否有未連接的net存在,點前面的小方塊,就可以看到 ...
: M1 h& \% [7 s: H( vzrysnake 发表于 2010-5-12 09:57
: Z$ [0 h5 }/ i- Y* K/ c, v3 n
9 ^% N( q) B& Q2 Y1 Y( J& }3 `

/ M% X0 n$ K  `1 ]# a5 n! n2 n    display里面没有status啊!  Q& m. i; Q  b% g; I/ ]
我用的15.5,不知道是不是因为版本问题

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 楼主| 发表于 2010-5-12 10:26 | 只看该作者
在setup/drawing option那里就可以看啊+ U. F: N& I3 `- i
sharon2008 发表于 2010-5-11 16:24
! V4 j! F: v* u* A3 w- B" D

5 L' x! H, z1 g# i% E! \* b" i9 \# B) |3 Q+ ]
    这个是可以看到,但是很不具体,能知道是否链接完全,但不知道那个没链接上

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 楼主| 发表于 2010-5-12 10:27 | 只看该作者
后来我找到一个report的菜单,可以检查出unconnect pin,还算比较全
DM642+FPGA+Camera Link项目研发中,有志同道合的朋友可以相互讨论
QQ:47174697

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发表于 2010-5-12 18:27 | 只看该作者
这个是可以看到,但是很不具体,能知道是否链接完全,但不知道那个没链接上
+ Z: i) _$ ]" I+ t# Delectro_boy 发表于 2010-5-12 10:26
% W2 d4 J7 @0 E. e! j' `" g" u' I
( j$ d! Q( L, b9 T" i; ^' t
- K* v1 y8 A+ m
    你用的是15.5版本是吧,这个地方显示的很完全啊,有显示你有没有没放进来的零件,和没走完的线,还有关于铜模是不是有孤岛,和DRC的问题,在15.5出gerber以前,这里是很重要的检查标志。
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