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LOGIC 原理图显示错误

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发表于 2017-1-20 16:50 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
元件管脚显示的时候 没有挨着外形,是有哪里设计错误了么???! [, r3 }* m& `2 _. y

QQ截图20170120165610.png (11.83 KB, 下载次数: 1)

QQ截图20170120165610.png
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发表于 2017-2-5 15:09 | 只看该作者
不好看而已,不影响性能

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是不会有影响 就是想做到统一格式 看起来舒服些,,有招么??  详情 回复 发表于 2017-2-6 09:01

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 楼主| 发表于 2017-2-6 09:01 | 只看该作者
CS.Su 发表于 2017-2-5 15:097 R  I" s, J( k3 o( \
不好看而已,不影响性能

7 {" _, I2 e8 q. `是不会有影响  就是想做到统一格式 看起来舒服些,,有招么??

点评

要美观就重新编辑下封装就好了  详情 回复 发表于 2017-2-6 16:01

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发表于 2017-2-6 16:01 | 只看该作者
1061652558 发表于 2017-2-6 09:01
8 A4 H, a1 D  [5 G) b1 q. i. x是不会有影响  就是想做到统一格式 看起来舒服些,,有招么??
% z$ F: g# p6 L8 D% h% ^
要美观就重新编辑下封装就好了
5 K( T: {. A- Q8 H5 ^4 ~, R% I
小改怡情,大改伤身。

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发表于 2017-2-14 14:30 | 只看该作者
CAE从新修改下就好了

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发表于 2017-4-1 13:58 | 只看该作者
我来给你做一下解释:
: R' N) C" o$ k3 l, N7 B
1、首先你要明白原理图库中你每次建库时放置的PIN,来自于哪里?看图:  C) x3 R  _, @  s3 {) N: v

9 K( m. Y) D& O, {1 w7 X) A7 G! x3 x
5 @8 i6 ?3 S/ S3 N
/ H( i5 S8 l, n- ~- [& G
2、打开这个PIN,明确这个PIN的长度(一般是200mil)、端点用处等因素。看图:
9 }' o5 y7 g9 e' ? $ t0 f. ^. R+ ?% S, v

# f( a* L8 f7 Z& J3、你的问题出在CAE Decal阶段,填写了比所用管脚更长的参数。看图即可明白:
$ j5 Q% I! Z+ ~' U3 ?3 g2 H. |3 X  n" s& _4 H
2 O, g! I/ V6 ]. p% N0 i
           填写了与管脚长度一致的距离200mil,正确:
( V2 ]- ]5 A; y+ I               
% F' J+ E1 k$ s# T6 ?8 O# n5 n& N+ B! [- u/ s  o6 w
         
+ ?+ I! {  i: Y& ?, a: ^8 c           填写了比实际管脚长度长的距离300mil,错误:错误:错误:/ N9 W8 H6 y5 r
; b. n0 X, y" a5 y3 \8 C% r$ O

- ~3 E9 r( j  q; `4 _( X, I/ t& N+ R! }

: I3 u+ I! _% n) e8 [& L
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