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candence不能导出网表以及allegro不能关联原理图的问题

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发表于 2016-7-28 15:17 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 逍遥剑客 于 2016-7-28 15:27 编辑 0 H2 _7 j: L9 D% i

  s' b1 Q* D" _6 g3 d& K' M刚学candence,遇到问题,请大家不吝赐教。我用的是16.6,文件也不在中文路径
, [5 G1 T9 l; r$ r7 M( f" v* U1.新建个原理图,导出网表,报错,是以为没有PCB库吗?我用的是candence自带的库,不可以吗?
; o4 Y3 _6 l9 a# h: |7 j- @8 d3 w& H' R- Y" F' \
图1-3# Q0 d% s% ^  H' ]/ {: _

% ]' U% N! T& C# {( ~. e
, J  I. P/ k, `) }
2.想把原理图和PCB关联,按照教程,原理图上勾选-ENABLE INTERTOOLS COMMUNICATION后,选择器件,右键却不能出现PCB editor selector 的命令9 n4 P- j( i' H8 O' I- [  {

1 q- A1 F" G2 A" Q( Q
右键如图4

1.png (50.46 KB, 下载次数: 0)

1.png

2.png (11.41 KB, 下载次数: 0)

2.png

3.png (16.5 KB, 下载次数: 0)

3.png

4.png (43.44 KB, 下载次数: 0)

4.png
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发表于 2016-7-28 15:29 | 只看该作者
1.从图片看出是网络表生成失败,原因有很多,具体见allegro文件夹中的log文件,从图中可以看出,电阻的封装有问题。/ n9 Z# \7 o* d2 v8 ~& |8 I
2.关联是要导入网络表成功之后才行,而且也不用右键,原理这边选择元件allegro那边就会高亮。

点评

我感觉要是第一步解决了,第二步应该也就没问题了,这种问题说不清,我还是找个人实际过来看看。谢谢  详情 回复 发表于 2016-7-28 15:46
技术上的突破,一个人很局限,一群人的努力才能取得长足的进步。

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 楼主| 发表于 2016-7-28 15:46 | 只看该作者
nat 发表于 2016-7-28 15:29
" B5 M. z0 m2 _4 `' f" S1.从图片看出是网络表生成失败,原因有很多,具体见allegro文件夹中的log文件,从图中可以看出,电阻的封装 ...
, _3 y& V) R: N! g: N
我感觉要是第一步解决了,第二步应该也就没问题了,这种问题说不清,我还是找个人实际过来看看。谢谢
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发表于 2016-7-28 17:05 | 只看该作者
网标都没有生成你怎么关联呢????

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我说的是两个pcb.第一个是新建的。第二个问题是用一个已经走线完了图纸和相应的原理图,每次关联前也要重新导一次网表么?  详情 回复 发表于 2016-7-28 19:21

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 楼主| 发表于 2016-7-28 19:21 | 只看该作者
980155498cai 发表于 2016-7-28 17:05/ }. T! [: H3 n. X
网标都没有生成你怎么关联呢????

) o5 i5 C8 z9 ~1 |4 x& M我说的是两个pcb.第一个是新建的。第二个问题是用一个已经走线完了图纸和相应的原理图,每次关联前也要重新导一次网表么?  `$ B8 {. x. z1 s! ]$ \& @% {' r

点评

如果关联不上就倒一下就好了  详情 回复 发表于 2016-7-28 21:02

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发表于 2016-7-28 21:02 | 只看该作者
逍遥剑客 发表于 2016-7-28 19:21& v8 S2 ^; b# e" Q- `/ B! N
我说的是两个pcb.第一个是新建的。第二个问题是用一个已经走线完了图纸和相应的原理图,每次关联前也要重 ...
9 c' X3 ^- r& c( f- {9 n
如果关联不上就倒一下就好了
" Y6 h: T7 P' E' }: p( ^- M

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发表于 2016-7-29 08:44 | 只看该作者
首先先解决网表导入前的DRC问题,先把网表导入成功后已经就可以关联了!
. G4 g) t- X& ]

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发表于 2016-8-1 15:58 | 只看该作者
我看了一下,你导不出网表至少有一点是错的,那就是你有些器件没有填写封装名“footprint"
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