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wangjing 发表于 2012-11-7 13:27 {+ i4 g0 p5 n; w数据线和时钟线做等长,每片地址线等长。数据线和地址线不要求
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wplian2188 发表于 2012-11-8 18:12 x8 ^! m2 h' b. D$ D! S 谢谢楼主的无私分享,我现在正在学习DDR3,要是能够得到楼主的brd原文件的更好!我的邮箱是: 谢谢!
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chenyuyu 发表于 2012-11-8 16:06 , N$ L; M' C' jddr3?
DIA3BLO 发表于 2012-11-9 13:30 4 G3 }7 o3 T& M* V9 Q" FLGA1366!X58主板!
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BOT
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TOP
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POWER
vincent_xiao 发表于 2012-11-9 14:13 . n: U9 [% s( l6层同样布局类型的DDR3,上传来给大家看看.接受评议~~~
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wangjing 发表于 2012-11-9 14:21 # Y# K/ |; f7 h& i T型?
vincent_xiao 发表于 2012-11-9 14:33 & `& U$ w' s( m& s1 b; ?4 N4片SDRAM,每二片时钟各自独立,ADD是4片互连,所以采用T型方式走线方式比较好做等长,有没更好的建议.... ...
wangjing 发表于 2012-11-9 14:54 / T" b1 P1 d9 n# C" f) M* t那并联终端电阻是两边都放了?
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