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电巢直播8月计划
楼主: liuyian2011
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详解怎样使用Polar Si9000软件计算阻抗及如何设计层叠结构.

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发表于 2013-1-2 11:57 | 只看该作者
好东西,受益了。

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发表于 2013-1-2 13:54 | 只看该作者
thanks!thanks!

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发表于 2013-1-5 10:37 来自手机 | 只看该作者
支持!很详细!

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发表于 2013-1-8 10:35 | 只看该作者
我现有4层板的PCB,2.4G和5.8G是在顶层,同时DDR也有在顶层走线和底层走线。DDR线宽是5MIL.  _  o: y) E& I; }
而2.4G和5.8G都是12MIL。而DDR和RF处的线都需要50OHM阻抗控制。像这种情况一般该怎样处理
: ]( |8 G) o6 a& s: R 板厂才能做到呢。
仁者无敌,勇者胜利

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 楼主| 发表于 2013-1-8 20:27 | 只看该作者
刘强 发表于 2013-1-8 10:35
6 u( S- o" y6 q* d6 I+ z+ J我现有4层板的PCB,2.4G和5.8G是在顶层,同时DDR也有在顶层走线和底层走线。DDR线宽是5MIL.
% W8 m( {2 F) f1 q9 y 而2.4G和5.8G ...
1 g8 b' `: M% y( S7 E0 c8 W
DDR的阻抗很容易控制,但RF天线可能需采用包地的形式,请问这个4层板板厚是多少MM?

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发表于 2013-1-9 09:09 | 只看该作者
1.0mm或1.2MM都可以,包地具体是怎样呢,又有说需要隔层参考,那具体是怎样做,能否告知?谢谢!
仁者无敌,勇者胜利

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发表于 2013-1-10 10:30 | 只看该作者
这个正好需要补充一下,端个凳凳坐下来好好瞧瞧

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发表于 2013-1-11 08:55 | 只看该作者
十分感谢学习了

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发表于 2013-1-13 14:37 | 只看该作者
不管怎么样?先回后看。

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发表于 2013-1-21 23:59 | 只看该作者
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发表于 2013-1-24 20:02 | 只看该作者
:victory:

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发表于 2013-2-16 15:02 | 只看该作者
此贴必火,先占位支持了,谢谢分享

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发表于 2013-2-20 18:17 | 只看该作者
正煩著不知怎麼使用
) o. F/ X  t9 S8 o+ _" o謝謝啦

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发表于 2013-2-22 13:38 | 只看该作者
学习

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发表于 2013-2-22 14:02 | 只看该作者
板厚1.2mm,4层板应该怎么叠层,层压结构是如何
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