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楼主: li_suny
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《Mentor SiP系统级封装设计与仿真》出版与技术答疑!

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 楼主| 发表于 2013-4-22 10:17 | 只看该作者
sexfei 发表于 2013-4-20 01:21
: J; u( Q/ G, rliyang:1 ?! l  N; n( t  Z. a2 M
你好!能不能把一列多个bondfinger以某一固定间距定位在某一固定坐标上?说说方法!灵活性上好像 ...

1 ^$ D1 n6 R3 h间距一般是按照规则设置中的Pad to pad的间距,可自动放置。
/ L% r; Y0 @, x8 n放置在固定坐标上,这个应该无法自动处理,需要手工来放置了。

bonding_gen.png (38.41 KB, 下载次数: 1)

bonding_gen.png

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 楼主| 发表于 2013-4-22 10:21 | 只看该作者
fenqinyao 发表于 2013-4-20 09:16 % C( k3 \* D4 A, D0 x* q
如果地线是环路的话,推挤的效果就要差很多,确实是没法和PADS Router(2007以后的版本,2007以前的版本有 ...

3 c8 D4 c9 _/ i' ]& }5 ~! n) p3 c0 j哦,这个倒没有遇到过。环路地用的比较少

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 楼主| 发表于 2013-4-22 10:26 | 只看该作者
fenqinyao 发表于 2013-4-20 09:17 - g/ Q9 i: B4 K) q, I5 O
1、注意一下,后放置的Shape的优生级会比之前放置的高,所以要设置一下优生级,也就是在绘图工具上调整 ...
3 _$ ?% H& R  n/ X" I6 g
感谢提醒,负片需要特别注意一下!

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 楼主| 发表于 2013-4-22 10:30 | 只看该作者
yth0 发表于 2013-4-20 16:47
% h& `: D) R; `# w; F3 f这个分两次挖就行了吧?
& P. I" {- C6 d! O# R3 D
这个你可以尝试一下,1 L3 p! M" _2 S% L3 F# K- G
我用的是先挖外边方框,再添内部铜皮的方法,形成这样特殊的空腔。

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发表于 2013-4-22 14:09 | 只看该作者
li_suny 发表于 2013-4-22 10:17
. m  n$ _  p$ n* F3 a3 Q8 S  ~间距一般是按照规则设置中的Pad to pad的间距,可自动放置。& _* W/ n% N/ ]
放置在固定坐标上,这个应该无法自动处理, ...
' g  U+ e9 ]) J+ X& D5 b
比方说每边放置三列,一次放置一列,能把每一列放置在固定的坐标上吗,就像做封装时放置一列焊盘时,按一下F3键,就能输入坐标放置了!

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发表于 2013-4-23 08:30 | 只看该作者
li_suny 发表于 2013-4-22 10:30
, \9 v  R& G# Z. e这个你可以尝试一下,+ n+ {5 Q, L. B9 ~, P' a. l
我用的是先挖外边方框,再添内部铜皮的方法,形成这样特殊的空腔。

1 V: `7 ]/ J* Y& p- I呵呵,我试了一下,两次挖可以,我觉得主要是想挖去的那部分中间有空腔,软件被整晕了,不知道该怎么挖了,{:soso_e113:} 如果把这个图形打散,形成2个中间没有空腔的图形就可以挖了。
  W9 J. r9 o# h% F2 O% H* k5 I

8 q5 f1 I% `! t' M/ ?) _# F  z4 _; }6 T2 x3 A

* E$ Y% b0 l# K  k0 R5 S
- P( p$ a) R) b4 B3 y( c: P6 [) ?0 }% [+ M

. h4 t; r( K3 R8 Q. \& k; b( Q/ I% |1 M3 G0 a
# X7 A8 W4 w" ~# w; q

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 楼主| 发表于 2013-4-23 11:00 | 只看该作者
sexfei 发表于 2013-4-22 14:09 ! T$ [. ?* [/ F3 d3 X4 i
比方说每边放置三列,一次放置一列,能把每一列放置在固定的坐标上吗,就像做封装时放置一列焊盘时,按一 ...

' h0 y, V+ H; X: J放置Bondpad(bondfinger)就像是布线一样,对坐标确实没有严格的要求,实际上打线的时候也是如此。& }- M3 `- o2 A- d9 Z2 I3 C
当然放置整齐会比较美观,我通常是设置一定的Grid或者辅助线来对准。( d9 {1 l1 F- _! m3 G/ ~5 I1 x8 c2 S

) u+ P0 B: Z/ E. x" `建库的时候放置焊盘可以输入坐标,因为焊盘对位置要求很精确,而Bondpad对此并没有要求,因为打线时是很灵活的。
6 X) }9 e9 P. Z所以,将Bondpad理解为布线的一部分会更加合理。

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 楼主| 发表于 2013-4-23 11:03 | 只看该作者
yth0 发表于 2013-4-23 08:30 3 r6 j, W- P' z( d  Y* M0 ?
呵呵,我试了一下,两次挖可以,我觉得主要是想挖去的那部分中间有空腔,软件被整晕了,不知道该怎么挖了 ...

3 I! U- r; |* w  }0 c  @你这个思路很好,通过两个多边形图形组成了一个中空的非多边形图形。
; b8 `9 G. q+ ]. {" [这种思路可以推荐给大家,谢谢!

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发表于 2013-4-27 13:32 | 只看该作者
请问在Expedition PCB 中什么时候可以用Constraint Editor System中的file>Import>Layout Template中倒入Layout Template?现在发现有块PCB中的Layout Template有点问题,想重新倒一下Template但是Import>Layout Template是灰色的,不可以用,什么情况下可以用呢?谢谢!

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发表于 2013-4-27 14:15 | 只看该作者
本帖最后由 lovelijizhi 于 2013-4-27 14:21 编辑 / J1 B6 u6 j9 N# u
' d+ q7 X6 V! Q. l
大家好!下面是对369#的解释。这块PCB最开始用的是4层板的layout template,后来改成单面板,下面发现有图示错误。7 y( `9 d9 ^" L
Layer Range: Layer 1-4,应该是Through Via的。project文件见下面的zip。请问怎么重新倒入layout template?谢谢!

1.JPG (73.41 KB, 下载次数: 3)

错误画面

错误画面

012_345_67890_01_check.zip

4.83 MB, 下载次数: 28, 下载积分: 威望 -5

怎么重新倒入Layout Template

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发表于 2013-4-28 08:54 | 只看该作者
怎么没人回复?

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 楼主| 发表于 2013-4-28 12:00 | 只看该作者
本帖最后由 li_suny 于 2013-4-28 12:04 编辑
4 D/ G4 V7 R) t' Q& ?5 v7 ]  r) B! G1 m
lovelijizhi 发表于 2013-4-27 14:15
* I: |, W' |6 m* }1 `1 O- _大家好!下面是对369#的解释。这块PCB最开始用的是4层板的layout template,后来改成单面板,下面发现有图示 ...

& o$ j) ]8 _/ M  q( l+ `' S# F6 r) |- n: G# g) c
“import Layout template“( `: E4 I$ c  @4 L
功能只在开始设计原理图的时候可以用,方便原理图设计师对板层进行规划,这时候,从原理图中打开CES,可以使用此功能。! b: J1 x5 Y5 M8 G2 C$ M' d
5 \4 E- w' X( c; z0 Z  e4 v
而当进入PCB以后,有了确定的层叠,这个功能就变灰色了,不能再重新导入了,这时候就需要从PCB中的Setup Parameter中去更改层叠设置。
4 U: ]# r7 ~; B, N" ]& s
6 l! y7 [1 L! ~, X1 F4 {, G* ^

import_layout_template2.png (13 KB, 下载次数: 1)

import_layout_template2.png

import_layout_template.png (31.96 KB, 下载次数: 1)

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发表于 2013-4-28 13:48 | 只看该作者
在7.9.4版本里,即使在PCB里变更了层数,回到CES里,底部信息窗口显示的template仍然是最初的layer;; d1 ]8 ~4 W2 J8 M' l8 z9 V, x$ S

7 H3 w& E& \1 Z% P比如最初采用了6 Layer template,后在PCB中增为8 Layer,打开CES,底部的Output窗口仍然显示 Layout Template: "6 Layer Template";
4 }4 ?: z* {  I  h) k
/ v$ Q$ }7 U# z+ Z! [, y虽不影响其他任何设计,但总觉得有点疙瘩,嘿嘿……

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 楼主| 发表于 2013-4-28 13:59 | 只看该作者
simhfc 发表于 2013-4-28 13:48
5 @# F& r& W' N+ ]$ x在7.9.4版本里,即使在PCB里变更了层数,回到CES里,底部信息窗口显示的template仍然是最初的layer;
& }$ u; X* t5 W  ^- e2 R; o8 Q, o- f5 @" n
比 ...

- U4 |* c0 X. h" ]* d这个信息是正确的!说明这个设计引用的模板(通常是在库里定义好的模板)。. }+ E, }+ ]5 Q& @1 X. a' W

: M4 P/ T4 E/ H6 z- T7 F3 y无论后来设计变成了什么样子,包括层数、层叠结构、外框等,但最初引用的模板是不会变的。
) ?' v" |) a- h相当于设计最初始的状态的记录。

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发表于 2013-4-28 21:19 | 只看该作者
本帖最后由 simhfc 于 2013-4-28 21:23 编辑
5 S& W* ], W& t8 I
li_suny 发表于 2013-4-28 13:59
1 c. P  w, B6 q  u6 u! ~# T  ]这个信息是正确的!说明这个设计引用的模板(通常是在库里定义好的模板)。
7 H4 E  ]* l/ X, w# e4 W
1 a% ~. X- L+ x$ T) C/ f, i/ |无论后来设计变成了什么样 ...

0 E  n: o. m; L& A* i! y9 r" w7 [0 q% I, a5 m1 E7 Y
我能理解,但PCB的Layer都已经变动了,CES里的Stackup也同步变化了,仅仅在信息显示上仍给出老模板的信息已经没有用处了,还不如显示与当前设计对应的信息;8 A. Z6 s, ?8 k9 D
& y0 Y, L- q) v% \3 u  V* P
毕竟Stackup如果需要变更,在设计开始后不久、布线等工序完成之前就需要着手了,那样底层的变动,保留最初原始信息的意义不大。
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