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本帖最后由 pwj6323 于 2012-12-13 14:41 编辑
7 c& k( C+ M& aTiv 发表于 2012-12-13 10:18 ' G4 t% h# `( z. v% W
能麻烦普及一下基础吗??呵呵
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1、走fly-by结构 是如何实现(或为什么能) “更有效的控制DDR3的阻抗连 ...
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1、走fly-by结构 是如何实现(或为什么能) “更有效的控制DDR3的阻抗连续”?
$ H d7 d& A* R5 R8 r这可以从DDR1,DDR2说起,由于芯片内部没有时序控制功能,为了满足时序建立、保持时间的裕量,我们只好走T形连接、树(星)形连接,但对于T形和树形都存在较长分支走线的现象,因此在DDR2的地址线上需要拉一下50-120的拉电阻,电阻值的大小除了起电压偏置效果,还可以将分支两端的走线阻抗拉高(见ATI规范中)。
5 n7 Z- a7 E1 A8 }& ]' A# b; D而fly-by,与菊花链类似,但要求更短小的分支,因此可以更好地控制分支带来的信号反射现象,这种走线方式对于更高速并口走线的阻抗控制具有更有效的作用。当然,此种方式对于PCB上任何走线都是需要遵循的真理。{:soso_e100:} - D' E0 y, f4 t% V( y/ F
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2、在DDR3上,阻抗不连续会带来什么现象和后果?
. `' D6 ]8 c$ J这个可以看下高速设计的理论,阻抗不连续会带来很多问题。。。 |
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