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楼主: wangjing
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关于ddr3等长控制的问题,急!

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 楼主| 发表于 2012-9-4 15:25 | 只看该作者
据说正反贴调不通,所以后来又将芯片全放在正面呢,大家不要被误导了

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 楼主| 发表于 2012-9-4 15:27 | 只看该作者
ddr2可以正反贴,ddr3不可以

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18#
发表于 2012-9-4 15:29 | 只看该作者
你的地址线是什么TOP?

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 楼主| 发表于 2012-9-4 15:34 | 只看该作者
252631 发表于 2012-9-4 15:29 ' W' ~6 h8 W+ Z6 P* n' g8 l' B3 L
你的地址线是什么TOP?

0 R0 p$ @) ]" q2 j0 f5 q- g! J什么意思?地址走在内层了

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发表于 2012-9-4 15:35 | 只看该作者
拓扑结构?不是层面的意思。

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发表于 2012-9-4 23:11 | 只看该作者
wangjing 发表于 2012-9-4 15:27
, ?8 h4 ]; F& Kddr2可以正反贴,ddr3不可以
9 J! B$ M3 C. J2 n
不知道你有多少个内层走线。我觉得你截的那个图走的拓补结构不怎么合适,DDR3地址线一般是走菊花链吧。DDR3可以正反贴的,不过要错开。

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发表于 2012-9-5 00:14 | 只看该作者
wanglan 发表于 2012-8-31 11:44
  C/ i4 B% s3 q, P感谢学习了!

: G5 `  i& F& k. q3 |: F上面的回答都是理论的东西,只能体现回答者多么只是渊博,并给不了layout 上面帮忙!
( m5 Y2 M! S/ B, K+ T9 p5 S* X7 |  p# j6 l! N9 l
下面给Intel 主板设计指南里,给出的DDR3 分组等长的规则,希望对layout者有提示。, @# I, S9 f' o4 z# s
7 n. c8 P9 K. z, ?& L7 I1 C( B; r
注意:ddr3 数据时64位 ,分8组分别等长。) p( ^5 T; E9 I: L( N/ s6 P" r9 l( [

+ M& d; \- {& Y6 L: PDDR3 Data Group Specifications        Min        Max1 L0 r7 d8 h) t6 l5 A; D
DQ/DM/DQS/DQSB Matching                0.010
/ [/ ^4 j' z/ e# L0 PDIMM0 to DIMM1 Region                0.500
( h$ Q  h& l1 v# _               
' V2 ?1 a4 D. K4 x' z* i  gDQS/DQSB/DQ/DM  min/max               
1 F* D  k( c  eByte Group 0               
( J) ^+ ^( U6 ZDie-2-DIMM0        2.900        4.9003 ~% c# P; |; L1 U1 m
Die-2-DIMM1        3.000        5.0001 O4 h' r0 y2 r+ |4 i0 w
Byte Group 1                ( v% W6 w- B& D! d: a; D6 R2 s
Die-2-DIMM0        2.500        4.500
% e; p2 L( @$ T9 z8 eDie-2-DIMM1        3.000        5.000
. B8 O) l! g0 g; bByte Group 2               
( E( B8 z! q6 w/ @Die-2-DIMM0        2.400        4.4003 I  B5 u$ B' S' H& D5 `% v" ^
Die-2-DIMM1        2.500        4.500
& t1 d/ }+ t  T3 S' C2 \* ?Byte Group 3               
: [" N. J6 Y: ^: y7 q* F  [Die-2-DIMM0        3.000        5.000
! H- y; {" s; j5 s$ yDie-2-DIMM1        3.000        5.000
0 T$ z) N, E; u5 PByte Group 4               
2 q- d* |5 S, x8 P/ L/ yDie-2-DIMM0        3.000        5.000% I. O4 h8 M' j- B! E% N2 b5 `8 w; q- C
Die-2-DIMM1        3.500        5.500
7 y9 d6 `: l$ F. ~Byte Group 5                * Y; c) R$ |7 \9 E5 _1 ?
Die-2-DIMM0        3.500        5.500' q( V, O9 `, T) v" i* V7 q( f
Die-2-DIMM1        4.000        6.000$ g# ^% U8 q" }  v* F2 @
Byte Group 6                / E* N+ @- Y; T
Die-2-DIMM0        4.000        6.000
! C( s" J* n2 F5 sDie-2-DIMM1        4.500        6.500
0 D0 N: l' x) e0 s6 y, [, vByte Group 7                - k$ R: _5 F* D& x5 M$ p# Z" p% ^
Die-2-DIMM0        4.500        6.500) o% ~: y7 j3 C
Die-2-DIMM1        5.000        7.0004 [2 f' t9 s/ y9 M
                  a! V' K) s/ o7 X# ^4 U+ ]
Strobe to Clock Length Matching Rules                2 @$ I; ]1 ?; P. p2 Y  J9 Y
Clock – DQS[0]               
; O' }9 s0 A5 ?Die-2-DIMM0        1.100        0.100
; q7 ]% i9 W( R) Q3 V& D8 ZDie-2-DIMM1        1.000        0.0004 W: h3 c3 A. T  z# u
Clock – DQS[1]                1 l# q6 Q; j9 N& L3 v3 Q
Die-2-DIMM0        1.500        0.500
+ d  h8 _# S, O0 p  a+ Q% i) @. k+ fDie-2-DIMM1        1.000        0.0008 N# N+ I4 `; \3 N: D: d) k- r3 |* u
Clock – DQS[2]                % m2 a5 h/ j- t* h' s- }, {
Die-2-DIMM0        1.600        0.600% }+ f6 I9 P/ F& y/ T, k$ o
Die-2-DIMM1        1.500        0.500
( Z- k* a3 Z( o4 u4 L/ p9 EClock – DQS[3]               
, ~/ U$ P! e# m$ kDie-2-DIMM0        1.000        0.000
" C3 p1 r. D& r- ?8 I" Q+ |Die-2-DIMM1        1.000        0.0009 D: S4 |2 {2 Q* S. z
Clock – DQS[4]                5 N. P" h" n8 V$ `7 ^
Die-2-DIMM0        1.000        0.0006 Y& r: U7 G8 d  D
Die-2-DIMM1        0.500        -0.500, Y  C, I0 P& p
Clock – DQS[5]               
' K( t6 ?5 d1 V* G: \; T0 g- D- vDie-2-DIMM0        0.500        -0.500# I1 j) H5 q1 L( o, u
Die-2-DIMM1        0.000        -1.000
& f, O0 ~2 g% ^! wClock – DQS[6]               
+ @( e* w, x* Z) BDie-2-DIMM0        0.000        -1.000, o. C6 k  S" _! f+ M
Die-2-DIMM1        -0.500        -1.500' W! N2 Q$ A- }) M' L$ l4 ]
Clock – DQS[7]                : q' j' m1 t1 L
Die-2-DIMM0        -0.500        -1.500
( f8 M5 ^- A3 K5 \/ y+ iDie-2-DIMM1        -1.000        -2.000
. P1 P, Y6 x7 r, A
: S  R1 X; a3 g, H+ d0 E/ P, E4 F( g' A5 O. q$ _: u& Q& H
下面看其中一组:
6 K$ ]. a0 \0 W说明1,这是excel copy 下来的,有兴趣研究的,就copy 回 execel去分析吧
1 s% o4 l( P( n4 c$ E( ~: j4 n2 J说明2,这个等长,包括了intel 芯片组北桥芯片的内部长度!即实际长度=BGA内部长度+走线长度
4 v) o# K: ]; L( l+ I说明3,这第一组平均长度在3456.1mil ,max-min=3.4mil! M6 V$ Q' V. s/ C4 m% y/ p

, j; P  f4 {3 t* G: H2 x$ i
" Y5 f5 R! m' [2 P- \$ K7 k  |DIMM0 Clock Lengths                                                                                                                4.5390        4.5390& L3 p+ r9 K. n+ R) m0 q
DIMM0 Byte Groups 0                                                                                                 Pkg + MB        (max - min)        CLKmin - DQS        CLKmax - DQS
% @1 X+ c$ I3 _- w; CTarget Lengths & Matching                                                                                                2.9 to 4.9        ≤ 0.01        1.100        0.100
' x( X2 w6 B! V1 k0 Y+ ~DDR_B_DQS_0        AW8        0.7081                DQS0        7                2.74802        0.0000                                3.4561        0.0034        1.083        1.0833 a# ^! p! o5 K+ u0 c" @) E
DDR_B_DQSB_0        AW9        0.6557                DQS0#        6                2.80238        0.0000                                3.4581                1.081        1.081
* |  H* k5 f6 l2 j' ]. mDDR_B_DQ_0        AV7        0.5394                DQ0        3                2.917        0.0000                                3.4564                        6 {' O# w0 L; e5 _
DDR_B_DQ_1        AW4        0.6155                DQ1        4                2.8418        0.0000                                3.4573                       
7 x# o+ _* }. ?, tDDR_B_DQ_2        BA9        0.6369                DQ2        9                2.82197        0.0000                                3.4589                        ' v- Y  f; \) I$ r4 }( B; h
DDR_B_DQ_3        AU11        0.6333                DQ3        10                2.82405        0.0000                                3.4574                       
& ~( _7 C4 g& j7 U& n! ~. F! ^' fDDR_B_DQ_4        AU7        0.5371                DQ4        122                2.92064        0.0000                                3.4577                       
, \6 K: E# Q) T* e# Z+ v1 XDDR_B_DQ_5        AU8        0.5191                DQ5        123                2.9398        0.0000                                3.4589                        / N* J: R" _0 k4 y/ Z
DDR_B_DQ_6        AW7        0.5991                DQ6        128                2.85637        0.0000                                3.4555                       
4 F/ N% k7 Q2 C& ]( fDDR_B_DQ_7        AY9        0.7033                DQ7        129                2.75472        0.0000                                3.4580                       
7 P( Q2 A& _1 GDDR_B_DM_0        AY6        0.7665                DM0        125                2.6896        0.0000                                3.4561                       
5 Z2 I* W/ ]! U6 t. y. B  ]- E; J; t( }) u

* }$ U4 H# k: n( ^再看第二组:
) w8 n( l$ ?) b/ _/ J: ^说明3,这第一组平均长度在3200mil ,max-min=1.9mil  ==》 注意啦, 第二组等长 3200 mil 与第一组等长3456mil 是不一样的!!!
" F+ v- G, s$ b0 ?. O: s3 H, x
( x( b) F# X/ n( T* r4 t: t( z: p; Z" }' y4 A' v& p6 C
0 q. t6 m3 r0 G6 |9 y% P
DIMM1 Byte Groups 1                                                                                                 Pkg + MB        (max - min)        CLKmin - DQS        CLKmax - DQS4 Z* T3 s5 a% b
Target Lengths & Matching                                                                        ≤ 0.5        ≤ 0.5                3 to 5        ≤ 0.01        1.000        0.000
, o0 Q) Y& J6 IDDR_B_DQS_1        AT15        0.5263                DQS1        16                2.7943        0.0000        0.0000        0.0000                3.3206        0.0019        -2.969        -2.931# s# B$ @7 c8 N; k9 z
DDR_B_DQSB_1        AU15        0.5737                DQS1#        15                2.7459        0.0000        0.0000        0.0000                3.3196                -2.968        -2.930
, B, m' [# U3 H  n& S% P, U4 @3 KDDR_B_DQ_8        AY13        0.6526                DQ8        12                2.6674        0.0000        0.0000        0.0000                3.3200                       
" G& K& @9 a3 dDDR_B_DQ_9        AP15        0.5135                DQ9        13                2.8080        0.0000        0.0000        0.0000                3.3215                        3 n0 o4 R3 E2 R& E7 h; Z  o
DDR_B_DQ_10        AW15        0.6721                DQ10        18                2.6481        0.0000        0.0000        0.0000                3.3202                       
6 ]1 o! u7 Y+ e6 V5 G# e& }DDR_B_DQ_11        AT16        0.7091                DQ11        19                2.6114        0.0000        0.0000        0.0000                3.3205                       
- R; ]3 T% K" t1 B7 q3 Z, F- BDDR_B_DQ_12        AU13        0.5236                DQ12        131                2.7960        0.0000        0.0000        0.0000                3.3196                        ( P8 `2 [, T- ]
DDR_B_DQ_13        AW13        0.6405                DQ13        132                2.6807        0.0000        0.0000        0.0000                3.3212                        0 I- x5 V  Z& l1 i# ^8 {8 {
DDR_B_DQ_14        AP16        0.6498                DQ14        137                2.6708        0.0000        0.0000        0.0000                3.3206                        ; Q1 G: ~# b; q+ [$ v) O! \
DDR_B_DQ_15        AU16        0.6571                DQ15        138                2.6632        0.0000        0.0000        0.0000                3.3203                       
1 d; o/ r6 K' Z6 a. JDDR_B_DM_1        AR15        0.5973                DM1        134                2.7233        0.0000        0.0000        0.0000                3.3206                       
8 T0 H; ]" [8 Z  Z

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发表于 2012-9-5 14:23 | 只看该作者
wzwang2000 发表于 2012-8-7 13:51 4 A: ?3 Z9 B: J! r/ M' l/ @4 s
这主要要看你ddr3的频率是多少,然后还有板子的介质,地址线之间相差不能超过波长的十分之一,比如说,ddr3 ...
+ n( W. M6 Y! O* T* h" M
很精典,学习下

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 楼主| 发表于 2012-9-5 15:28 | 只看该作者
dszfp 发表于 2012-9-4 23:11
0 }& K2 U# I" s不知道你有多少个内层走线。我觉得你截的那个图走的拓补结构不怎么合适,DDR3地址线一般是走菊花链吧。DD ...
' Q7 x  X( E4 P5 @2 Q) E7 l7 x
是的,已经修改了

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发表于 2012-9-5 16:24 | 只看该作者
地址线应该不超过2000mil吧,

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发表于 2012-9-13 09:29 | 只看该作者
DDR3的拓扑结构有好几种,选择适合目前摆放的结构。timing match要根据芯片的规格建议来设定,不然自己要做仿真多麻烦!

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发表于 2012-11-20 00:39 | 只看该作者
学习了!

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发表于 2012-11-20 09:39 | 只看该作者
挺专业的,学习一下!

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 楼主| 发表于 2012-11-20 09:45 | 只看该作者
dszfp 发表于 2012-9-4 23:11 . U" o- {# W7 V! D$ b$ Q
不知道你有多少个内层走线。我觉得你截的那个图走的拓补结构不怎么合适,DDR3地址线一般是走菊花链吧。DD ...

' i  R+ Y2 W" r# e/ L多谢了,是否可以截个大图看看地址和数据线等长的绕法?
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