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楼主: ddhr2001
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巧用DATASHEET核对板文件中元件物理封装的正确性

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发表于 2014-3-3 21:38 | 只看该作者
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发表于 2014-3-4 10:30 | 只看该作者
chensi007 发表于 2014-3-3 19:20
5 q$ N! |$ k# l- O# e那是你对你自己作的封装很自信。你相信你的封装不可能错。  但常在河边走。。。。
& A' D( h+ n5 [4 e
/ S+ r5 a+ J  u- [. Z3 c我在作封装时 ...
  |+ u/ G" Y0 ~) n) }9 j% b9 L
用自己的库,很爽,最常出错的不是封装尺寸不对,是管脚顺序不对,尤其是三极管,MOS管,这个的根源在原理图,你懂的……
: {5 |; n! |( `/ N' n" J1 O要说封装不合适,倒有一次,是调用别人的封装,结果焊盘太窄了,还好能用。1 n* M, b7 F  w0 B: o- z# v
如果管理好自己的库文件,就不必要后续的封装检查,除非调用出错。总之,还是粗心导致。" Q+ ^, O( u3 C- Q6 A
不要痴迷于阅读成功人士的传记,从中寻找经验,这些书大部分经过了精致的包装,没有人会随随便便成功。更不要痴迷哥,哥还没成功!

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发表于 2014-3-5 12:30 | 只看该作者
也是一种方法。

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发表于 2014-10-28 15:15 | 只看该作者
chensi007 发表于 2014-3-3 19:20& E3 S0 |6 g" o1 B/ v
那是你对你自己作的封装很自信。你相信你的封装不可能错。  但常在河边走。。。。
3 f8 b* @( x& \) P" [5 q7 l- V% p
% j8 b4 |. Q" S8 u% h0 L# y5 v我在作封装时 ...

) {7 ^% n" u6 b  k- m4 t可是选哪个点来将提取的图与建好的封装重叠呢?
" x8 t) x  a+ }

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发表于 2014-10-28 18:15 | 只看该作者
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发表于 2014-10-28 22:05 | 只看该作者
Jessica2014 发表于 2014-10-28 15:15. ^) L8 W2 |4 y$ [# q; ?8 D
可是选哪个点来将提取的图与建好的封装重叠呢?
) W. u# K  J6 J' T( ^7 t
建LIB时,要画元件的BODY。如下图的D1和E1.这个大小正好和提取的图最后是能吻合到的。。。。。。。。。。。。。。。6 P4 t" ~, e  N
$ @( V3 ~/ o- F( E8 p

" K3 c4 a7 H. E6 I3 ?0 w* M0 S

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发表于 2014-10-29 09:45 | 只看该作者
chensi007 发表于 2014-10-28 22:05
% P1 T9 z) ~$ }; k* G; @4 I建LIB时,要画元件的BODY。如下图的D1和E1.这个大小正好和提取的图最后是能吻合到的。。。。。。。。。。 ...
0 H! q# D7 n* }  I2 L
哦!好的,谢谢!

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发表于 2014-10-29 09:52 | 只看该作者
这个方法不错,我一般是做个标注,方便检查,不过一般封装都没问题。

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发表于 2014-12-15 16:11 | 只看该作者
就是有点晕

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发表于 2014-12-16 16:33 | 只看该作者

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发表于 2014-12-16 20:00 | 只看该作者
顶一个,CorelDRAW竟然可以这么玩

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发表于 2015-1-12 17:40 | 只看该作者
只要DATASHEET没错,那么自己做的LIB不会出错的。不过还是谢谢你的分享!
对酒当歌,人生几何?
譬如朝露,去日苦多。
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