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楼主: jimmy
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深圳某公司高级layout工程师面试题目,看看你会几题。

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发表于 2015-3-27 08:19 | 只看该作者
为了答案,我也来顶一下。

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发表于 2015-3-27 08:58 | 只看该作者
100页还有好长的路要走呀!顶起来!

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发表于 2015-3-28 19:50 | 只看该作者
好好好" F; V4 U) b1 a. V

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发表于 2015-3-30 08:39 | 只看该作者
顶起来

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发表于 2015-3-30 14:42 | 只看该作者
盖楼等答案.

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发表于 2015-3-30 16:36 | 只看该作者
顶起来,等答案

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发表于 2015-3-31 11:57 | 只看该作者
有难度啊

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发表于 2015-4-1 16:07 | 只看该作者
顶顶顶顶顶

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发表于 2015-4-3 11:51 来自手机 | 只看该作者
还没回复呢

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发表于 2015-4-3 15:55 | 只看该作者
一年了 还没给答案啊 下面我来盖楼

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发表于 2015-4-3 15:56 | 只看该作者
伟大的度娘 无所不能
; G. f  w- m1 v  @: l1,        PCB上的阻抗怎么控制?
) }0 I! m# n' T+ b$ ]传输线->特性阻抗 ->板材介电常数、板材介质厚度、铜箔厚度、铜箔宽度、绿油
- {) l+ J: y) ~' H6 m

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发表于 2015-4-3 15:57 | 只看该作者
伟大的度娘 无所不能8 e8 j' J$ r% K6 h
2,信号线的传输速率是多少?/ Z( \9 b$ ^8 \1 N
电信号在真空中的传播速度是光速,3 * 10^8 m/s or 11.8 inch/ns .   1 inch = 2.54cm = 1000 mil, 在其他的介质中,如果相对介电系数是Er ,则传播速度为 11.8 / Er^0.5。% R7 R6 [' Q& N5 _, v
5 F- G; F4 ]" u( E
FR4板材信号速度为6in/ns:这样计算出来的
& Q0 U- U* Z4 k* m Vp= V/sqrt(Er)
+ ?' K0 D6 @% ^8 ^5 ?6 i; d Er是FR4的介电常数
2 d$ x9 `4 {8 b+ B7 h V是光速
' d$ g. f$ x* d( y' @# y
8 C/ m- n* c, Y信号在pcb走线上传输需要一定的时间,普通FR4板材上传输时间约为每纳秒6英寸,当然表层走线和内层走线速度稍有差别。
! m5 s  ~0 l1 w( K. R7 a, v5 i 试验中发现的经验数据为,当信号在pcb走线上的时延高于信号上升沿的20%时,信号会产生明显的振铃。对于上升时间为1ns的方波信号来说,pcb走线长度为0.2*6=1.2inch以上时,信号就会有严重的振铃。所以临界长度就是1.2inch,大约3cm, z7 ?3 R, F' Q

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发表于 2015-4-3 15:57 | 只看该作者
伟大的度娘 无所不能6 x" V( f4 q, r% A# c- F
3,        CMOS器件输入管脚在电路中要如何处理?为什么1 |+ d0 o+ Q, `7 w
CMOS器件是电压控制器件,输入阻抗高,CMOS器件不用的输入引脚不能悬空,悬空感应的电压高,会损坏器件。7 r# [0 v* v* }3 G; @* }
如果是功能管脚则要看具体电路,比如与非门的不用的输入脚应该接电源(高电平),或非门的不用的输入脚就应该接地(低电平)。5 R$ U* I' }  c; @
不用的输入管脚都要接地或电源。这是因为COMS是高阻抗器件,要求输入电流很低,所以一旦输入悬空会使得输入不确定,引起输出不确定,影响电路逻辑。 输出管脚不用接。一般地说,不论是否是CMOS或TTL,其输入端如果没有用到,都应该接地或电源(通过上拉电阻)。4 Q$ \# T3 d$ A
对TTL数字电路,输入段悬空等同于输入端是高电平。
+ T2 V$ D" K# I2 p1 X0 J( X0 C也就是说,对TTL数字电路,该脚如果就是输入个“1”,可以让它悬空。; _- F+ h7 T; H$ G' Z) B9 Z9 U$ \( i  K
CMOS电路没有这一项“福利”,一般输入都不要悬空。8 j# B' K# ?" J+ k6 Y
对模拟电路,比如运算放大器,不用的输入端,要胆大爱悬空就悬空,没大碍;要不放心接地就成。
1 R& ?. y5 I' H- B5 [! i: }* g& T1 q悬空会导致静电击穿现象,不是可能,而是早晚会,CMOS的输入端输入阻抗很高,极易积累电荷,当积累量达到一定程度时会击穿栅极。; f9 S" T9 k; ]2 S
管脚本身有配置上拉下拉功能的时候,而且已经配置上下拉的时候,管脚可以悬空。 2 Z- D0 ?5 T6 o
(1)当输入引脚是内部集成了上拉电阻或下拉电阻的, 这时候即使悬空,(可编程器件需要配置为上拉或者下拉输入),也没有问题;, o7 D, G0 t: [. w
(2)集成逻辑门电路在使用的时候,一般不让多余的输入引脚悬空,特别是CMOS电路的多余输入端绝对不能悬空,原因是它的输入电阻很大,容易收到外界静电或工作区域工频电磁场引入电荷的影响,而破坏电路的正常工作状态
2 R: y- X4 H1 Y1 a! {8 u

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发表于 2015-4-3 15:58 | 只看该作者
伟大的度娘 无所不能- ~. K' ~. F, m0 W
4,        TTL电路不能直接驱动CMOS电路的原因是什么?
# K5 l: q+ H9 KTTL电路指电路遵循TTL电平规则(+5V等价于逻辑“1”,0V等价于逻辑“0”),而CMOS电路遵循的电平规则是(3v - 18V等价于逻辑“1”(具体电压德参考芯片供电电源),0V等价于逻辑“0”),由于他们遵循的电平规则不同,所以有时候TTL电路和CMOS电路布不能无缝的直接连接通信
6 K  J& ^- G2 m& V9 I1,TTL电平: 输出高电平>2.4V,输出低电平<0.4V。在室温下,一般输出高电平是3.5V,输出低电平 是0.2V。最小输入高电平和低电平:输入高电平>=2.0V,输入低电平<=0.8V,噪声容限是 0.4V。
4 {% r% k5 ~) X 2,CMOS电平: 1逻辑电平电压接近于电源电压,0逻辑电平接近于0V。而且具有很宽的噪声容限。
6 d9 P& D0 r  e6 Q; r, W- s3,电平转换电路: 因为TTL和COMS的高低电平的值不一样(ttl 5v<==>cmos 3.3v),所以互相连接时需 要电平的转换:就是用两个电阻对电平分压。
. ]" F) Y6 i. |) v& n4 _4,OC门,即集电极开路门电路,OD门,即漏极开路门电路,必须外界上拉电阻和电源才能 将开关电平作为高低电平用。否则它一般只作为开关大电压和大电流负载,所以又叫做驱 动门电路。 6 d5 }  A$ `! B* n
5,TTL和COMS电路比较:
" w" G- H& s1 ]+ A, N# o; {1)TTL电路是电流控制器件,而coms电路是电压控制器件。
' _" D  i! O, c: r/ x+ R" X2)TTL电路的速度快,传输延迟时间短(5-10ns),但是功耗大。 COMS电路的速度慢,传输延迟时间长(25-50ns),但功耗低。 COMS电路本身的功耗与输入信号的脉冲频率有关,频率越高,芯片集越热,这是正常 现象。 " \" ^! L) j+ m9 x/ [4 W/ P+ V, k7 V
3)COMS电路的锁定效应: COMS电路由于输入太大的电流,内部的电流急剧增大,除非切断电源,电流一直在增大 。这种效应就是锁定效应。当产生锁定效应时,COMS的内部电流能达到40mA以上,很容易 烧毁芯片。 防御措施: 1)在输入端和输出端加钳位电路,使输入和输出不超过不超过规定电压。 2)芯片的电源输入端加去耦电路,防止VDD端出现瞬间的高压。 3)在VDD和外电源之间加线流电阻,即使有大的电流也不让它进去。
$ `3 A. I) M; U/ A  n( D4)当系统由几个电源分别供电时,开关要按下列顺序:开启时,先开启COMS电路得电 源,再开启输入信号和负载的电源;关闭时,先关闭输入信号和负载的电源,再关闭COMS
) [% Y* I  D" U2 H. ~5 L4 M8 x' o1.CMOS是场效应管构成,TTL为双极晶体管构成2.COMS的逻辑电平范围比较大(5~15V),TTL只能在5V下工作3.CMOS的高低电平之间相差比较大、抗干扰性强,TTL则相差小,抗干扰能力差4.CMOS功耗很小,TTL功耗较大(1~5mA/门)5.CMOS的工作频率较TTL略低,但是高速CMOS速度与TTL差不多相当。
) v3 z' r1 N: ~2 F% M1 g) p1 g2 M

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发表于 2015-4-3 15:59 | 只看该作者
伟大的度娘 无所不能
8 p$ n% ]# u' Z6 u' Q5 y" Z5,较长的时钟信号要走带状线的原因是什么?. g7 F0 ^7 T3 t8 x" C- \
高频信号线走在表层容易产生较大电磁辐射,也容易受到外界电磁辐射的干扰。将高频信号先布线在电源和地线之间,通过电源和地层对电磁波的吸收,所产生的辐射将减少很多。时钟信号要有良好参考平面。2 ~; }  [7 n! k5 |
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