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第一篇  PCB布线
在PCB设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的， 在整个PCB中，以布线的设计过程限定最高，技巧最细、工作量最大。PCB布线有单面布线、 双面布线及多层布线。布线的方式也有两种：自动布线及交互式布线，在自动布线之前， 可以用交互式预先对要求比较严格的线进行布线，输入端与输出端的边线应避免相邻平行， 以免产生反射干扰。必要时应加地线隔离，两相邻层的布线要互相垂直，平行容易产生寄生耦合。
9 k1 o4 j0 B; c3 D    自动布线的布通率，依赖于良好的布局，布线规则可以预先设定， 包括走线的弯曲次数、导通孔的数目、步进的数目等。一般先进行探索式布经线，快速地把短线连通， 然后进行迷宫式布线，先把要布的连线进行全局的布线路径优化，它可以根据需要断开已布的线。 并试着重新再布线，以改进总体效果。
% @( N- c  r1 x& q$ N9 Q    对目前高密度的PCB设计已感觉到贯通孔不太适应了， 它浪费了许多宝贵的布线通道，为解决这一矛盾，出现了盲孔和埋孔技术，它不仅完成了导通孔的作用， 还省出许多布线通道使布线过程完成得更加方便，更加流畅，更为完善，PCB 板的设计过程是一个复杂而又简单的过程，要想很好地掌握它，还需广大电子工程设计人员去自已体会， 才能得到其中的真谛。
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1 电源、地线的处理
    既使在整个PCB板中的布线完成得都很好，但由于电源、 地线的考虑不周到而引起的干扰，会使产品的性能下降，有时甚至影响到产品的成功率。所以对电、 地线的布线要认真对待，把电、地线所产生的噪音干扰降到最低限度，以保证产品的质量。
    对每个从事电子产品设计的工程人员来说都明白地线与电源线之间噪音所产生的原因， 现只对降低式抑制噪音作以表述：
/ x" e+ S% T( z（1）、众所周知的是在电源、地线之间加上去耦电容。
5 F$ L+ H1 l# g; w6 H* E( O/ m; ^（2）、尽量加宽电源、地线宽度，最好是地线比电源线宽，它们的关系是：地线＞电源线＞信号线，通常信号线宽为：0.2～0.3mm,最经细宽度可达0.05～0.07mm,电源线为1.2～2.5 mm
; U+ S% H; n' E% m5 _对数字电路的PCB可用宽的地导线组成一个回路, 即构成一个地网来使用(模拟电路的地不能这样使用)
（3）、用大面积铜层作地线用,在印制板上把没被用上的地方都与地相连接作为地线用。或是做成多层板，电源，地线各占用一层。
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% r5 Q# v1 m/ R* K$ i7 {2 数字电路与模拟电路的共地处理
9 D% i1 Y( H; F+ B0 X1 k    现在有许多PCB不再是单一功能电路（数字或模拟电路），而是由数字电路和模拟电路混合构成的。因此在布线时就需要考虑它们之间互相干扰问题，特别是地线上的噪音干扰。
2 {& d% n; U  c5 P% Y    数字电路的频率高，模拟电路的敏感度强，对信号线来说，高频的信号线尽可能远离敏感的模拟电路器件，对地线来说，整人PCB对外界只有一个结点，所以必须在PCB内部进行处理数、模共地的问题，而在板内部数字地和模拟地实际上是分开的它们之间互不相连，只是在PCB与外界连接的接口处（如插头等）。数字地与模拟地有一点短接，请注意，只有一个连接点。也有在PCB上不共地的，这由系统设计来决定。
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7 G6 s9 v0 n4 Y: A: ~) I6 g3 信号线布在电（地）层上
0 D! D; y1 Q8 M. q; A! C% `    在多层印制板布线时，由于在信号线层没有布完的线剩下已经不多，再多加层数就会造成浪费也会给生产增加一定的工作量，成本也相应增加了，为解决这个矛盾，可以考虑在电（地）层上进行布线。首先应考虑用电源层，其次才是地层。因为最好是保留地层的完整性。
; s& v2 }5 M# a# J, s( M, x% R% c) ?
4 大面积导体中连接腿的处理
# P- [! d7 e, q4 {& H. D5 l; U2 N$ ?$ O7 ?    在大面积的接地（电）中，常用元器件的腿与其连接，对连接腿的处理需要进行综合的考虑，就电气性能而言，元件腿的焊盘与铜面满接为好，但对元件的焊接装配就存在一些不良隐患如：①焊接需要大功率加热器。②容易造成虚焊点。所以兼顾电气性能与工艺需要，做成十字花焊盘，称之为热隔离（heat shield）俗称热焊盘（Thermal），这样，可使在焊接时因截面过分散热而产生虚焊点的可能性大大减少。多层板的接电（地）层腿的处理相同。

, x  |/ L9 |: d5 布线中网络系统的作用
. h( z- K' h* w0 X    在许多CAD系统中，布线是依据网络系统决定的。网格过密，通路虽然有所增加，但步进太小，图场的数据量过大，这必然对设备的存贮空间有更高的要求，同时也对象计算机类电子产品的运算速度有极大的影响。而有些通路是无效的，如被元件腿的焊盘占用的或被安装孔、定们孔所占用的等。网格过疏，通路太少对布通率的影响极大。所以要有一个疏密合理的网格系统来支持布线的进行。
    标准元器件两腿之间的距离为0.1英寸(2.54mm),所以网格系统的基础一般就定为0.1英寸(2.54 mm)或小于0.1英寸的整倍数，如：0.05英寸、0.025英寸、0.02英寸等。
" k7 s: c" u6 D, B' @& U
1 m5 M' u8 R. @% \& o6 设计规则检查（DRC）
) C& g2 u1 p. p" W0 u- J5 |/ j    布线设计完成后，需认真检查布线设计是否符合设计者所制定的规则，同时也需确认所制定的规则是否符合印制板生产工艺的需求，一般检查有如下几个方面：
4 ?) y3 ?  ?8 O5 P1 K+ U, V/ J
（1）、线与线，线与元件焊盘，线与贯通孔，元件焊盘与贯通孔，贯通孔与贯通孔之间的距离是否合理，是否满足生产要求。
（2）、电源线和地线的宽度是否合适，电源与地线之间是否紧耦合（低的波阻抗）？在PCB中是否还有能让地线加宽的地方。
（3）、对于关键的信号线是否采取了最佳措施，如长度最短，加保护线，输入线及输出线被明显地分开。
- Z2 E( S. z( O, d' O（4）、模拟电路和数字电路部分，是否有各自独立的地线。
- n* J+ h; N* Z8 J- z8 T; R2 h（5）后加在PCB中的图形（如图标、注标）是否会造成信号短路。
（6）对一些不理想的线形进行修改。
（7）、在PCB上是否加有工艺线？阻焊是否符合生产工艺的要求，阻焊尺寸是否合适，字符标志是否压在器件焊盘上，以免影响电装质量。
（8）、多层板中的电源地层的外框边缘是否缩小，如电源地层的铜箔露出板外容易造成短路。
8 p, ~+ g  D: Q. u0 W; E" _& [下面的问题，属于网友经常提问的。现在把问题和解答整理出来。
A.常用软件的下载问题   
B.Protel常见操作问题
0 z- m1 p; p( {' v* Q% iC.Protel中常用元件的封装
6 L% Q$ H& D) x2 \5 ?0 LD.由SCH生成PCB时提示出错(Protel)
& x/ [% G0 }5 _& [; M! f6 C: IE.电容，二极管，三极管，有源晶振等器件的极性
F.不同逻辑电平的接口                                                         

3 a. G; B  W9 @0 z0 x' n7 g* u) IG.电阻，电容值的识别                                                         

+ K* Y. q: ?6 L# K. Q3 C( D! N# x

A.常用软件的下载问题：
" f" ^/ o' M# F6 ?4 D% X2 s★Protel99se,Protel2004从哪里可以下载到
    在百度上搜。
3 R2 }$ d7 U7 I3 o; C
5 y) j- l# Y2 P; Q, |$ ^B.Protel常见操作问题:
5 d/ Y% Z0 G% ]! x' ~0 a/ R★如何将原理图中的电路粘贴到Word中
+ H# w. T5 r& R/ i1 [    tools->preferences->Graphical Editing,取消Add Template to Clipboard,然后
复制

" Q/ T. }+ {& j* z★如何切换mil和mm单位
. Z/ r$ O0 k" [: a0 ]& v* Y    菜单View->Toggle Unit，或者按Q键
- }1 P, U9 V4 _/ p
★取消备份及DDB文件减肥：
/ y* ?2 d. X; G8 N    "File"菜单左边一个向下的灰色箭头
    preference-->create backup files
    design utilities-->perform compact after closing

★如何把SCH，PCB输出到PDF格式
# O; c, @' k: B, n* D, O- O    安装Acrobat Distiller打印机，在acrobat 5.0以上版本中带的。然后在Protel里
的打印选项里，
    选择打印机acrobat Distiller即可。

★如何设置和更改Protel的DRC(Design Rules Check）
) U. v2 j2 E8 d9 Z( I' A6 s9 z) r    菜单Design->rules。只针对常用的规则进行讲解：
    * Clearance Constraint:不同两个网络的间距，一般设置>12 mil，加工都不会出
% T. R) c7 u; N7 b1 g  `0 t问题
) E9 e2 z' e' K# \" Y$ O7 |    * Routing Via Style:设置过孔参数，具体含义在属性里有图。一般hole size比导
+ O& G9 U3 @* ~' B线宽8mil以上，diameter
      比hole size大10mil 以上
    * Width Constraint:导线宽度设置，建议>10mil
5 O4 _( m4 @( S- [! Q$ R( r" l& w
/ F% h" p0 p# ~8 S2 L' ^2 ^                                   
C.Protel中常用元件的封装
5 s5 ?* C/ C; q
   以下元件在Protel DOS Schematic Libraries.ddb,Miscellaneous Devices.ddb(以
- A  A. p7 `; ~4 l9 S& b上
是schlib)Advpcb.ddb,Transistors.ddb,General IC.ddb(以上是PCBlib)等库文件中，
7 o4 s& ?6 @; |. \& m5 m8 C可
以使用通配符“*”进行查找。另外，希望大家把自己做的封装传到ftp上共享，这样可
  F$ R) s: o1 Y' {' \8 L以节省时间。

+ l4 N. `" H: e7 [0 b                                直插                    表贴
电阻，小电感                    axial0.3/axial0.4       0805/0603等
+ ?( O' s' q2 K& W小电容                          RAD0.1/ RAD0.2          0805/0603等
5 h$ ~2 b1 B+ u+ Z) U/ D( O, w" i电解电容                        (RB.2/.4)               1210/1812/2220等
0 N$ W7 w! j, J; m小功率三极管                    TO-92A/B               
2 e$ _+ m2 j- H3 D& ZSOT-23               
大功率三极管(三端稳压)          T0-220                  
小功率二极管                    DIODE-0.4               自己做
双列IC                          DIPxx                   SO-xx     xx代表引脚
8 I! Q8 E" ?% Z' N2 V% {' a; n/ P数

) r, ~8 ?8 p$ {! K. D有源晶振                        DIP14(保留四个顶点,去掉中间10个焊盘)
- f, ^+ K- K" ~( F四方型IC                        大部分需要自己用向导画,尺寸参照datasheet
接插件                          SIPxx/IDCxx,DB9/DB25(注意male/female的区别)等
4 s3 o' E8 m/ U3 v4 S电位器，开关，继电器等          买好了元件，量好尺寸自己画
+ _$ }2 e, G# f' G8 q* ~% l! H. W提醒:*使用封装时最好少用水平/垂直翻转功能
     *自己建好的元件库或者PCB，一定要1:1的打印出来，和实际比较，以确保无误
     *有条件的话，尽量先买好器件，再定封装，可以节省很多眼泪

                              

( R8 |9 U, m% @) M/ F  j8 k& CD.由SCH生成PCB时提示出错(Protel)

  sch编辑界面中选择design-->updatepcb,在出现的对话框中按“Preview Change”按
5 p! H; ]; K& W) G# a% Z: U- x( K钮
) ~( z2 u) r( R6 J，选中 Only show Errors会列出所有错误

      错误类型                                解决办法
0 r$ h; R3 L5 ]9 S! T$ X1.footprint not found           确保所有的器件都指定了封装
                                确保指定的封装名与PCB中的封装名一致
- z. L! }" }. d4 g9 G                                确保你的库已经打开或者被添加
" u/ B- Z, m. i% p  o& k4 [- T2.node not found                确认没有“footprint not found” 类型的错误
                                编辑PCBlib,将对应引脚名改成没有找到的那个node
3.Duplicate sheet number        degisn-options-organization,给每张子电路图编
# u1 R- s1 v) {0 S8 i) N  a+ y号
. k: t( b- A- B' h+ s) y$ Z
( S- H2 l; [6 ~% ]& U
# m9 C6 H$ q* I! _2 S: gE.电容，二极管，三极管等器件的极性问题:
! f6 E% N  t/ c0 i  g/ {
- |* ^- G. Q/ g0 B9 \8 S直插铝电解：负极附近有黑色的“-”标记，如果没有剪腿的话，长腿为正
贴片钽电解：有横杠的一头为正
二极管：    有圈的一头为负
小功率三极管                                 F.不同逻辑电平的接口问题:
* P& q$ d' a2 e7 h4 m5 T: Z/ M, b
CMOS<-->TTL     电源电压相同的条件下可以兼容
* t9 p- d. O  }: T) x( n1 k3.3V--->5V      一般可以直接驱动(以datasheet为准!)
0 `6 @! I: e9 Y6 \9 e1 U7 W5V--->3.3V      74LVT245/74LVT16245
6 H4 W, v* Q+ |: [. x9 o5 I5V<-->3.3V      74LVC4245/74LVC16245
+ Y7 o4 ]$ O) g/ s. _ECL-->TTL       MC10125
' _; W# m" S) f5 a; KTTL-->ECL       MC10124

  o/ A! I+ M3 [& J+ f4 ]
G.电阻，电容值的识别
! A" {" D9 c) B' k1 J
色环电阻:
黑 棕 红 橙 黄 绿 蓝 紫 灰 白
0  1  2  3  4  5  6  7  8  9
6 U- ^7 H' M( H
6 B, ?! S7 b4 T最后一环表示精度,离其他几环比较远(一般是棕色)
3 j( p2 W7 Z. [1 I倒数第二环表示阶数(10^n)
前面的是有效数字
$ n9 \, o7 Q! T( I& N例: “绿棕黑黑棕”这个电阻是510欧
( B5 U  f6 q' e0 M, D2 X7 b
3 d3 E9 W/ |# E7 t& J小电容:
" s7 ^* m$ r9 h  o0 }. e# ]通常以三位数标注,以pf为单位
& V7 c  ]1 q* g% T/ G+ i前两位是有效数字,最后一位表示阶数（为0时，可以空缺):
例:“332”这个电容是3300 pf
   “471”这个电容是470pf   
8 P1 D+ z! M+ ^$ X$ A1 `1 ]   “47”这个电容是47pF
第二篇
1 n$ R4 P" F; T" L% t8 ^           如何实现PCB高的布通率以及缩短设计时间
尽管现在的EDA工具很强大，但随着PCB尺寸要求越来越小，器件密度越来越高，PCB设计的难度并不小。如何实现PCB高的布通率以及缩短设计时间呢？本文介绍PCB规划、布局和布线的设计技巧和要点。 现在PCB设计的时间越来越短，越来越小的电路板空间，越来越高的器件密度，极其苛刻的布局规则和大尺寸的组件使得设计师的工作更加困难。为了解决设计上的困难，加快产品的上市，现在很多厂家倾向于采用专用EDA工具来实现PCB的设计。但专用的EDA工具并不能产生理想的结果，也不能达到100%的布通率，而且很乱，通常还需花很多时间完成余下的工作。
1 q0 t7 D# T; B
% `# M: C9 F/ D2 `　　现在市面上流行的EDA工具软件很多，但除了使用的术语和功能键的位置不一样外都大同小异，如何用这些工具更好地实现PCB的设计呢？在开始布线之前对设计进行认真的分析以及对工具软件进行认真的设置将使设计更加符合要求。下面是一般的设计过程和步骤。  
" a! Y0 p- A' r6 m$ n& |
　　1、确定PCB的层数
% q5 R& d# J8 l- [* B+ M5 O
　　电路板尺寸和布线层数需要在设计初期确定。如果设计要求使用高密度球栅数组(BGA)组件，就必须考虑这些器件布线所需要的最少布线层数。布线层的数量以及层叠(stack-up)方式会直接影响到印制线的布线和阻抗。板的大小有助于确定层叠方式和印制线宽度，实现期望的设计效果。

　　多年来，人们总是认为电路板层数越少成本就越低，但是影响电路板的制造成本还有许多其它因素。近几年来，多层板之间的成本差别已经大大减小。在开始设计时最好采用较多的电路层并使敷铜均匀分布，以避免在设计临近结束时才发现有少量信号不符合已定义的规则以及空间要求，从而被迫添加新层。在设计之前认真的规划将减少布线中很多的麻烦。  
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　　2、设计规则和限制
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　　自动布线工具本身并不知道应该做些什幺。为完成布线任务，布线工具需要在正确的规则和限制条件下工作。不同的信号线有不同的布线要求，要对所有特殊要求的信号线进行分类，不同的设计分类也不一样。每个信号类都应该有优先级，优先级越高，规则也越严格。规则涉及印制线宽度、过孔的最大数量、平行度、信号线之间的相互影响以及层的限制，这些规则对布线工具的性能有很大影响。认真考虑设计要求是成功布线的重要一步。  
% \8 v2 z, R  P( C
1 v) p) g/ v. j$ ]　　3、组件的布局
' O, C0 w6 u, _% Q6 F% Q
  e& _4 ?& k; ]+ G' u) A6 e. P( ]　　为最优化装配过程，可制造性设计(DFM)规则会对组件布局产生限制。如果装配部门允许组件移动，可以对电路适当优化，更便于自动布线。所定义的规则和约束条件会影响布局设计。
2 V1 e, o2 p/ n$ T* I
　　在布局时需考虑布线路径(routing channel)和过孔区域。这些路径和区域对设计人员而言是显而易见的，但自动布线工具一次只会考虑一个信号，通过设置布线约束条件以及设定可布信号线的层，可以使布线工具能像设计师所设想的那样完成布线。  

+ B! D2 d6 @6 T" \* f. h　　4、扇出设计

# s# N" t, _9 d5 R" r' z; R& i, Z　　在扇出设计阶段，要使自动布线工具能对组件引脚进行连接，表面贴装器件的每一个引脚至少应有一个过孔，以便在需要更多的连接时，电路板能够进行内层连接、在线测试(ICT)和电路再处理。  

& c' R+ P: a: w7 ^5 \　　为了使自动布线工具效率最高，一定要尽可能使用最大的过孔尺寸和印制线，间隔设置为50mil较为理想。要采用使布线路径数最大的过孔类型。进行扇出设计时，要考虑到电路在线测试问题。测试夹具可能很昂贵，而且通常是在即将投入全面生产时才会订购，如果这时候才考虑添加节点以实现100%可测试性就太晚了。  
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　　经过慎重考虑和预测，电路在线测试的设计可在设计初期进行，在生产过程后期实现，根据布线路径和电路在线测试来确定过孔扇出类型，电源和接地也会影响到布线和扇出设计。为降低滤波电容器连接线产生的感抗，过孔应尽可能靠近表面贴装器件的引脚，必要时可采用手动布线，这可能会对原来设想的布线路径产生影响，甚至可能会导致你重新考虑使用哪种过孔，因此必须考虑过孔和引脚感抗间的关系并设定过孔规格的优先级。  

. c6 G8 L" t8 f8 u0 J% ?+ }　　5、手动布线以及关键信号的处理  
! v- ^! L' \5 i, @( r
* }$ F# x" F3 ~1 I2 S: |; T4 U: v　　尽管本文主要论述自动布线问题，但手动布线在现在和将来都是印刷电路板设计的一个重要过程。采用手动布线有助于自动布线工具完成布线工作。如图2a和图2b所示，通过对挑选出的网络(net)进行手动布线并加以固定，可以形成自动布线时可依据的路径。  

/ ]7 G- j6 k: y5 ?! _　　无论关键信号的数量有多少，首先对这些信号进行布线，手动布线或结合自动布线工具均可。关键信号通常必须通过精心的电路设计才能达到期望的性能。布线完成后，再由有关的工程人员来对这些信号布线进行检查，这个过程相对容易得多。检查通过后，将这些线固定，然后开始对其余信号进行自动布线。  
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; O5 v/ U. a7 W　　6、自动布线  

　　对关键信号的布线需要考虑在布线时控制一些电参数，比如减小分布电感和EMC等，对于其它信号的布线也类似。所有的EDA厂商都会提供一种方法来控制这些参数。在了解自动布线工具有哪些输入参数以及输入参数对布线的影响后，自动布线的质量在一定程度上可以得到保证。

　　应该采用通用规则来对信号进行自动布线。通过设置限制条件和禁止布线区来限定给定信号所使用的层以及所用到的过孔数量，布线工具就能按照工程师的设计思想来自动布线。如果对自动布线工具所用的层和所布过孔的数量不加限制，自动布线时将会使用到每一层，而且将会产生很多过孔。  

! k9 e9 C6 B2 N! q　　在设置好约束条件和应用所创建的规则后，自动布线将会达到与预期相近的结果，当然可能还需要进行一些整理工作，同时还需要确保其它信号和网络布线的空间。在一部分设计完成以后，将其固定下来，以防止受到后边布线过程的影响。  
) A- w5 w. s) a% S- b
+ i4 I; Z1 u% `! I! ~. X, p- x9 B　　采用相同的步骤对其余信号进行布线。布线次数取决于电路的复杂性和你所定义的通用规则的多少。每完成一类信号后，其余网络布线的约束条件就会减少。但随之而来的是很多信号布线需要手动干预。现在的自动布线工具功能非常强大，通常可完成100%的布线。但是当自动布线工具未完成全部信号布线时，就需对余下的信号进行手动布线。  
, }  k( M; c1 Z2 R7 \
! U5 A# |6 X- C1 n% t$ w; f4 ^　　7、自动布线的设计要点包括:
& H% c/ c7 f; s! U, Y% _9 ^! z
　　7.1 略微改变设置，试用多种路径布线；
　　7.2 保持基本规则不变，试用不同的布线层、不同的印制线和间隔宽度以及不同线宽、不同类型的过孔如盲孔、埋孔等，观察这些因素对设计结果有何影响；
; Y- ]7 x0 f) R, x6 `+ L　　7.3让布线工具对那些默认的网络根据需要进行处理；
1 F8 m4 W% p( f$ V( K0 f　　7.4信号越不重要，自动布线工具对其布线的自由度就越大。  
0 s9 |# A$ x: X$ W% m$ w/ i
' t- n* P" x) _% O1 Z' \. r' i7 H　　8、布线的整理  

; S3 T, C, Z6 z/ S: }% w　　如果你所使用的EDA工具软件能够列出信号的布线长度，检查这些数据，你可能会发现一些约束条件很少的信号布线的长度很长。这个问题比较容易处理，通过手动编辑可以缩短信号布线长度和减少过孔数量。在整理过程中，你需要判断出哪些布线合理，哪些布线不合理。同手动布线设计一样，自动布线设计也能在检查过程中进行整理和编辑。  
' r4 T6 b& K0 r: f
4 P5 p/ Z$ I- n　　9、电路板的外观  
, o+ [7 ^6 n' ]& \* E* J9 D! z8 [
5 f! }, f* ~4 W, J& r; [　　以前的设计常常注意电路板的视觉效果，现在不一样了。自动设计的电路板不比手动设计的美观，但在电子特性上能满足规定的要求，而且设计的完整性能得到保证
; L1 _- O1 T5 _; c& @
: \6 N* _2 n! Y! E$ S第三篇
PROTEL技术大全
8 X% J# z# }" n0 {

8 I  f+ j, Z9 K% n  
1.原理图常见错误：
   （1）ERC报告管脚没有接入信号：
/ R7 T9 ~7 x6 J, m) ]2 g9 z    a. 创建封装时给管脚定义了I/O属性；
- z! L" i  u% o! H. N- o# i    b.创建元件或放置元件时修改了不一致的grid属性，管脚与线没有连上；
8 N5 A1 E) W, H: t8 I8 F7 _5 U1 c    c. 创建元件时pin方向反向，必须非pin name端连线。
  （2）元件跑到图纸界外：没有在元件库图表纸中心创建元件。
  （3）创建的工程文件网络表只能部分调入pcb：生成netlist时没有选择为global。
  （4）当使用自己创建的多部分组成的元件时，千万不要使用annotate.
! O( Q, q4 D, \+ V2 y( ^9 z2.PCB中常见错误：
$ z! f' Q# F) u; D  m6 J/ l  （1）网络载入时报告NODE没有找到：
+ A; }. I5 @, }6 s8 I' `! W. k/ |   a. 原理图中的元件使用了pcb库中没有的封装；
" `6 x- n0 B& |4 N  a, |% D- V+ m   b. 原理图中的元件使用了pcb库中名称不一致的封装；
* W0 H7 F  [8 i5 V% g% y% O. J   c. 原理图中的元件使用了pcb库中pin number不一致的封装。如三极管：sch中pin number 为e,b,c, 而pcb中为1，2，3。
% [. w7 X! |8 ^2 V5 h（2）打印时总是不能打印到一页纸上：
   a. 创建pcb库时没有在原点；
- `+ T& v/ v1 M% ~2 A' p3 S   b. 多次移动和旋转了元件，pcb板界外有隐藏的字符。选择显示所有隐藏的字符， 缩小pcb, 然后移动字符到边界内。
  （3）DRC报告网络被分成几个部分：
  i, A% C1 X- o7 ?* l" E& O% E  表示这个网络没有连通，看报告文件，使用选择CONNECTED COPPER查找。
  另外提醒朋友尽量使用WIN2000, 减少蓝屏的机会；多几次导出文件，做成新的DDB文件，减少文件尺寸和PROTEL僵死的机会。如果作较复杂得设计，尽量不要使用自动布线。
: i0 `( S! H+ G9 q) c- M/ a# b4 X
  U. `& ]% C* F& h2 |在PCB设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的， 在整个PCB中，以布线的设计过程限定最高，技巧最细、工作量最大。PCB布线有单面布线、 双面布线及多层布线。布线的方式也有两种：自动布线及交互式布线，在自动布线之前， 可以用交互式预先对要求比较严格的线进行布线，输入端与输出端的边线应避免相邻平行， 以免产生反射干扰。必要时应加地线隔离，两相邻层的布线要互相垂直，平行容易产生寄生耦合。
$ A) X7 N! o! [- w# Y
自动布线的布通率，依赖于良好的布局，布线规则可以预先设定， 包括走线的弯曲次数、导通孔的数目、步进的数目等。一般先进行探索式布经线，快速地把短线连通， 然后进行迷宫式布线，先把要布的连线进行全局的布线路径优化，它可以根据需要断开已布的线。 并试着重新再布线，以改进总体效果。

0 \* y( L; e) ?对目前高密度的PCB设计已感觉到贯通孔不太适应了， 它浪费了许多宝贵的布线通道，为解决这一矛盾，出现了盲孔和埋孔技术，它不仅完成了导通孔的作用， 还省出许多布线通道使布线过程完成得更加方便，更加流畅，更为完善，PCB 板的设计过程是一个复杂而又简单的过程，要想很好地掌握它，还需广大电子工程设计人员去自已体会， 才能得到其中的真谛。
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1 电源、地线的处理

既使在整个PCB板中的布线完成得都很好，但由于电源、 地线的考虑不周到而引起的干扰，会使产品的性能下降，有时甚至影响到产品的成功率。所以对电、 地线的布线要认真对待，把电、地线所产生的噪音干扰降到最低限度，以保证产品的质量。
4 N$ {% ^" T: ^7 H
对每个从事电子产品设计的工程人员来说都明白地线与电源线之间噪音所产生的原因， 现只对降低式抑制噪音作以表述：

众所周知的是在电源、地线之间加上去耦电容。
尽量加宽电源、地线宽度，最好是地线比电源线宽，它们的关系是：地线＞电源线＞信号线，通常信号线宽为：0.2～0.3mm,最经细宽度可达0.05～0.07mm,电源线为1.2～2.5 mm
7 V9 X3 U+ `- h  r* q' m对数字电路的PCB可用宽的地导线组成一个回路, 即构成一个地网来使用(模拟电路的地不能这样使用)
用大面积铜层作地线用,在印制板上把没被用上的地方都与地相连接作为地线用。或是做成多层板，电源，地线各占用一层。
% e' q( @4 `" Y/ d; P2、数字电路与模拟电路的共地处理
4 a4 F# A# A2 _3 d
现在有许多PCB不再是单一功能电路（数字或模拟电路），而是由数字电路和模拟电路混合构成的。因此在布线时就需要考虑它们之间互相干扰问题，特别是地线上的噪音干扰。
数字电路的频率高，模拟电路的敏感度强，对信号线来说，高频的信号线尽可能远离敏感的模拟电路器件，对地线来说，整人PCB对外界只有一个结点，所以必须在PCB内部进行处理数、模共地的问题，而在板内部数字地和模拟地实际上是分开的它们之间互不相连，只是在PCB与外界连接的接口处（如插头等）。数字地与模拟地有一点短接，请注意，只有一个连接点。也有在PCB上不共地的，这由系统设计来决定。

+ ]. W) q6 w! W& I) h3 T0 e3、信号线布在电（地）层上
( x- O7 `) a1 c, r
在多层印制板布线时，由于在信号线层没有布完的线剩下已经不多，再多加层数就会造成浪费也会给生产增加一定的工作量，成本也相应增加了，为解决这个矛盾，可以考虑在电（地）层上进行布线。首先应考虑用电源层，其次才是地层。因为最好是保留地层的完整性。

5 D9 P1 @5 ~7 C& p4、大面积导体中连接腿的处理
6 D+ B' I; v3 _3 R* ]8 d/ ^
, k5 _. v. n( g" U+ k在大面积的接地（电）中，常用元器件的腿与其连接，对连接腿的处理需要进行综合的考虑，就电气性能而言，元件腿的焊盘与铜面满接为好，但对元件的焊接装配就存在一些不良隐患如：①焊接需要大功率加热器。②容易造成虚焊点。所以兼顾电气性能与工艺需要，做成十字花焊盘，称之为热隔离（heat shield）俗称热焊盘（Thermal），这样，可使在焊接时因截面过分散热而产生虚焊点的可能性大大减少。多层板的接电（地）层腿的处理相同。

4 \) I% I( Z! `: I" }5、布线中网络系统的作用
, O7 I# d3 {* ]6 `5 L
在许多CAD系统中，布线是依据网络系统决定的。网格过密，通路虽然有所增加，但步进太小，图场的数据量过大，这必然对设备的存贮空间有更高的要求，同时也对象计算机类电子产品的运算速度有极大的影响。而有些通路是无效的，如被元件腿的焊盘占用的或被安装孔、定们孔所占用的等。网格过疏，通路太少对布通率的影响极大。所以要有一个疏密合理的网格系统来支持布线的进行。
4 f+ {% z% I1 R( R
/ Z8 w- D( u2 a3 u& x标准元器件两腿之间的距离为0.1英寸(2.54mm),所以网格系统的基础一般就定为0.1英寸(2.54 mm)或小于0.1英寸的整倍数，如：0.05英寸、0.025英寸、0.02英寸等。
5 C" b4 _7 B& o* E8 X
8 C  _: ^3 F8 |5 H1 @+ p6、设计规则检查（DRC）
8 ]; r2 x. o3 s2 P* \* B
布线设计完成后，需认真检查布线设计是否符合设计者所制定的规则，同时也需确认所制定的规则是否符合印制板生产工艺的需求，一般检查有如下几个方面：
# i1 C$ T( F; e* ]) }/ a
% v$ _9 J, n5 m  G7 A, N5 v线与线，线与元件焊盘，线与贯通孔，元件焊盘与贯通孔，贯通孔与贯通孔之间的距离是否合理，是否满足生产要求。
* C1 }+ P2 c- S2 J- D9 B8 b0 k2 |! H电源线和地线的宽度是否合适，电源与地线之间是否紧耦合（低的波阻抗）？在PCB中是否还有能让地线加宽的地方。
对于关键的信号线是否采取了最佳措施，如长度最短，加保护线，输入线及输出线被明显地分开。
5 n  h5 S; ^, U模拟电路和数字电路部分，是否有各自独立的地线。
后加在PCB中的图形（如图标、注标）是否会造成信号短路。
对一些不理想的线形进行修改。
在PCB上是否加有工艺线？阻焊是否符合生产工艺的要求，阻焊尺寸是否合适，字符标志是否压在器件焊盘上，以免影响电装质量。
  h+ A$ |5 K2 G多层板中的电源地层的外框边缘是否缩小，如电源地层的铜箔露出板外容易造成短路。概述
本文档的目的在于说明使用PADS的印制板设计软件PowerPCB进行印制板设计的流程和一些注意事项，为一个工作组的设计人员提供设计规范，方便设计人员之间进行交流和相互检查。
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2、设计流程
PCB的设计流程分为网表输入、规则设置、元器件布局、布线、检查、复查、输出六个步骤.
3 Z7 H* z: X5 Y. K2.1 网表输入
! }4 M4 h6 }4 I2 j   网表输入有两种方法，一种是使用PowerLogic的OLE PowerPCB Connection功能，选择Send Netlist，应用OLE功能，可以随时保持原理图和PCB图的一致，尽量减少出错的可能。另一种方法是直接在PowerPCB中装载网表，选择File->Import，将原理图生成的网表输入进来。
2.2 规则设置
如果在原理图设计阶段就已经把PCB的设计规则设置好的话，就不用再进行设置
4 J* p5 K% T1 {1 r/ T这些规则了，因为输入网表时，设计规则已随网表输入进PowerPCB了。如果修改了设计规则，必须同步原理图，保证原理图和PCB的一致。除了设计规则和层定义外，还有一些规则需要设置，比如Pad Stacks，需要修改标准过孔的大小。如果设计者新建了一个焊盘或过孔，一定要加上Layer 25。
注意：
PCB设计规则、层定义、过孔设置、CAM输出设置已经作成缺省启动文件，名称为Default.stp，网表输入进来以后，按照设计的实际情况，把电源网络和地分配给电源层和地层，并设置其它高级规则。在所有的规则都设置好以后，在PowerLogic中，使用OLE PowerPCB Connection的Rules From PCB功能，更新原理图中的规则设置，保证原理图和PCB图的规则一致。

: _' K/ ^. E* f' i2.3 元器件布局
4 v+ S' [+ M9 a/ l0 S网表输入以后，所有的元器件都会放在工作区的零点，重叠在一起，下一步的工作就是把这些元器件分开，按照一些规则摆放整齐，即元器件布局。PowerPCB提供了两种方法，手工布局和自动布局。2.3.1 手工布局
; l7 V. t2 S, O' v; u- M# Y; J. i. T1. 工具印制板的结构尺寸画出板边（Board Outline）。
2. 将元器件分散（Disperse Components），元器件会排列在板边的周围。
2 G' f8 `8 A; l4 K) g+ R) D% s$ f; m3. 把元器件一个一个地移动、旋转，放到板边以内，按照一定的规则摆放整齐。
2 F& L4 S2 M) K4 B2.3.2 自动布局
8 _2 h) y: Q6 f$ Y2 d; [  b/ m- C  PowerPCB提供了自动布局和自动的局部簇布局，但对大多数的设计来说，效果并不理想，不推荐使用。2.3.3 注意事项
: \* e6 }) f7 e: \' J/ da. 布局的首要原则是保证布线的布通率，移动器件时注意飞线的连接，把有连线关系的器件放在一起
b. 数字器件和模拟器件要分开，尽量远离
/ ^% s8 I, _. d1 K0 w# Ac. 去耦电容尽量靠近器件的VCC
d. 放置器件时要考虑以后的焊接，不要太密集
e. 多使用软件提供的Array和Union功能，提高布局的效率

, t* v. Z6 [/ b) ]2.4 布线
! s! b& |2 s2 m  布线的方式也有两种，手工布线和自动布线。PowerPCB提供的手工布线功能十分强大，包括自动推挤、在线设计规则检查（DRC），自动布线由Specctra的布线引擎进行，通常这两种方法配合使用，常用的步骤是手工—自动—手工。
2 a, n& f. t" ~4 \2.4.1 手工布线
1. 自动布线前，先用手工布一些重要的网络，比如高频时钟、主电源等，这些网络往往对走线距离、线宽、线间距、屏蔽等有特殊的要求；另外一些特殊封装，如BGA，自动布线很难布得有规则，也要用手工布线。
2. 自动布线以后，还要用手工布线对PCB的走线进行调整。
2.4.2 自动布线
1 c; i) V1 G1 G6 a7 r手工布线结束以后，剩下的网络就交给自动布线器来自布。选择Tools->SPECCTRA，启动Specctra布线器的接口，设置好DO文件，按Continue就启动了Specctra布线器自动布线，结束后如果布通率为100%，那么就可以进行手工调整布线了；如果不到100%，说明布局或手工布线有问题，需要调整布局或手工布线，直至全部布通为止。
  ~& p0 k) W* h& I: t/ }/ R- B7 g
2.4.3 注意事项
a. 电源线和地线尽量加粗
b. 去耦电容尽量与VCC直接连接
c. 设置Specctra的DO文件时，首先添加Protect all wires命令，保护手工布的线不被自动布线器重布
d. 如果有混合电源层，应该将该层定义为Split/mixed Plane，在布线之前将其分割，布完线之后，使用Pour Manager的Plane Connect进行覆铜
) m9 ?# F* ]7 R# ue. 将所有的器件管脚设置为热焊盘方式，做法是将Filter设为Pins，选中所有的管脚，修改属性，在Thermal选项前打勾
f. 手动布线时把DRC选项打开，使用动态布线（Dynamic Route）
$ @1 A8 i& |  y+ B
2.5 检查
  检查的项目有间距（Clearance）、连接性（Connectivity）、高速规则（High Speed）和电源层（Plane），这些项目可以选择Tools->Verify Design进行。如果设置了高速规则，必须检查，否则可以跳过这一项。检查出错误，必须修改布局和布线。
3 y% i* s! K1 H注意：
  有些错误可以忽略，例如有些接插件的Outline的一部分放在了板框外，检查间距时会出错；另外每次修改过走线和过孔之后，都要重新覆铜一次。
2.6 复查
  复查根据“PCB检查表”，内容包括设计规则，层定义、线宽、间距、焊盘、过孔设置；还要重点复查器件布局的合理性，电源、地线网络的走线，高速时钟网络的走线与屏蔽，去耦电容的摆放和连接等。复查不合格，设计者要修改布局和布线，合格之后，复查者和设计者分别签字。
9 N" z6 A7 t' U- X- j3 y
2 M* y. ]# a8 e2.7 设计输出
  PCB设计可以输出到打印机或输出光绘文件。打印机可以把PCB分层打印，便于设计者和复查者检查；光绘文件交给制板厂家，生产印制板。光绘文件的输出十分重要，关系到这次设计的成败，下面将着重说明输出光绘文件的注意事项。
a. 需要输出的层有布线层（包括顶层、底层、中间布线层）、电源层（包括VCC层和GND层）、丝印层（包括顶层丝印、底层丝印）、阻焊层（包括顶层阻焊和底层阻焊），另外还要生成钻孔文件（NC Drill）
b. 如果电源层设置为Split/Mixed，那么在Add Document窗口的Document项选择Routing，并且每次输出光绘文件之前，都要对PCB图使用Pour Manager的Plane Connect进行覆铜；如果设置为CAM Plane，则选择Plane，在设置Layer项的时候，要把Layer25加上，在Layer25层中选择Pads和Viasc. 在设备设置窗口（按Device Setup），将Aperture的值改为199
; r; B7 a9 W  yd. 在设置每层的Layer时，将Board Outline选上
% C0 [& ?% y" o- ]$ [5 @/ {e. 设置丝印层的Layer时，不要选择Part Type，选择顶层（底层）和丝印层的Outline、Text、Line
f. 设置阻焊层的Layer时，选择过孔表示过孔上不加阻焊，不选过孔表示家阻焊，视具体情况确定
( J0 `7 p5 i' |g. 生成钻孔文件时，使用PowerPCB的缺省设置，不要作任何改动
% P+ u& @: s5 s5 t6 Y' |h. 所有光绘文件输出以后，用CAM350打开并打印，由设计者和复查者根据“PCB检查表”检查
    过孔（via）是多层PCB的重要组成部分之一，钻孔的费用通常占PCB制板费用的30%到40%。简单的说来，PCB上的每一个孔都可以称之为过孔。从作用上看，过孔可以分成两类：一是用作各层间的电气连接；二是用作器件的固定或定位。如果从工艺制程上来说，这些过孔一般又分为三类，即盲孔(blind via)、埋孔(buried via)和通孔(through via)。盲孔位于印刷线路板的顶层和底层表面，具有一定深度，用于表层线路和下面的内层线路的连接，孔的深度通常不超过一定的比率(孔径)。埋孔是指位于印刷线路板内层的连接孔，它不会延伸到线路板的表面。上述两类孔都位于线路板的内层，层压前利用通孔成型工艺完成，在过孔形成过程中可能还会重叠做好几个内层。第三种称为通孔，这种孔穿过整个线路板，可用于实现内部互连或作为元件的安装定位孔。由于通孔在工艺上更易于实现，成本较低，所以绝大部分印刷电路板均使用它，而不用另外两种过孔。以下所说的过孔，没有特殊说明的，均作为通孔考虑。
2 V( u, F0 ], n. \: k' Y) X. F# l从设计的角度来看，一个过孔主要由两个部分组成，一是中间的钻孔（drill hole）,二是钻孔周围的焊盘区，见下图。这两部分的尺寸大小决定了过孔的大小。很显然，在高速,高密度的PCB设计时，设计者总是希望过孔越小越好，这样板上可以留有更多的布线空间，此外，过孔越小，其自身的寄生电容也越小，更适合用于高速电路。但孔尺寸的减小同时带来了成本的增加，而且过孔的尺寸不可能无限制的减小，它受到钻孔(drill)和电镀（plating）等工艺技术的限制：孔越小，钻孔需花费的时间越长，也越容易偏离中心位置；且当孔的深度超过钻孔直径的6倍时，就无法保证孔壁能均匀镀铜。比如，现在正常的一块6层PCB板的厚度（通孔深度）为50Mil左右，所以PCB厂家能提供的钻孔直径最小只能达到8Mil。
  b+ A3 A: `6 u2 a+ I0 q0 y8 m
二、过孔的寄生电容
过孔本身存在着对地的寄生电容，如果已知过孔在铺地层上的隔离孔直径为D2,过孔焊盘的直径为D1,PCB板的厚度为T,板基材介电常数为ε,则过孔的寄生电容大小近似于：
" X  c0 H  ]9 x  t+ }+ t, RC=1.41εTD1/(D2-D1)
过孔的寄生电容会给电路造成的主要影响是延长了信号的上升时间，降低了电路的速度。举例来说，对于一块厚度为50Mil的PCB板，如果使用内径为10Mil，焊盘直径为20Mil的过孔，焊盘与地铺铜区的距离为32Mil,则我们可以通过上面的公式近似算出过孔的寄生电容大致是：C=1.41x4.4x0.050x0.020/(0.032-0.020)=0.517pF，这部分电容引起的上升时间变化量为：T10-90=2.2C(Z0/2)=2.2x0.517x(55/2)=31.28ps 。从这些数值可以看出，尽管单个过孔的寄生电容引起的上升延变缓的效用不是很明显，但是如果走线中多次使用过孔进行层间的切换，设计者还是要慎重考虑的。

三、过孔的寄生电感
0 ^, U( g1 X" C1 w同样，过孔存在寄生电容的同时也存在着寄生电感，在高速数字电路的设计中，过孔的寄生电感带来的危害往往大于寄生电容的影响。它的寄生串联电感会削弱旁路电容的贡献，减弱整个电源系统的滤波效用。我们可以用下面的公式来简单地计算一个过孔近似的寄生电感：
0 x( t: q- e( B9 wL=5.08h[ln(4h/d)+1]其中L指过孔的电感，h是过孔的长度，d是中心钻孔的直径。从式中可以看出，过孔的直径对电感的影响较小，而对电感影响最大的是过孔的长度。仍然采用上面的例子，可以计算出过孔的电感为：L=5.08x0.050[ln(4x0.050/0.010)+1]=1.015nH 。如果信号的上升时间是1ns，那么其等效阻抗大小为：XL=πL/T10-90=3.19Ω。这样的阻抗在有高频电流的通过已经不能够被忽略，特别要注意，旁路电容在连接电源层和地层的时候需要通过两个过孔，这样过孔的寄生电感就会成倍增加。

四、高速PCB中的过孔设计
通过上面对过孔寄生特性的分析，我们可以看到，在高速PCB设计中，看似简单的过
孔往往也会给电路的设计带来很大的负面效应。为了减小过孔的寄生效应带来的不利影响，在设计中可以尽量做到：
1、从成本和信号质量两方面考虑，选择合理尺寸的过孔大小。比如对6-10层的内
存模块PCB设计来说，选用10/20Mil（钻孔/焊盘）的过孔较好，对于一些高密度的小尺寸的板子，也可以尝试使用8/18Mil的过孔。目前技术条件下，很难使用更小尺寸的过孔了。对于电源或地线的过孔则可以考虑使用较大尺寸，以减小阻抗。
0 M  G8 J0 t8 P6 w; r4 _5 k6 [- X2、上面讨论的两个公式可以得出，使用较薄的PCB板有利于减小过孔的两种寄
生参数。
. W0 }. u1 t: g$ F& v& A3、PCB板上的信号走线尽量不换层，也就是说尽量不要使用不必要的过孔。
: K9 `0 z% U' F* M! i4、电源和地的管脚要就近打过孔，过孔和管脚之间的引线越短越好，因为它们会
% Y: T4 y2 L- }% _0 N导致电感的增加。同时电源和地的引线要尽可能粗，以减少阻抗。
3 M( m* ?3 O: I* ^5、在信号换层的过孔附近放置一些接地的过孔，以便为信号提供最近的回路。甚至可以在PCB板上大量放置一些多余的接地过孔。当然，在设计时还需要灵活多变。前面讨论的过孔模型是每层均有焊盘的情况，也有的时候，我们可以将某些层的焊盘减小甚至去掉。特别是在过孔密度非常大的情况下，可能会导致在铺铜层形成一个隔断回路的断槽，解决这样的问题除了移动过孔的位置，我们还可以考虑将过孔在该铺铜层的焊盘尺寸减小。

  H6 y" R; _3 ]. N2 [
) y) ^& i, E# i( ]$ ]问：从WORD文件中拷贝出来的符号，为什么不能够在PROTEL中正常显示
  ~( t8 c5 o  H# D. A复：请问你是在SCH环境,还是在PCB环境,在PCB环境是有一些特殊字符不能显示,因为那时保留字.
+ j) `. D* _* i/ ]
; A4 I* B0 a. z! p8 G/ q问：net名与port同名，pcb中可否连接
! N! G- Y( m# F8 S答复：可以,PROTEL可以多种方式生成网络,当你在在层次图中以port-port时,每张线路图可以用相同的NET名,它们不会因网络名是一样而连接.但请不要使用电源端口,因为那是全局的.
+ H6 \5 x+ {' q3 ]" r' k
问：:请问在PROTEL99SE中导入PADS文件， 为何焊盘属性改了
复：这多是因为两种软件和每种版本之间的差异造成，通常做一下手工体调整就可以了。
. k" z* [7 ^! U
( f2 w; E7 Z7 J2 p( b- q$ H问：请问杨大虾：为何通过软件把power logic的原理图转化成protel后，在protel中无法进行属性修改，只要一修改，要不不现实，要不就是全显示属性？谢谢！
复：如全显示，可以做一个全局性编辑，只显示希望的部分。

1 L# f; g; {& D& [7 S4 f问：请教铺銅的原则？
复：铺銅一般应该在你的安全间距的2倍以上.这是LAYOUT的常规知识.

. q& O; f9 L, c! S问：请问Potel DXP在自动布局方面有无改进?导入封装时能否根据原理图的布局自动排开?
* B' g) l# e% G" O% K! V复：PCB布局与原理图布局没有一定的内在必然联系，故此，Potel DXP在自动布局时不会根据原理图的布局自动排开。（根据子图建立的元件类，可以帮助PCB布局依据原理图的连接）。
( d* H* W: f4 ]% p* \, [8 _
5 V# C( A0 h3 p* J/ z8 Q6 l: Y问：请问信号完整性分析的资料在什么地方购买
7 E- ^# g( \& H8 A2 ^$ N4 E复：Protel软件配有详细的信号完整性分析手册。

问：为何铺铜，文件哪么大？有何方法？
& `' d: ]( K& ?1 w/ P复：铺铜数据量大可以理解。但如果是过大，可能是您的设置不太科学。
) M4 N( O! Y9 z6 p3 Z  f3 s+ }' A
" X; O" G5 M7 A问：有什么办法让原理图的图形符号可以缩放吗？
复：不可以。
4 z; k7 e' f4 p! {" k8 D* n
问：PROTEL仿真可进行原理性论证，如有详细模型可以得到好的结果
- T# c9 e  w8 L2 ]3 h复：PROTEL仿真完全兼容Spice模型，可以从器件厂商处获得免费Spice模型，进行仿真。PROTEL也提供建模方法，具有专业仿真知识，可建立有效的模型。
. D6 r  D$ \0 P
* k! D5 `+ g8 W7 y问：99SE中如何加入汉字，如果汉化后好象少了不少东西！  3-28 14:17:0 但确实少了不少功能！
8 h8 `6 G2 O6 x0 z复：可能是汉化的版本不对。
1 }$ Q  [6 z( V& r8 b
* v8 H3 u) L8 Q8 f* z5 {# K& d问：如何制作一个孔为2*4MM   外径为6MM的焊盘?
复：在机械层标注方孔尺寸。与制版商沟通具体要求。

# ]/ ?/ q8 J, X+ B; _+ d' `问：我知道，但是在内电层如何把电源和地与内电层连接。没有网络表，如果有网络表就没有问题了
复：利用from-to类生成网络连接
3 U6 K% v8 X# H
问：还想请教一下99se中椭圆型焊盘如何制作？放置连续焊盘的方法不可取，线路板厂家不乐意。可否在下一版中加入这个设置项？
0 a6 j: D3 p# h) n复：在建库元件时，可以利用非焊盘的图素形成所要的焊盘形状。在进行PCB设计时使其具有相同网络属性。我们可以向Protel公司建议。

$ U0 X( j9 r, z+ x4 w) e* i% O问：如何免费获取以前的原理图库和pcb库
复：那你可以的WWW.PROTEL.COM下载
' _: h+ v4 J+ \3 z( c
问：刚才本人提了个在覆铜上如何写上空心(不覆铜)的文字,专家回答先写字,再覆铜,然后册除字,可是本人试了一下,删除字后,空的没有,被覆铜 覆盖了,请问专家是否搞错了,你能不能试一下
- D0 I8 L( Q/ {5 \2 ]复：字必须用PROTEL99SE提供的放置中文的办法，然后将中文（英文）字解除元件，（因为那是一个元件）将安全间距设置成1MIL，再覆铜，然后移动覆铜，程序会询问是否重新覆铜，回答NO。
. @8 Q5 t/ F: z  U
问：画原理图时，如何元件的引脚次序？
复：原理图建库时，有强大的检查功能，可以检查序号，重复，缺漏等。也可以使用阵列排放的功能，一次性放置规律性的引脚。

% V% I( {8 O- d' H% Y问：protel99se6自动布线后，在集成块的引脚附近会出现杂乱的走线，像毛刺一般，有时甚至是三角形的走线，需要进行大量手工修正，这种问题怎么避免？
复：合理设置元件网格，再次优化走线。

问：用PROTEL画图，反复修改后，发现文件体积非常大（虚肿），导出后再导入就小了许多。为什么？？有其他办法为文件瘦身吗？
复：其实那时因为PROTEL的铺铜是线条组成的原因造成的，因知识产权问题，不能使用PADS里的“灌水”功能，但它有它的好处，就是可以自动删除“死铜”。致与文件大，你用WINZIP压缩一下就很小。不会影响你的文件发送。
' B( H" b" P7 \, B) R) E
问：请问：在同一条导线上，怎样让它不同部分宽度不一样，而且显得连续美观？谢谢！
7 t4 n( P! s6 h: s  l' w复：不能自动完成，可以利用编辑技巧实现。
# Q$ o2 I9 f& m; Y* C3 O! r
liaohm问：如何将一段圆弧进行几等分？
" F1 `; L  F7 F% nfanglin163答复：利用常规的几何知识嘛。EDA只是工具。
+ g. l  Y! L9 u" @* Q
  ^/ B7 z9 y' x& @! l; }问：protel里用的HDL是普通的VHDL
- R) s) h: i# T, P! q- _) k复：Protel PLD不是，Protel FPGA是。
* a2 {% ~# y4 {4 `
8 u6 D1 A# Y: y  h' b" C; L  p6 l问：补泪滴后再铺铜，有时铺出来的网格会残缺，怎么办？
复：那是因为你在补泪滴时设置了热隔离带原因，你只需要注意安全间距与热隔离带方式。也可以用修补的办法。

问：可不可以做不对称焊盘？拖动布线时相连的线保持原来的角度一起拖动？
复：可以做不对称焊盘。拖动布线时相连的线不能直接保持原来的角度一起拖动。

% Z2 o( j  b/ l2 o0 C$ R问：请问当Protel发挥到及至时，是否能达到高端EDA软件同样的效果
: o; E2 \" S+ j2 t复：视设计而定。
, V6 W( G. O! M
3 Q% y" R3 I7 H% u0 M" w9 E/ w问：Protel DXP的自动布线效果是否可以达到原ACCEL的水平？
9 y4 X& _& {, r! s- N2 H) X复：有过之而无不及。
7 x: W5 p6 c( V6 R0 _; x/ [
8 S  V' k" O. i" S8 \. _问：protel的pld功能好象不支持流行的HDL语言？
复：Protel PLD使用的Cupl语言，也是一种HDL语言。下一版本可以直接用VHDL语言输入。

: N. ?5 ]  C2 W& C6 v问：PCB里面的3D功能对硬件有何要求？
. f3 n% b5 h) y0 o/ Z1 v- y0 V复：需要支持OpenGL.

问：如何将一块实物硬制版的布线快速、原封不动地做到电脑之中？
复：最快的办法就是扫描，然后用BMP2PCB程序转换成胶片文件，然后再修改，但你的PCB精度必须在0.2MM以上。BMP2PCB程序可在21IC上下载，你的线路板必须用沙纸打的非常光亮才能成功。

( q' y4 r. `0 Y: G. X1 p% P# ^问：直接画PCB板时，如何为一个电路接点定义网络名？
' P' ]0 a& e) G" x3 n2 o5 m复：在Net编辑对话框中设置。

问：怎么让做的资料中有孔径显示或符号标志，同allego一样
: r  Z4 D' n$ t( p4 r+ b! @0 M复：在输出中有选项，可以产生钻孔统计及各种孔径符号。
9 [0 s- C4 u  z
问：自动布线的锁定功能不好用，系统有的会重布，不知道怎么回事？
. y6 x9 z  ]2 y3 I) H+ w' x复：最新的版本无此类问题。

, D2 e1 |  _8 T/ _2 d问：如何实现多个原器件的整体翻转
复：一次选中所要翻转的元件。

问：我用的p 99 版加入汉字就死机,是什么原因?
复：应是D版所致。
6 {9 ^9 g# F. \
7 q' X" J1 I/ n7 `" h! Y8 E( c问：powpcb的文件怎样用PROTEL打开？
( O8 W0 W- R/ d4 x7 }0 b复：先新建一PCB文件，然后使用导入功能达到。

/ L; n9 z& V3 D& h: _$ ^0 l# H! k问：怎样从PROTEL99中导入GERBER文件
6 f) F& s' ~; t3 q/ E  ~复：Protel pcb只能导入自己的Gerber,而Protel的CAM可以导入其它格式的Gerber.
% X* E9 l, P( q# h/ t' u
问：如何把布好PCB走线的细线条部分地改为粗线条
/ c1 P7 V$ q  e: @$ @  T复：双击修改+全局编辑。注意匹配条件。修改规则使之适应新线宽。
- F& i$ y# p8 d$ _
& v8 j; x3 N( z+ @8 k0 b问：如何修改一个集成电路封装内的焊盘尺寸?  若全局修改的话应如何设置?
复：全部选定，进行全局编辑
2 f& m- x$ I! T
- u0 o, z% b6 o5 S9 J% V3 ?问：如何修改一个集成电路封装内的焊盘尺寸?
6 J9 |- x/ t: A$ `5 ]6 I% B复：在库中修改一个集成电路封装内的焊盘尺寸大家都知道，在PCB板上也可以修改。（先在元件属性中解锁）。

问：能否在做PCB时对元件符号的某些部分加以修改或删除？
0 i' i' y; J; p% R, q复：在元件属性中去掉元件锁定，就可在PCB中编辑元件，并且不会影响库中元件。
4 k$ L" k1 K6 y. [5 u. o, s$ n/ F
问：该焊盘为地线，包地之后，该焊盘与地所连线如何设置宽度
( l4 q4 J, a) V" e" h' a1 n/ Z  I复：包地前设置与焊盘的连接方式
! e# D6 ]0 w; Z% i* I3 n; _+ R0 b
问：为何99se存储时要改为工程项目的格式？
. O) P4 s$ S1 |' H复：便于文件管理。
: }" O1 Q0 P/ t1 ?
$ t/ s6 q2 c" a) S# [# r问：如何去掉PCB上元件的如电阻阻值，电容大小等等，要一个个去掉吗，有没有快捷方法
复：使用全局编辑，同一层全部隐藏

! H/ A, I* J. w1 d3 ?) H问：能告诉将要推出的新版本的PROTEL的名称吗？简单介绍一下有哪些新功能？protel手动布线的推挤能力太弱！
) l5 X! q! X" `. G5 Z0 K. t复：Protel DXP，在仿真和布线方面会有大的提高。
* \- E& l3 O5 q  n" J8 V% h& ~$ f
9 S* Y1 e- ^' c$ d8 Z9 u问：如何把敷铜区中的分离的小块敷铜除去
6 W+ U! g  [( B  c! Y# L7 V复：在敷铜时选择＂去除死铜＂

问：VDD和GND都用焊盘连到哪儿了，怎么看不到呀
' X- `! E" V$ ~: L复：打开网络标号显示。

问：在PCB中有画弧线? 在画完直线,接着直接可以画弧线具体如DOS版弧线模式那样!能实现吗?能的话,如何设置?
0 P# R8 C% P& Q! K; z# j复：可以，使用shift+空格可以切换布线形式
8 ]7 ^8 b* k$ z1 s+ }7 n, y) @
& d. G; S6 d1 x: \, w: p问：protel99se9层次图的总图用edit\export spread生成电子表格的时候，却没有生成各分图纸里面的元件及对应标号、封装等。如果想用电子表格的方式一次性修改全部图纸的封装，再更新原理图，该怎么作？
复：点中相应的选项即可。

% o( M3 B2 f  V, V. c问：protel99se6的PCB通过specctra interface导出到specctra10.1里面，发现那些没有网络标号的焊盘都不见了，结果specctra就从那些实际有焊盘的地方走线，布得一塌糊涂，这种情况如何避免？
, r! {1 u$ `3 q2 V" @: F& @0 A复：凡涉及到两种软件的导入/导出，多数需要人工做一些调整。
2 _# B9 q2 V# _. I! m' l! h
问：在打开内电层时，放置元件和过孔等时，好像和内电层短接在一起了，是否正确
复：内电层显示出的效果与实际的缚铜效果相反，所以是正确的

问：protel的执行速度太慢，太耗内存了，这是为什么？而如allegro那么大的系统，执行起来却很流畅！
复：最新的Protel软件已不是完成一个简单的PCB设计，而是系统设计，包括文件管理、3D分析等。只要PIII,128M以上内存，Protel亦可运行如飞。
2 ~* f% c- U0 k) L, k+ u
) i0 O' w; ~/ Q: f* d8 o问：如何自动布线中加盲，埋孔？
复：设置自动布线规则时允许添加盲孔和埋孔

3 r; R# c2 Q8 D* Y0 g问：3D的功能对硬件有什么要求？谢谢，我的好象不行
复：请把金山词霸关掉
' m6 F- ?/ t2 R- n6 ~/ _
问：补泪滴可以一个一个加吗？
3 Y7 `, ~$ l1 Z! f$ \) k复：当然可以
7 l4 `, x1 K8 U% B0 K
- Z% h% b1 Z+ I2 w9 e6 y/ I  |问：请问在PROTEL99SE中倒入PADS文件， 为何焊盘属性改了，
复：这类问题，一般都需要手工做调整，如修改属性等。

! W$ V, p$ B" M& ^- l/ G( i问：protell99se能否打开orcad格式的档案，如不能以后是否会考虑添加这一功能？
复：现在可以打开。

问：在99SEPCB板中加入汉字没发加，但汉化后SE少了不少东西！
( k1 Y2 R% @9 O, f% I# @4 P复：可能是安装的文件与配置不正确。
! M$ m1 K7 u3 w+ }% p
) L' M0 R: E$ ]) F( i0 A问：SE在菜单汉化后，在哪儿启动3D功能？
复：您说的是View3D接口吗，请在系统菜单（左边大箭头下）启动。
% I& a/ Z0 r1 Y8 w+ e6 H5 {) V
问：请问如何画内孔不是圆形的焊盘？？？
复：不行。
) }9 G* z3 k7 G  j
. l% i/ w) `( R$ F- H问：在PCB中有几种走线模式?我的计算机只有两种,通过空格来切换
1 W/ X/ ^8 \- I& c- N% X复：Shift＋空格

3 C2 X; w- P( f0 v. l) @+ c问：请问：对于某些可能有较大电流的线，如果我希望线上不涂绿油，以便我在其上上锡，以增大电流。我该怎么设计？谢谢！
复：可以简单地在阻焊层放置您想要的上锡的形状。

0 f2 j# L( Y: g2 s问：如何连续画弧线,用画园的方法每个弯画个园吗?
# j% X+ O1 B$ ]  E复：不用，直接用圆弧画。

/ m, Q( f% s4 O# z问：如何锁定一条布线？
复：先选中这个网络，然后在属性里改。
6 S5 l, v9 }3 }! j, d' v. S0 Z
问：随着每次修改的次数越来越多，protel文件也越来越大，请问怎么可以让他文件尺寸变小呢？
复：在系统菜单中有数据库工具。（Fiel菜单左边的大箭头下）。

$ N, `- e1 {+ i% `0 o5 ?% Z) D$ Lwangjinfeng问：请问PROTEL中画PCB板如何设置采用总线方式布线？
高英凯答复：Shift＋空格。

问：如何利用protel的PLD功能编写GAL16V8程序？
$ Z  q2 G; f$ ^& q  W复：利用protel的PLD功能编写GAL16V8程序比较简单，直接使用Cupl DHL硬件描述语言就可以编程了。帮助里有实例。Step by step.
; I6 W$ R: A, [9 Y, k- Q' H* C, F* s
/ ^  ]7 }+ R% \2 R# u问：我用99se6布一块4层板子，布了一个小时又二十分钟布到99.6％，但再过来11小时多以后却只布到99.9％！不得已让它停止了
' }, B* j& R, @( h1 x复：对剩下的几个Net，做一下手工预布，剩下的再自动，可达到100％的布通。
1 p8 o4 l- B+ h5 d
6 G6 C' D/ p0 Q* g3 [0 t问：在pcb多层电路板设计中，如何设置内电层？前提是完全手工布局和布线。
! R/ K; i% C3 f+ t" q9 t复：有专门的菜单设置。
9 ~/ p% C- y& }& t" k- R
问：protel PCB图可否输出其它文件格式,如HyperLynx的?  它的帮助文件中说可以,但是在菜单中却没有这个选项
; v7 f6 S, d" W' {复：现在Protel自带有PCB信号分析功能。
* A, x: K2 i1 @
4 L7 d- F4 o, H, R2 d! h8 n* P- L) c问：请问pcb里不同的net,最后怎么让他们连在一起？
) @$ i" D2 a* b3 N7 n/ u9 [2 U复：最好不要这么做，应该先改原理图，按规矩来，别人接手容易些。
0 G; f7 D7 d& e' h2 L
问：自动布线前如何把先布的线锁定？？一个一个选么？
5 ]2 V* t8 _1 |: z复：99SE中的锁定预布线功能很好，不用一个一个地选，只要在自动布线设置中点一个勾就可以了。
( g0 \  Y3 ]- M5 I4 B, c( a
2 V* E% Z" d1 k4 [问：PSPICE的功能有没有改变
' M, K9 b5 s1 ?8 F" W0 F复：在Protel即将推出的新版本中，仿真功能会有大的提升。

+ Q: h8 r2 [0 v, w' [" ~5 E4 b问：如何使用Protel 99se的PLD仿真功能？
$ i) K" J# \" i; o5 G+ f/ P+ }9 m复：首先要有仿真输入文件(.si)，其次在configure中要选择Absolute ABS选项，编译成功后，可仿真。看仿真输出文件。
! m! M. ~5 d* `, F: R
问：protel.ddb历史记录如和删
. X6 `4 \) G7 {9 r复：先删除至回收战，然后清空回收站。
; C8 A' N- z+ d1 N( x
6 V) [: a" [+ G- O' y问：自动布线为什么会修改事先已布的线而且把它们认为没有布过重新布了而设置我也正确了?
复：把先布的线锁定。应该就可以了。
6 {- ~8 P0 ^& Y9 \& R2 Q
问：布线后有的线在视觉上明显太差，PROTEL这样布线有他的道理吗（电气上）
: v( h/ x  v& k! Y0 m* ~复：仅仅通过自动布线，任何一个布线器的结果都不会太美观。
& ]7 r7 u  \: h9 n' d( L! H" V
: I/ ~1 N( \* l* ]; z# t5 P! H  i8 C问：可以在焊盘属性中修改焊盘的X和Y的尺寸
  e, [8 ^- b( E0 I复：可以。
2 Z: U- H9 I+ i* h5 c
问：protel99se后有没推出新的版本？
; j9 l- j5 ?6 C( N  S" \; l$ ^( K, O+ U复：即将推出。该版本耗时2年多，无论在功能、规模上都与Protel99SE,有极大的飞跃。
+ y, E, c/ ^9 n( s: o5 ~
  P6 y8 r  R9 C: H3 [& {问：99se的3d功能能更增进些吗？好像只能从正面看！其外形能自己做吗？
复：3D图形可以用  Ctrl   +   上，下，左，右 键翻转一定的角度。不过用处不大，显卡要好才行。
  V3 {; V6 a, ^6 L' ^% d$ Y
9 R1 S# X8 H* s. T0 D问：有没有设方孔的好办法？除了在机械层上画。
9 E" }" W' b8 k1 u( P2 `8 O复：可以，在Multi Layer上设置。
/ {3 |6 h, Y. ^8 f7 f
问：一个问题:填充时,假设布线规则中间距为20mil,但我有些器件要求100mil间距,怎样才能自动填充?
复：可以在design-->rules-->clearance constraint里加

7 Y  h/ g7 g9 z/ L5 k6 w2 b问：在protel中能否用orcad原理图
& B% [2 V* q" e4 e( q+ T复：需要将orcad原理图生成protel支持的网表文件,再由protel打开即可.
# \3 U+ ]  N" M0 U
6 e1 ^* k3 N4 p  m9 v& d9 c7 T问：请问多层电路板是否可以用自动布线
% T0 ^$ Q" N# w, M. @0 k复：可以的，跟双面板一样的，设置好就行了。
, Z( d$ ^  f* M* }
一、印刷线路元件布局结构设计讨论
* \; G+ Y$ B; s6 [+ l# d9 v
6 L8 ^& \- o1 z- {0 @  C2 ~　　一台性能优良的仪器，除选择高质量的元器件，合理的电路外，印刷线路板的元件布局和电气连线方向的正确结构设计是决定仪器能否可靠工作的一个关键问题，对同一种元件和参数的电路，由于元件布局设计和电气连线方向的不同会产生不同的结果，其结果可能存在很大的差异。因而，必须把如何正确设计印刷线路板元件布局的结构和正确选择布线方向及整体仪器的工艺结构三方面联合起来考虑，合理的工艺结构，既可消除因布线不当而产生的噪声干扰，同时便于生产中的安装、调试与检修等。
4 ^; d! [* q/ Q' r+ g( T+ f4 T: }- d
" V" u' v7 d. h( q3 ]  k　　下面我们针对上述问题进行讨论，由于优良“结构”没有一个严格的“定义”和“模式”，因而下面讨论，只起抛砖引玉的作用，仅供参考。每一种仪器的结构必须根据具体要求（电气性能、整机结构安装及面板布局等要求），采取相应的结构设计方案，并对几种可行设计方案进行比较和反复修改。印刷板电源、地总线的布线结构选择----系统结构：模拟电路和数字电路在元件布局图的设计和布线方法上有许多相同和不同之处。模拟电路中，由于放大器的存在，由布线产生的极小噪声电压，都会引起输出信号的严重失真，在数字电路中，TTL噪声容限为0.4V～0.6V,CMOS噪声容限为Vcc的0.3～0.45倍,故数字电路具有较强的抗干扰的能力。良好的电源和地总线方式的合理选择是仪器可靠工作的重要保证，相当多的干扰源是通过电源和地总线产生的，其中地线引起的噪声干扰最大。

　　二、印刷电路板图设计的基本原则要求
　　１．印刷电路板的设计，从确定板的尺寸大小开始，印刷电路板的尺寸因受机箱外壳大小限制，以能恰好安放入外壳内为宜，其次，应考虑印刷电路板与外接元器件（主要是电位器、插口或另外印刷电路板）的连接方式。印刷电路板与外接元件一般是通过塑料导线或金属隔离线进行连接。但有时也设计成插座形式。即：在设备内安装一个插入式印刷电路板要留出充当插口的接触位置。对于安装在印刷电路板上的较大的元件，要加金属附件固定，以提高耐振、耐冲击性能。
! h( Q/ R" p/ h2 n; Z　　２．布线图设计的基本方法
  A& x! L6 l/ O+ b/ z　　首先需要对所选用元件器及各种插座的规格、尺寸、面积等有完全的了解；对各部件的位置安排作合理的、仔细的考虑，主要是从电磁场兼容性、抗干扰的角度，走线短，交叉少，电源，地的路径及去耦等方面考虑。各部件位置定出后，就是各部件的连线，按照电路图连接有关引脚，完成的方法有多种，印刷线路图的设计有计算机辅助设计与手工设计方法两种。
　　最原始的是手工排列布图。这比较费事，往往要反复几次，才能最后完成，这在没有其它绘图设备时也可以，这种手工排列布图方法对刚学习印刷板图设计者来说也是很有帮助的。计算机辅助制图，现在有多种绘图软件，功能各异，但总的说来，绘制、修改较方便，并且可以存盘贮存和打印。
' }4 x* Y+ ?) r- J( B　　接着，确定印刷电路板所需的尺寸，并按原理图，将各个元器件位置初步确定下来，然后经过不断调整使布局更加合理，印刷电路板中各元件之间的接线安排方式如下：
　　（１）印刷电路中不允许有交叉电路，对于可能交叉的线条，可以用“钻”、“绕”两种办法解决。即，让某引线从别的电阻、电容、三极管脚下的空隙处“钻”过去，或从可能交叉的某条引线的一端“绕”过去，在特殊情况下如何电路很复杂，为简化设计也允许用导线跨接，解决交叉电路问题。
  |; c  T6 }' @1 }5 X" V　　（２）电阻、二极管、管状电容器等元件有“立式”，“卧式”两种安装方式。立式指的是元件体垂直于电路板安装、焊接，其优点是节省空间，卧式指的是元件体平行并紧贴于电路板安装，焊接，其优点是元件安装的机械强度较好。这两种不同的安装元件，印刷电路板上的元件孔距是不一样的。
8 a6 _! |: E8 J" N! m, O$ X2 {　　（３）同一级电路的接地点应尽量靠近，并且本级电路的电源滤波电容也应接在该级接地点上。特别是本级晶体管基极、发射极的接地点不能离得太远，否则因两个接地点间的铜箔太长会引起干扰与自激，采用这样“一点接地法”的电路，工作较稳定，不易自激。
　　（４）总地线必须严格按高频－中频－低频一级级地按弱电到强电的顺序排列原则，切不可随便翻来复去乱接，级与级间宁肯可接线长点，也要遵守这一规定。特别是变频头、再生头、调频头的接地线安排要求更为严格，如有不当就会产生自激以致无法工作。调频头等高频电路常采用大面积包围式地线，以保证有良好的屏蔽效果。
$ G% D* z& J) _1 P0 s, B7 b　　（５）强电流引线（公共地线，功放电源引线等）应尽可能宽些，以降低布线电阻及其电压降，可减小寄生耦合而产生的自激。
　　（６）阻抗高的走线尽量短，阻抗低的走线可长一些，因为阻抗高的走线容易发笛和吸收信号，引起电路不稳定。电源线、地线、无反馈元件的基极走线、发射极引线等均属低阻抗走线，射极跟随器的基极走线、收录机两个声道的地线必须分开，各自成一路，一直到功效末端再合起来，如两路地线连来连去，极易产生串音，使分离度下降。
; v8 p" e& s+ k/ o# W- ]
' m; r. u; Z" E  I8 K% ~4 I排列，分布要合理和均匀，力求整齐，美观，结构严谨的工艺要求。
　　３．电阻，二极管的放置方式：分为平放与竖放两种：
　　（１）平放：当电路元件数量不多，而且电路板尺寸较大的情况下，一般是采用平放较好；对于1/4W以下的电阻平放时,两个焊盘间的距离一般取4/10英寸，1/2W的电阻平放时,两焊盘的间距一般取5/10英寸；二极管平放时，1N400X系列整流管,一般取3/10英寸;1N540X系列整流管,一般取4～5/10英寸。
  x5 M, {# P, h1 _　　（２）竖放：当电路元件数较多，而且电路板尺寸不大的情况下，一般是采用竖放，竖放时两个焊盘的间距一般取1～2/10英寸。
: ~' x  e: V& t- v　　４．电位器：IC座的放置原则
　　（１）电位器：在稳压器中用来调节输出电压，故设计电位器应满中顺时针调节时输出电压升高，反时针调节器节时输出电压降低；在可调恒流充电器中电位器用来调节充电电流折大小，设计电位器时应满中顺时针调节时，电流增大。电位器安放位轩应当满中整机结构安装及面板布局的要求，因此应尽可能放轩在板的边缘，旋转柄朝外。
6 Y4 C$ M" S9 G# o& P　　（２）IC座：设计印刷板图时，在使用IC座的场合下，一定要特别注意IC座上定位槽放置的方位是否正确，并注意各个IC脚位是否正确，例如第1脚只能位于IC座的右下角线或者左上角，而且紧靠定位槽（从焊接面看）。
- V; ?+ j7 L  `7 d  R& f9 h( `　　５．进出接线端布置
6 s& x1 Q' A- B  {# |! M* T! ^　　（１）相关联的两引线端不要距离太大，一般为2～3/10英寸左右较合适。
' q$ J/ ]6 z3 x5 j2 ]- W　　（２）进出线端尽可能集中在1至2个侧面，不要太过离散。
　　６．设计布线图时要注意管脚排列顺序，元件脚间距要合理。
　　７．在保证电路性能要求的前提下，设计时应力求走线合理，少用外接跨线，并按一定顺充要求走线，力求直观，便于安装，高度和检修。
% O+ S; P' N7 n# d, j; w' H0 j　　８．设计布线图时走线尽量少拐弯，力求线条简单明了。
. a5 ~* S: L  K. [7 F　　９．布线条宽窄和线条间距要适中，电容器两焊盘间距应尽可能与电容引线脚的间距相符；
　　１０．设计应按一定顺序方向进行，例如可以由左往右和由上而下的顺序进行
第一篇  PCB布线
在PCB设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的， 在整个PCB中，以布线的设计过程限定最高，技巧最细、工作量最大。PCB布线有单面布线、 双面布线及多层布线。布线的方式也有两种：自动布线及交互式布线，在自动布线之前， 可以用交互式预先对要求比较严格的线进行布线，输入端与输出端的边线应避免相邻平行， 以免产生反射干扰。必要时应加地线隔离，两相邻层的布线要互相垂直，平行容易产生寄生耦合。
    自动布线的布通率，依赖于良好的布局，布线规则可以预先设定， 包括走线的弯曲次数、导通孔的数目、步进的数目等。一般先进行探索式布经线，快速地把短线连通， 然后进行迷宫式布线，先把要布的连线进行全局的布线路径优化，它可以根据需要断开已布的线。 并试着重新再布线，以改进总体效果。
+ B: N# N* ]# R+ S) E& }9 T    对目前高密度的PCB设计已感觉到贯通孔不太适应了， 它浪费了许多宝贵的布线通道，为解决这一矛盾，出现了盲孔和埋孔技术，它不仅完成了导通孔的作用， 还省出许多布线通道使布线过程完成得更加方便，更加流畅，更为完善，PCB 板的设计过程是一个复杂而又简单的过程，要想很好地掌握它，还需广大电子工程设计人员去自已体会， 才能得到其中的真谛。
$ ^6 T9 v6 u3 C0 m' j+ C) e6 J# Y
: ^( v9 f# H8 ^8 T" c; q1 电源、地线的处理
5 @# {3 G# |' ]    既使在整个PCB板中的布线完成得都很好，但由于电源、 地线的考虑不周到而引起的干扰，会使产品的性能下降，有时甚至影响到产品的成功率。所以对电、 地线的布线要认真对待，把电、地线所产生的噪音干扰降到最低限度，以保证产品的质量。
    对每个从事电子产品设计的工程人员来说都明白地线与电源线之间噪音所产生的原因， 现只对降低式抑制噪音作以表述：
% a- _1 d' P2 L5 I/ Y3 ~. ?（1）、众所周知的是在电源、地线之间加上去耦电容。
3 `: ~' x) `* u% }* h! l7 h3 I) p' a（2）、尽量加宽电源、地线宽度，最好是地线比电源线宽，它们的关系是：地线＞电源线＞信号线，通常信号线宽为：0.2～0.3mm,最经细宽度可达0.05～0.07mm,电源线为1.2～2.5 mm
对数字电路的PCB可用宽的地导线组成一个回路, 即构成一个地网来使用(模拟电路的地不能这样使用)
（3）、用大面积铜层作地线用,在印制板上把没被用上的地方都与地相连接作为地线用。或是做成多层板，电源，地线各占用一层。

2 数字电路与模拟电路的共地处理
    现在有许多PCB不再是单一功能电路（数字或模拟电路），而是由数字电路和模拟电路混合构成的。因此在布线时就需要考虑它们之间互相干扰问题，特别是地线上的噪音干扰。
    数字电路的频率高，模拟电路的敏感度强，对信号线来说，高频的信号线尽可能远离敏感的模拟电路器件，对地线来说，整人PCB对外界只有一个结点，所以必须在PCB内部进行处理数、模共地的问题，而在板内部数字地和模拟地实际上是分开的它们之间互不相连，只是在PCB与外界连接的接口处（如插头等）。数字地与模拟地有一点短接，请注意，只有一个连接点。也有在PCB上不共地的，这由系统设计来决定。

3 信号线布在电（地）层上
8 T( ^- P; |8 r" v9 ~' e    在多层印制板布线时，由于在信号线层没有布完的线剩下已经不多，再多加层数就会造成浪费也会给生产增加一定的工作量，成本也相应增加了，为解决这个矛盾，可以考虑在电（地）层上进行布线。首先应考虑用电源层，其次才是地层。因为最好是保留地层的完整性。
6 f/ i3 O5 H6 k  Y" V- N. u
, I/ g. Z7 _4 C) w) {) h4 大面积导体中连接腿的处理
1 E3 z4 n- a- r    在大面积的接地（电）中，常用元器件的腿与其连接，对连接腿的处理需要进行综合的考虑，就电气性能而言，元件腿的焊盘与铜面满接为好，但对元件的焊接装配就存在一些不良隐患如：①焊接需要大功率加热器。②容易造成虚焊点。所以兼顾电气性能与工艺需要，做成十字花焊盘，称之为热隔离（heat shield）俗称热焊盘（Thermal），这样，可使在焊接时因截面过分散热而产生虚焊点的可能性大大减少。多层板的接电（地）层腿的处理相同。

5 布线中网络系统的作用
    在许多CAD系统中，布线是依据网络系统决定的。网格过密，通路虽然有所增加，但步进太小，图场的数据量过大，这必然对设备的存贮空间有更高的要求，同时也对象计算机类电子产品的运算速度有极大的影响。而有些通路是无效的，如被元件腿的焊盘占用的或被安装孔、定们孔所占用的等。网格过疏，通路太少对布通率的影响极大。所以要有一个疏密合理的网格系统来支持布线的进行。
$ y0 c" I# Y. _  J8 W2 u" X0 t    标准元器件两腿之间的距离为0.1英寸(2.54mm),所以网格系统的基础一般就定为0.1英寸(2.54 mm)或小于0.1英寸的整倍数，如：0.05英寸、0.025英寸、0.02英寸等。

6 设计规则检查（DRC）
    布线设计完成后，需认真检查布线设计是否符合设计者所制定的规则，同时也需确认所制定的规则是否符合印制板生产工艺的需求，一般检查有如下几个方面：

! q, ~; ?6 Y2 h% {/ \（1）、线与线，线与元件焊盘，线与贯通孔，元件焊盘与贯通孔，贯通孔与贯通孔之间的距离是否合理，是否满足生产要求。
（2）、电源线和地线的宽度是否合适，电源与地线之间是否紧耦合（低的波阻抗）？在PCB中是否还有能让地线加宽的地方。
6 M1 m5 u- J, M. t$ C3 [（3）、对于关键的信号线是否采取了最佳措施，如长度最短，加保护线，输入线及输出线被明显地分开。
（4）、模拟电路和数字电路部分，是否有各自独立的地线。
（5）后加在PCB中的图形（如图标、注标）是否会造成信号短路。
1 h0 T( L1 q+ O7 ]7 M# ]. p! f（6）对一些不理想的线形进行修改。
4 N- O5 c8 q: x1 Z& R; `3 @（7）、在PCB上是否加有工艺线？阻焊是否符合生产工艺的要求，阻焊尺寸是否合适，字符标志是否压在器件焊盘上，以免影响电装质量。
（8）、多层板中的电源地层的外框边缘是否缩小，如电源地层的铜箔露出板外容易造成短路。
下面的问题，属于网友经常提问的。现在把问题和解答整理出来。
' `! `3 D. E5 `; p$ \# f; }A.常用软件的下载问题   
+ y( t$ ]" T+ N2 |8 q' aB.Protel常见操作问题
! {9 b- {) A# m& GC.Protel中常用元件的封装
D.由SCH生成PCB时提示出错(Protel)
E.电容，二极管，三极管，有源晶振等器件的极性
F.不同逻辑电平的接口                                                         

G.电阻，电容值的识别                                                         
* V1 x+ K& h7 z2 ]/ ~) |7 i! u3 D


A.常用软件的下载问题：
★Protel99se,Protel2004从哪里可以下载到
    在http://tu.cndzz.com/down/index.htm置底ftp,soft帐号下,pub/eda下。密码将不定期更改，见置底贴。

* E4 Z6 N6 G, J" R' VB.Protel常见操作问题:
6 Q0 V; A, }+ O4 B2 ~7 M★如何将原理图中的电路粘贴到Word中
    tools->preferences->Graphical Editing,取消Add Template to Clipboard,然后
复制

★如何切换mil和mm单位
/ O( g. I5 F( [& ]' Z    菜单View->Toggle Unit，或者按Q键

★取消备份及DDB文件减肥：
0 W" [* j1 K* h$ L; ]7 ?3 ?    "File"菜单左边一个向下的灰色箭头
    preference-->create backup files
, B0 F: e. ~( d# {    design utilities-->perform compact after closing
- f( C5 G4 d2 I
★如何把SCH，PCB输出到PDF格式
    安装Acrobat Distiller打印机，在acrobat 5.0以上版本中带的。然后在Protel里
9 v3 h. y) v- d2 }的打印选项里，
    选择打印机acrobat Distiller即可。
3 D0 q, |7 g. V/ Z/ Y( ^# p6 K
★如何设置和更改Protel的DRC(Design Rules Check）
    菜单Design->rules。只针对常用的规则进行讲解：
5 }" N* R9 V$ F    * Clearance Constraint:不同两个网络的间距，一般设置>12 mil，加工都不会出
问题
    * Routing Via Style:设置过孔参数，具体含义在属性里有图。一般hole size比导
9 p$ w  q" m; I: D; w线宽8mil以上，diameter
      比hole size大10mil 以上
% @5 G9 v- K3 F$ [5 B. m! w! E  e    * Width Constraint:导线宽度设置，建议>10mil
% b& O. v6 y/ F) E& Z* e
                                   
  L- d+ N9 H% y/ V1 j& {C.Protel中常用元件的封装
  i) d' c! P: ]9 H
   以下元件在Protel DOS Schematic Libraries.ddb,Miscellaneous Devices.ddb(以
6 {5 ~3 @; e- ~4 o/ ]( N- b上
. z  M; v# Q5 Z2 `7 f( r9 a0 S是schlib)Advpcb.ddb,Transistors.ddb,General IC.ddb(以上是PCBlib)等库文件中，
可
9 ?3 _8 L0 y" R$ O' I; M以使用通配符“*”进行查找。另外，希望大家把自己做的封装传到ftp上共享，这样可
以节省时间。

) _5 U2 @1 T4 x1 [9 @6 X                                直插                    表贴
. [1 V- D5 {! p0 ]0 H电阻，小电感                    axial0.3/axial0.4       0805/0603等
小电容                          RAD0.1/ RAD0.2          0805/0603等
, {; {" G1 ~7 y4 Z0 p电解电容                        (RB.2/.4)               1210/1812/2220等
小功率三极管                    TO-92A/B               
5 y1 l# |4 d: ?6 v: B' g7 j' qSOT-23               
大功率三极管(三端稳压)          T0-220                  
小功率二极管                    DIODE-0.4               自己做
! p( l$ f1 q  c; n- n$ h4 H双列IC                          DIPxx                   SO-xx     xx代表引脚
数
0 @, m, Y; i1 n; Y7 ~4 f
- ^/ f# Z$ \7 G( R1 R  `有源晶振                        DIP14(保留四个顶点,去掉中间10个焊盘)
四方型IC                        大部分需要自己用向导画,尺寸参照datasheet
! _1 J1 B7 f" Q# Y& {4 ]接插件                          SIPxx/IDCxx,DB9/DB25(注意male/female的区别)等
电位器，开关，继电器等          买好了元件，量好尺寸自己画
. _: Q" T! Q+ d% ?, Z: i4 R5 W提醒:*使用封装时最好少用水平/垂直翻转功能
     *自己建好的元件库或者PCB，一定要1:1的打印出来，和实际比较，以确保无误
     *有条件的话，尽量先买好器件，再定封装，可以节省很多眼泪

/ C' j' W2 K/ {- a; `                              

3 a: Z5 j' Z% s+ p7 {, g+ UD.由SCH生成PCB时提示出错(Protel)
7 b' W) a; x) I& b
  sch编辑界面中选择design-->updatepcb,在出现的对话框中按“Preview Change”按
钮
( v% |6 B% e) ~( C，选中 Only show Errors会列出所有错误
9 r' ?- y/ C( O+ w, w0 h& W/ h
      错误类型                                解决办法
1.footprint not found           确保所有的器件都指定了封装
  R) B7 b7 t' @  U4 f$ D4 G- y" K                                确保指定的封装名与PCB中的封装名一致
                                确保你的库已经打开或者被添加
8 [5 H6 x# j3 U7 X2.node not found                确认没有“footprint not found” 类型的错误
& b% M- D, ?, n3 X# F. F                                编辑PCBlib,将对应引脚名改成没有找到的那个node
3.Duplicate sheet number        degisn-options-organization,给每张子电路图编
号

, O1 M# Z9 `' e
E.电容，二极管，三极管等器件的极性问题:

直插铝电解：负极附近有黑色的“-”标记，如果没有剪腿的话，长腿为正
贴片钽电解：有横杠的一头为正
二极管：    有圈的一头为负
小功率三极管                                 F.不同逻辑电平的接口问题:

. K# X3 Y1 O* w+ F7 x3 q, ICMOS<-->TTL     电源电压相同的条件下可以兼容
  D8 g0 a( g% f4 b- M2 ]+ L3.3V--->5V      一般可以直接驱动(以datasheet为准!)
5V--->3.3V      74LVT245/74LVT16245
( }. X* O! ^) M: C) j4 Z0 B1 C2 e' D5V<-->3.3V      74LVC4245/74LVC16245
. N1 k9 \& D1 S, ?3 nECL-->TTL       MC10125
TTL-->ECL       MC10124
0 [, Z: M1 [& b
/ @2 E0 }) `! Y" n
G.电阻，电容值的识别

色环电阻:
黑 棕 红 橙 黄 绿 蓝 紫 灰 白
0  1  2  3  4  5  6  7  8  9

最后一环表示精度,离其他几环比较远(一般是棕色)
0 G# m0 f3 K. n" R0 B倒数第二环表示阶数(10^n)
& S  m' F5 i: l4 Z& W" u( C前面的是有效数字
例: “绿棕黑黑棕”这个电阻是510欧
( a3 o- \+ o1 u4 t+ V
小电容:
- [6 ?* x1 |0 k9 c) y通常以三位数标注,以pf为单位
( e" w) y6 t+ }9 o# d. }前两位是有效数字,最后一位表示阶数（为0时，可以空缺):
例:“332”这个电容是3300 pf
( ^8 U0 q6 ?  y, }, U" |& q! c   “471”这个电容是470pf   
   “47”这个电容是47pF
第二篇
  B0 b) V! E8 }- ~+ z% F) I; X           如何实现PCB高的布通率以及缩短设计时间
尽管现在的EDA工具很强大，但随着PCB尺寸要求越来越小，器件密度越来越高，PCB设计的难度并不小。如何实现PCB高的布通率以及缩短设计时间呢？本文介绍PCB规划、布局和布线的设计技巧和要点。 现在PCB设计的时间越来越短，越来越小的电路板空间，越来越高的器件密度，极其苛刻的布局规则和大尺寸的组件使得设计师的工作更加困难。为了解决设计上的困难，加快产品的上市，现在很多厂家倾向于采用专用EDA工具来实现PCB的设计。但专用的EDA工具并不能产生理想的结果，也不能达到100%的布通率，而且很乱，通常还需花很多时间完成余下的工作。
) k( J+ I8 n. B6 B; x3 k
　　现在市面上流行的EDA工具软件很多，但除了使用的术语和功能键的位置不一样外都大同小异，如何用这些工具更好地实现PCB的设计呢？在开始布线之前对设计进行认真的分析以及对工具软件进行认真的设置将使设计更加符合要求。下面是一般的设计过程和步骤。  
* i- k. f/ l4 y  }
　　1、确定PCB的层数

　　电路板尺寸和布线层数需要在设计初期确定。如果设计要求使用高密度球栅数组(BGA)组件，就必须考虑这些器件布线所需要的最少布线层数。布线层的数量以及层叠(stack-up)方式会直接影响到印制线的布线和阻抗。板的大小有助于确定层叠方式和印制线宽度，实现期望的设计效果。
' a. T% l8 ~; Y. N4 ^: {! @
3 V  N9 a) @+ f  [( I; p* f- o2 y　　多年来，人们总是认为电路板层数越少成本就越低，但是影响电路板的制造成本还有许多其它因素。近几年来，多层板之间的成本差别已经大大减小。在开始设计时最好采用较多的电路层并使敷铜均匀分布，以避免在设计临近结束时才发现有少量信号不符合已定义的规则以及空间要求，从而被迫添加新层。在设计之前认真的规划将减少布线中很多的麻烦。  

. G8 L8 l. j3 d5 ?　　2、设计规则和限制
6 d' y# J% r, s- q! C
9 ~9 i% v5 W$ M! y2 C" s　　自动布线工具本身并不知道应该做些什幺。为完成布线任务，布线工具需要在正确的规则和限制条件下工作。不同的信号线有不同的布线要求，要对所有特殊要求的信号线进行分类，不同的设计分类也不一样。每个信号类都应该有优先级，优先级越高，规则也越严格。规则涉及印制线宽度、过孔的最大数量、平行度、信号线之间的相互影响以及层的限制，这些规则对布线工具的性能有很大影响。认真考虑设计要求是成功布线的重要一步。  

　　3、组件的布局
* x& R! s% _! b  b& A
: |  s2 p% X0 S0 a0 [+ R& g　　为最优化装配过程，可制造性设计(DFM)规则会对组件布局产生限制。如果装配部门允许组件移动，可以对电路适当优化，更便于自动布线。所定义的规则和约束条件会影响布局设计。

% e' ?' ^$ V# `( S' j　　在布局时需考虑布线路径(routing channel)和过孔区域。这些路径和区域对设计人员而言是显而易见的，但自动布线工具一次只会考虑一个信号，通过设置布线约束条件以及设定可布信号线的层，可以使布线工具能像设计师所设想的那样完成布线。  
  x0 p' H2 d; s- C) X
' k) w4 X% S8 S- |  Y) M) w) M2 l　　4、扇出设计

　　在扇出设计阶段，要使自动布线工具能对组件引脚进行连接，表面贴装器件的每一个引脚至少应有一个过孔，以便在需要更多的连接时，电路板能够进行内层连接、在线测试(ICT)和电路再处理。  

8 u- M% S$ O) F& k$ q  B' k　　为了使自动布线工具效率最高，一定要尽可能使用最大的过孔尺寸和印制线，间隔设置为50mil较为理想。要采用使布线路径数最大的过孔类型。进行扇出设计时，要考虑到电路在线测试问题。测试夹具可能很昂贵，而且通常是在即将投入全面生产时才会订购，如果这时候才考虑添加节点以实现100%可测试性就太晚了。  
& V  K# X2 j  ^
! t$ Z$ {, J* d. w$ A　　经过慎重考虑和预测，电路在线测试的设计可在设计初期进行，在生产过程后期实现，根据布线路径和电路在线测试来确定过孔扇出类型，电源和接地也会影响到布线和扇出设计。为降低滤波电容器连接线产生的感抗，过孔应尽可能靠近表面贴装器件的引脚，必要时可采用手动布线，这可能会对原来设想的布线路径产生影响，甚至可能会导致你重新考虑使用哪种过孔，因此必须考虑过孔和引脚感抗间的关系并设定过孔规格的优先级。  
, h, x6 E' J5 q0 Y( @
　　5、手动布线以及关键信号的处理  
8 t9 X+ E  m2 `+ Q2 P# t+ A
* O: H; k3 Q$ O6 g4 I+ z. L: W　　尽管本文主要论述自动布线问题，但手动布线在现在和将来都是印刷电路板设计的一个重要过程。采用手动布线有助于自动布线工具完成布线工作。如图2a和图2b所示，通过对挑选出的网络(net)进行手动布线并加以固定，可以形成自动布线时可依据的路径。  

/ @: B/ H# M' ?　　无论关键信号的数量有多少，首先对这些信号进行布线，手动布线或结合自动布线工具均可。关键信号通常必须通过精心的电路设计才能达到期望的性能。布线完成后，再由有关的工程人员来对这些信号布线进行检查，这个过程相对容易得多。检查通过后，将这些线固定，然后开始对其余信号进行自动布线。  
  d- j9 J& u5 z) w: b
. r0 n& o+ l$ {6 D0 W　　6、自动布线  
/ i  J6 e$ b; x( G6 w7 l
2 O. y, f. ]- r: e3 s7 B5 l　　对关键信号的布线需要考虑在布线时控制一些电参数，比如减小分布电感和EMC等，对于其它信号的布线也类似。所有的EDA厂商都会提供一种方法来控制这些参数。在了解自动布线工具有哪些输入参数以及输入参数对布线的影响后，自动布线的质量在一定程度上可以得到保证。
" Q2 h9 l) M7 F: E7 `
. ]* D4 a& \& T4 U　　应该采用通用规则来对信号进行自动布线。通过设置限制条件和禁止布线区来限定给定信号所使用的层以及所用到的过孔数量，布线工具就能按照工程师的设计思想来自动布线。如果对自动布线工具所用的层和所布过孔的数量不加限制，自动布线时将会使用到每一层，而且将会产生很多过孔。  
+ J  e, c9 U6 l$ e/ Y$ F
　　在设置好约束条件和应用所创建的规则后，自动布线将会达到与预期相近的结果，当然可能还需要进行一些整理工作，同时还需要确保其它信号和网络布线的空间。在一部分设计完成以后，将其固定下来，以防止受到后边布线过程的影响。  
& x2 h4 U" `. d5 j% _* C
　　采用相同的步骤对其余信号进行布线。布线次数取决于电路的复杂性和你所定义的通用规则的多少。每完成一类信号后，其余网络布线的约束条件就会减少。但随之而来的是很多信号布线需要手动干预。现在的自动布线工具功能非常强大，通常可完成100%的布线。但是当自动布线工具未完成全部信号布线时，就需对余下的信号进行手动布线。  
, @$ D9 j) a: |
　　7、自动布线的设计要点包括:

0 `, ]* e# ]% u" ~6 n　　7.1 略微改变设置，试用多种路径布线；
　　7.2 保持基本规则不变，试用不同的布线层、不同的印制线和间隔宽度以及不同线宽、不同类型的过孔如盲孔、埋孔等，观察这些因素对设计结果有何影响；
　　7.3让布线工具对那些默认的网络根据需要进行处理；
0 `# B% a2 n6 ?- o　　7.4信号越不重要，自动布线工具对其布线的自由度就越大。  

8 G" b! w; h/ R8 p. j$ @　　8、布线的整理  

, ]* ]0 Y$ [. P0 F　　如果你所使用的EDA工具软件能够列出信号的布线长度，检查这些数据，你可能会发现一些约束条件很少的信号布线的长度很长。这个问题比较容易处理，通过手动编辑可以缩短信号布线长度和减少过孔数量。在整理过程中，你需要判断出哪些布线合理，哪些布线不合理。同手动布线设计一样，自动布线设计也能在检查过程中进行整理和编辑。  
* \' H- ?& e: W+ N/ i7 e. r
　　9、电路板的外观  

* L% Y# {0 i+ e& J4 O8 {　　以前的设计常常注意电路板的视觉效果，现在不一样了。自动设计的电路板不比手动设计的美观，但在电子特性上能满足规定的要求，而且设计的完整性能得到保证
% M4 u4 x6 ~5 N& S* K2 X4 R
  X. t2 e0 k# F0 w3 ]- l1 q第三篇
PROTEL技术大全


6 V. }3 @- A7 ]  
1.原理图常见错误：
/ K7 n# }5 S+ ~! |6 M, g   （1）ERC报告管脚没有接入信号：
7 z! t7 ^* `8 }! \    a. 创建封装时给管脚定义了I/O属性；
% ^. X: @8 f! s6 `0 a" q1 x9 \    b.创建元件或放置元件时修改了不一致的grid属性，管脚与线没有连上；
    c. 创建元件时pin方向反向，必须非pin name端连线。
8 Q7 g$ ?3 W$ o  （2）元件跑到图纸界外：没有在元件库图表纸中心创建元件。
' v# D3 D0 p3 {  （3）创建的工程文件网络表只能部分调入pcb：生成netlist时没有选择为global。
  （4）当使用自己创建的多部分组成的元件时，千万不要使用annotate.
) ?- P0 {4 g4 b  e3 V2 o2.PCB中常见错误：
  （1）网络载入时报告NODE没有找到：
   a. 原理图中的元件使用了pcb库中没有的封装；
   b. 原理图中的元件使用了pcb库中名称不一致的封装；
8 U1 e# Y$ w7 P* f" J+ O, T   c. 原理图中的元件使用了pcb库中pin number不一致的封装。如三极管：sch中pin number 为e,b,c, 而pcb中为1，2，3。
（2）打印时总是不能打印到一页纸上：
   a. 创建pcb库时没有在原点；
. J7 |: E; E" N) x   b. 多次移动和旋转了元件，pcb板界外有隐藏的字符。选择显示所有隐藏的字符， 缩小pcb, 然后移动字符到边界内。
  （3）DRC报告网络被分成几个部分：
  表示这个网络没有连通，看报告文件，使用选择CONNECTED COPPER查找。
% ?) b4 N$ L6 k2 M7 x3 z  另外提醒朋友尽量使用WIN2000, 减少蓝屏的机会；多几次导出文件，做成新的DDB文件，减少文件尺寸和PROTEL僵死的机会。如果作较复杂得设计，尽量不要使用自动布线。
# g$ l9 W3 j1 x
4 Z8 _) X) e. K0 {8 q在PCB设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的， 在整个PCB中，以布线的设计过程限定最高，技巧最细、工作量最大。PCB布线有单面布线、 双面布线及多层布线。布线的方式也有两种：自动布线及交互式布线，在自动布线之前， 可以用交互式预先对要求比较严格的线进行布线，输入端与输出端的边线应避免相邻平行， 以免产生反射干扰。必要时应加地线隔离，两相邻层的布线要互相垂直，平行容易产生寄生耦合。
2 E  G3 i/ m& Z! ~9 z8 r
) ^- c! c2 V+ A7 O# P自动布线的布通率，依赖于良好的布局，布线规则可以预先设定， 包括走线的弯曲次数、导通孔的数目、步进的数目等。一般先进行探索式布经线，快速地把短线连通， 然后进行迷宫式布线，先把要布的连线进行全局的布线路径优化，它可以根据需要断开已布的线。 并试着重新再布线，以改进总体效果。

) q* P8 w4 A% d# m- ^& h对目前高密度的PCB设计已感觉到贯通孔不太适应了， 它浪费了许多宝贵的布线通道，为解决这一矛盾，出现了盲孔和埋孔技术，它不仅完成了导通孔的作用， 还省出许多布线通道使布线过程完成得更加方便，更加流畅，更为完善，PCB 板的设计过程是一个复杂而又简单的过程，要想很好地掌握它，还需广大电子工程设计人员去自已体会， 才能得到其中的真谛。
2 d8 j% N8 x9 h; p
1 电源、地线的处理
5 ^. b' `$ m( B6 X0 u
既使在整个PCB板中的布线完成得都很好，但由于电源、 地线的考虑不周到而引起的干扰，会使产品的性能下降，有时甚至影响到产品的成功率。所以对电、 地线的布线要认真对待，把电、地线所产生的噪音干扰降到最低限度，以保证产品的质量。
# x8 m0 }! o1 W$ M: h# T9 m
对每个从事电子产品设计的工程人员来说都明白地线与电源线之间噪音所产生的原因， 现只对降低式抑制噪音作以表述：

/ t; ~6 t$ \2 F& c9 _9 l众所周知的是在电源、地线之间加上去耦电容。
9 F) [. C+ n7 o: v) K% C尽量加宽电源、地线宽度，最好是地线比电源线宽，它们的关系是：地线＞电源线＞信号线，通常信号线宽为：0.2～0.3mm,最经细宽度可达0.05～0.07mm,电源线为1.2～2.5 mm
对数字电路的PCB可用宽的地导线组成一个回路, 即构成一个地网来使用(模拟电路的地不能这样使用)
" a& v) L) ?* y1 V3 d& _4 I: E用大面积铜层作地线用,在印制板上把没被用上的地方都与地相连接作为地线用。或是做成多层板，电源，地线各占用一层。
% E( d1 k" I. M/ r- M# Q6 L* F6 @4 ]2、数字电路与模拟电路的共地处理

现在有许多PCB不再是单一功能电路（数字或模拟电路），而是由数字电路和模拟电路混合构成的。因此在布线时就需要考虑它们之间互相干扰问题，特别是地线上的噪音干扰。
数字电路的频率高，模拟电路的敏感度强，对信号线来说，高频的信号线尽可能远离敏感的模拟电路器件，对地线来说，整人PCB对外界只有一个结点，所以必须在PCB内部进行处理数、模共地的问题，而在板内部数字地和模拟地实际上是分开的它们之间互不相连，只是在PCB与外界连接的接口处（如插头等）。数字地与模拟地有一点短接，请注意，只有一个连接点。也有在PCB上不共地的，这由系统设计来决定。
$ X9 K" a. t- }* U' e, k
0 h4 J: G, {5 O1 m3、信号线布在电（地）层上

在多层印制板布线时，由于在信号线层没有布完的线剩下已经不多，再多加层数就会造成浪费也会给生产增加一定的工作量，成本也相应增加了，为解决这个矛盾，可以考虑在电（地）层上进行布线。首先应考虑用电源层，其次才是地层。因为最好是保留地层的完整性。
3 S8 y( ^8 X) M; y2 w. I$ X
& \  ]; W  E$ c% z8 s  H8 g4、大面积导体中连接腿的处理
9 }: \, h: c2 m3 w
在大面积的接地（电）中，常用元器件的腿与其连接，对连接腿的处理需要进行综合的考虑，就电气性能而言，元件腿的焊盘与铜面满接为好，但对元件的焊接装配就存在一些不良隐患如：①焊接需要大功率加热器。②容易造成虚焊点。所以兼顾电气性能与工艺需要，做成十字花焊盘，称之为热隔离（heat shield）俗称热焊盘（Thermal），这样，可使在焊接时因截面过分散热而产生虚焊点的可能性大大减少。多层板的接电（地）层腿的处理相同。
  _$ E- n1 I  v" o  f2 ~0 M
9 Y8 a/ F& a5 I% E; _5、布线中网络系统的作用

; V9 l) [+ S0 f1 ~& _在许多CAD系统中，布线是依据网络系统决定的。网格过密，通路虽然有所增加，但步进太小，图场的数据量过大，这必然对设备的存贮空间有更高的要求，同时也对象计算机类电子产品的运算速度有极大的影响。而有些通路是无效的，如被元件腿的焊盘占用的或被安装孔、定们孔所占用的等。网格过疏，通路太少对布通率的影响极大。所以要有一个疏密合理的网格系统来支持布线的进行。

+ ?3 {0 k4 w; I% u标准元器件两腿之间的距离为0.1英寸(2.54mm),所以网格系统的基础一般就定为0.1英寸(2.54 mm)或小于0.1英寸的整倍数，如：0.05英寸、0.025英寸、0.02英寸等。

6、设计规则检查（DRC）
* O; j7 I- }" A$ e
5 P& E  _& k/ f1 i" X1 z. S布线设计完成后，需认真检查布线设计是否符合设计者所制定的规则，同时也需确认所制定的规则是否符合印制板生产工艺的需求，一般检查有如下几个方面：

3 P$ b/ H$ n# `# l* i9 I4 J8 {4 a/ @& r线与线，线与元件焊盘，线与贯通孔，元件焊盘与贯通孔，贯通孔与贯通孔之间的距离是否合理，是否满足生产要求。
电源线和地线的宽度是否合适，电源与地线之间是否紧耦合（低的波阻抗）？在PCB中是否还有能让地线加宽的地方。
对于关键的信号线是否采取了最佳措施，如长度最短，加保护线，输入线及输出线被明显地分开。
" ^5 E# ?. ]) g9 }6 {8 u, M7 A( b/ u  z模拟电路和数字电路部分，是否有各自独立的地线。
4 [) ^- v: }3 \8 r: Z+ M' T后加在PCB中的图形（如图标、注标）是否会造成信号短路。
, U  n: h: h& \; V8 W7 \对一些不理想的线形进行修改。
9 Z* r' v  U6 u6 b) w5 B8 q在PCB上是否加有工艺线？阻焊是否符合生产工艺的要求，阻焊尺寸是否合适，字符标志是否压在器件焊盘上，以免影响电装质量。
9 `7 L7 A  T! B2 ]2 W多层板中的电源地层的外框边缘是否缩小，如电源地层的铜箔露出板外容易造成短路。概述
本文档的目的在于说明使用PADS的印制板设计软件PowerPCB进行印制板设计的流程和一些注意事项，为一个工作组的设计人员提供设计规范，方便设计人员之间进行交流和相互检查。

7 f* J6 ^, A& j9 |. k% c2、设计流程
; _! O4 \8 y. t* z4 @: CPCB的设计流程分为网表输入、规则设置、元器件布局、布线、检查、复查、输出六个步骤.
2.1 网表输入
   网表输入有两种方法，一种是使用PowerLogic的OLE PowerPCB Connection功能，选择Send Netlist，应用OLE功能，可以随时保持原理图和PCB图的一致，尽量减少出错的可能。另一种方法是直接在PowerPCB中装载网表，选择File->Import，将原理图生成的网表输入进来。
2.2 规则设置
如果在原理图设计阶段就已经把PCB的设计规则设置好的话，就不用再进行设置
这些规则了，因为输入网表时，设计规则已随网表输入进PowerPCB了。如果修改了设计规则，必须同步原理图，保证原理图和PCB的一致。除了设计规则和层定义外，还有一些规则需要设置，比如Pad Stacks，需要修改标准过孔的大小。如果设计者新建了一个焊盘或过孔，一定要加上Layer 25。
- g# G# T4 w2 K& M8 k注意：
7 L# X: X! i2 U6 o( [7 P0 u+ E' I) APCB设计规则、层定义、过孔设置、CAM输出设置已经作成缺省启动文件，名称为Default.stp，网表输入进来以后，按照设计的实际情况，把电源网络和地分配给电源层和地层，并设置其它高级规则。在所有的规则都设置好以后，在PowerLogic中，使用OLE PowerPCB Connection的Rules From PCB功能，更新原理图中的规则设置，保证原理图和PCB图的规则一致。
, E: e0 F( R" t) r/ m! V# r( E0 Q
2.3 元器件布局
$ Z! E* i+ j# h网表输入以后，所有的元器件都会放在工作区的零点，重叠在一起，下一步的工作就是把这些元器件分开，按照一些规则摆放整齐，即元器件布局。PowerPCB提供了两种方法，手工布局和自动布局。2.3.1 手工布局
1. 工具印制板的结构尺寸画出板边（Board Outline）。
& l5 A% c' B7 c; S2. 将元器件分散（Disperse Components），元器件会排列在板边的周围。
) a7 z0 v4 m9 s  S3. 把元器件一个一个地移动、旋转，放到板边以内，按照一定的规则摆放整齐。
2.3.2 自动布局
0 n/ n  z: E& d, z* d" ?8 [  PowerPCB提供了自动布局和自动的局部簇布局，但对大多数的设计来说，效果并不理想，不推荐使用。2.3.3 注意事项
; L; Y, w2 o' Ca. 布局的首要原则是保证布线的布通率，移动器件时注意飞线的连接，把有连线关系的器件放在一起
b. 数字器件和模拟器件要分开，尽量远离
% i8 T5 A- G* W( }- ^. m' a8 xc. 去耦电容尽量靠近器件的VCC
1 e# ^. J2 S- ?' Xd. 放置器件时要考虑以后的焊接，不要太密集
e. 多使用软件提供的Array和Union功能，提高布局的效率

2.4 布线
6 U& ]; G- l4 S+ k9 G  布线的方式也有两种，手工布线和自动布线。PowerPCB提供的手工布线功能十分强大，包括自动推挤、在线设计规则检查（DRC），自动布线由Specctra的布线引擎进行，通常这两种方法配合使用，常用的步骤是手工—自动—手工。
2.4.1 手工布线
9 ~- V0 Z* Q8 f, r& @1. 自动布线前，先用手工布一些重要的网络，比如高频时钟、主电源等，这些网络往往对走线距离、线宽、线间距、屏蔽等有特殊的要求；另外一些特殊封装，如BGA，自动布线很难布得有规则，也要用手工布线。
4 M! [0 E. ?0 ?# U+ N: G& f9 {2. 自动布线以后，还要用手工布线对PCB的走线进行调整。
8 \, e3 t( a- R5 V) j7 h( B2.4.2 自动布线
手工布线结束以后，剩下的网络就交给自动布线器来自布。选择Tools->SPECCTRA，启动Specctra布线器的接口，设置好DO文件，按Continue就启动了Specctra布线器自动布线，结束后如果布通率为100%，那么就可以进行手工调整布线了；如果不到100%，说明布局或手工布线有问题，需要调整布局或手工布线，直至全部布通为止。
9 m' g7 V8 Q+ [! M' I
- l- i* K9 b6 @2.4.3 注意事项
a. 电源线和地线尽量加粗
2 s) A5 ^2 K( Pb. 去耦电容尽量与VCC直接连接
c. 设置Specctra的DO文件时，首先添加Protect all wires命令，保护手工布的线不被自动布线器重布
d. 如果有混合电源层，应该将该层定义为Split/mixed Plane，在布线之前将其分割，布完线之后，使用Pour Manager的Plane Connect进行覆铜
e. 将所有的器件管脚设置为热焊盘方式，做法是将Filter设为Pins，选中所有的管脚，修改属性，在Thermal选项前打勾
f. 手动布线时把DRC选项打开，使用动态布线（Dynamic Route）
+ t8 W; A7 C4 k" f$ N
2.5 检查
  检查的项目有间距（Clearance）、连接性（Connectivity）、高速规则（High Speed）和电源层（Plane），这些项目可以选择Tools->Verify Design进行。如果设置了高速规则，必须检查，否则可以跳过这一项。检查出错误，必须修改布局和布线。
5 \5 b+ x# `( K* E, L  y注意：
! f, @% l$ Z2 }7 A, j0 v  有些错误可以忽略，例如有些接插件的Outline的一部分放在了板框外，检查间距时会出错；另外每次修改过走线和过孔之后，都要重新覆铜一次。
2.6 复查
  复查根据“PCB检查表”，内容包括设计规则，层定义、线宽、间距、焊盘、过孔设置；还要重点复查器件布局的合理性，电源、地线网络的走线，高速时钟网络的走线与屏蔽，去耦电容的摆放和连接等。复查不合格，设计者要修改布局和布线，合格之后，复查者和设计者分别签字。

4 a- C6 _* g, |8 G2.7 设计输出
  PCB设计可以输出到打印机或输出光绘文件。打印机可以把PCB分层打印，便于设计者和复查者检查；光绘文件交给制板厂家，生产印制板。光绘文件的输出十分重要，关系到这次设计的成败，下面将着重说明输出光绘文件的注意事项。
- B6 [: `! b0 K# D% p( Na. 需要输出的层有布线层（包括顶层、底层、中间布线层）、电源层（包括VCC层和GND层）、丝印层（包括顶层丝印、底层丝印）、阻焊层（包括顶层阻焊和底层阻焊），另外还要生成钻孔文件（NC Drill）
. Q9 \* T+ c( o7 D+ T: Q* Vb. 如果电源层设置为Split/Mixed，那么在Add Document窗口的Document项选择Routing，并且每次输出光绘文件之前，都要对PCB图使用Pour Manager的Plane Connect进行覆铜；如果设置为CAM Plane，则选择Plane，在设置Layer项的时候，要把Layer25加上，在Layer25层中选择Pads和Viasc. 在设备设置窗口（按Device Setup），将Aperture的值改为199
d. 在设置每层的Layer时，将Board Outline选上
) V0 b4 {4 s4 Ye. 设置丝印层的Layer时，不要选择Part Type，选择顶层（底层）和丝印层的Outline、Text、Line
f. 设置阻焊层的Layer时，选择过孔表示过孔上不加阻焊，不选过孔表示家阻焊，视具体情况确定
! ^; `' Z: K; x/ K" P( l9 gg. 生成钻孔文件时，使用PowerPCB的缺省设置，不要作任何改动
h. 所有光绘文件输出以后，用CAM350打开并打印，由设计者和复查者根据“PCB检查表”检查
$ S( d* S9 U2 m/ d! Y2 c    过孔（via）是多层PCB的重要组成部分之一，钻孔的费用通常占PCB制板费用的30%到40%。简单的说来，PCB上的每一个孔都可以称之为过孔。从作用上看，过孔可以分成两类：一是用作各层间的电气连接；二是用作器件的固定或定位。如果从工艺制程上来说，这些过孔一般又分为三类，即盲孔(blind via)、埋孔(buried via)和通孔(through via)。盲孔位于印刷线路板的顶层和底层表面，具有一定深度，用于表层线路和下面的内层线路的连接，孔的深度通常不超过一定的比率(孔径)。埋孔是指位于印刷线路板内层的连接孔，它不会延伸到线路板的表面。上述两类孔都位于线路板的内层，层压前利用通孔成型工艺完成，在过孔形成过程中可能还会重叠做好几个内层。第三种称为通孔，这种孔穿过整个线路板，可用于实现内部互连或作为元件的安装定位孔。由于通孔在工艺上更易于实现，成本较低，所以绝大部分印刷电路板均使用它，而不用另外两种过孔。以下所说的过孔，没有特殊说明的，均作为通孔考虑。
从设计的角度来看，一个过孔主要由两个部分组成，一是中间的钻孔（drill hole）,二是钻孔周围的焊盘区，见下图。这两部分的尺寸大小决定了过孔的大小。很显然，在高速,高密度的PCB设计时，设计者总是希望过孔越小越好，这样板上可以留有更多的布线空间，此外，过孔越小，其自身的寄生电容也越小，更适合用于高速电路。但孔尺寸的减小同时带来了成本的增加，而且过孔的尺寸不可能无限制的减小，它受到钻孔(drill)和电镀（plating）等工艺技术的限制：孔越小，钻孔需花费的时间越长，也越容易偏离中心位置；且当孔的深度超过钻孔直径的6倍时，就无法保证孔壁能均匀镀铜。比如，现在正常的一块6层PCB板的厚度（通孔深度）为50Mil左右，所以PCB厂家能提供的钻孔直径最小只能达到8Mil。
& q8 [" n9 r  v/ D4 P3 X+ q
1 g; C3 n: w, e) n7 r' |二、过孔的寄生电容
过孔本身存在着对地的寄生电容，如果已知过孔在铺地层上的隔离孔直径为D2,过孔焊盘的直径为D1,PCB板的厚度为T,板基材介电常数为ε,则过孔的寄生电容大小近似于：
C=1.41εTD1/(D2-D1)
过孔的寄生电容会给电路造成的主要影响是延长了信号的上升时间，降低了电路的速度。举例来说，对于一块厚度为50Mil的PCB板，如果使用内径为10Mil，焊盘直径为20Mil的过孔，焊盘与地铺铜区的距离为32Mil,则我们可以通过上面的公式近似算出过孔的寄生电容大致是：C=1.41x4.4x0.050x0.020/(0.032-0.020)=0.517pF，这部分电容引起的上升时间变化量为：T10-90=2.2C(Z0/2)=2.2x0.517x(55/2)=31.28ps 。从这些数值可以看出，尽管单个过孔的寄生电容引起的上升延变缓的效用不是很明显，但是如果走线中多次使用过孔进行层间的切换，设计者还是要慎重考虑的。
( j% X2 m: ]) i( g
; c: S8 C; H  m1 t) S0 S: Y三、过孔的寄生电感
同样，过孔存在寄生电容的同时也存在着寄生电感，在高速数字电路的设计中，过孔的寄生电感带来的危害往往大于寄生电容的影响。它的寄生串联电感会削弱旁路电容的贡献，减弱整个电源系统的滤波效用。我们可以用下面的公式来简单地计算一个过孔近似的寄生电感：
9 _5 X1 w' s& b7 Z* \: D; PL=5.08h[ln(4h/d)+1]其中L指过孔的电感，h是过孔的长度，d是中心钻孔的直径。从式中可以看出，过孔的直径对电感的影响较小，而对电感影响最大的是过孔的长度。仍然采用上面的例子，可以计算出过孔的电感为：L=5.08x0.050[ln(4x0.050/0.010)+1]=1.015nH 。如果信号的上升时间是1ns，那么其等效阻抗大小为：XL=πL/T10-90=3.19Ω。这样的阻抗在有高频电流的通过已经不能够被忽略，特别要注意，旁路电容在连接电源层和地层的时候需要通过两个过孔，这样过孔的寄生电感就会成倍增加。

4 \! t- U8 u. @$ P四、高速PCB中的过孔设计
通过上面对过孔寄生特性的分析，我们可以看到，在高速PCB设计中，看似简单的过
孔往往也会给电路的设计带来很大的负面效应。为了减小过孔的寄生效应带来的不利影响，在设计中可以尽量做到：
' P3 y5 S' B( x6 K: w; J9 `3 h1、从成本和信号质量两方面考虑，选择合理尺寸的过孔大小。比如对6-10层的内
  [1 |# e  c/ x% g' y% y存模块PCB设计来说，选用10/20Mil（钻孔/焊盘）的过孔较好，对于一些高密度的小尺寸的板子，也可以尝试使用8/18Mil的过孔。目前技术条件下，很难使用更小尺寸的过孔了。对于电源或地线的过孔则可以考虑使用较大尺寸，以减小阻抗。
2、上面讨论的两个公式可以得出，使用较薄的PCB板有利于减小过孔的两种寄
生参数。
3、PCB板上的信号走线尽量不换层，也就是说尽量不要使用不必要的过孔。
4、电源和地的管脚要就近打过孔，过孔和管脚之间的引线越短越好，因为它们会
' o! S9 E+ S7 X4 w导致电感的增加。同时电源和地的引线要尽可能粗，以减少阻抗。
2 y/ P" A/ C+ C3 a; C: ?- M5、在信号换层的过孔附近放置一些接地的过孔，以便为信号提供最近的回路。甚至可以在PCB板上大量放置一些多余的接地过孔。当然，在设计时还需要灵活多变。前面讨论的过孔模型是每层均有焊盘的情况，也有的时候，我们可以将某些层的焊盘减小甚至去掉。特别是在过孔密度非常大的情况下，可能会导致在铺铜层形成一个隔断回路的断槽，解决这样的问题除了移动过孔的位置，我们还可以考虑将过孔在该铺铜层的焊盘尺寸减小。
, I% g* P. d0 S2 S; m1 ?3 e6 s

问：从WORD文件中拷贝出来的符号，为什么不能够在PROTEL中正常显示
复：请问你是在SCH环境,还是在PCB环境,在PCB环境是有一些特殊字符不能显示,因为那时保留字.

问：net名与port同名，pcb中可否连接
答复：可以,PROTEL可以多种方式生成网络,当你在在层次图中以port-port时,每张线路图可以用相同的NET名,它们不会因网络名是一样而连接.但请不要使用电源端口,因为那是全局的.
' f6 j# z0 P! f
6 l4 W6 u+ B! `* H3 A1 Y1 u* [) K问：:请问在PROTEL99SE中导入PADS文件， 为何焊盘属性改了
复：这多是因为两种软件和每种版本之间的差异造成，通常做一下手工体调整就可以了。

问：请问杨大虾：为何通过软件把power logic的原理图转化成protel后，在protel中无法进行属性修改，只要一修改，要不不现实，要不就是全显示属性？谢谢！
复：如全显示，可以做一个全局性编辑，只显示希望的部分。
8 I! }* k& w0 e* j( d% F
' n( q& ?# O; a9 K- g问：请教铺銅的原则？
5 r  ^/ }9 ~& D% h1 V+ o复：铺銅一般应该在你的安全间距的2倍以上.这是LAYOUT的常规知识.

问：请问Potel DXP在自动布局方面有无改进?导入封装时能否根据原理图的布局自动排开?
6 |& `5 J; |- l5 W复：PCB布局与原理图布局没有一定的内在必然联系，故此，Potel DXP在自动布局时不会根据原理图的布局自动排开。（根据子图建立的元件类，可以帮助PCB布局依据原理图的连接）。
+ }5 e. E3 W' |) A2 r6 O& Q
问：请问信号完整性分析的资料在什么地方购买
复：Protel软件配有详细的信号完整性分析手册。
' _" ~: i- j9 n$ o. ~) g/ i
1 S0 m/ t1 U( X问：为何铺铜，文件哪么大？有何方法？
复：铺铜数据量大可以理解。但如果是过大，可能是您的设置不太科学。
3 ?& l& O: s6 h, I+ n) Y
问：有什么办法让原理图的图形符号可以缩放吗？
2 l3 m  N1 m* Q: E复：不可以。

问：PROTEL仿真可进行原理性论证，如有详细模型可以得到好的结果
% r! ?# M% [- J, N1 Y1 g7 k复：PROTEL仿真完全兼容Spice模型，可以从器件厂商处获得免费Spice模型，进行仿真。PROTEL也提供建模方法，具有专业仿真知识，可建立有效的模型。
) r. t, H7 Z/ k; z( g
问：99SE中如何加入汉字，如果汉化后好象少了不少东西！  3-28 14:17:0 但确实少了不少功能！
复：可能是汉化的版本不对。

问：如何制作一个孔为2*4MM   外径为6MM的焊盘?
3 H6 f! C+ _- n* X复：在机械层标注方孔尺寸。与制版商沟通具体要求。
7 S8 s8 E6 ]# {" O# T9 K" D
问：我知道，但是在内电层如何把电源和地与内电层连接。没有网络表，如果有网络表就没有问题了
! |0 |4 U) C" X) L- c+ N复：利用from-to类生成网络连接
* |% c' M/ I0 K& v, R) @$ {
问：还想请教一下99se中椭圆型焊盘如何制作？放置连续焊盘的方法不可取，线路板厂家不乐意。可否在下一版中加入这个设置项？
复：在建库元件时，可以利用非焊盘的图素形成所要的焊盘形状。在进行PCB设计时使其具有相同网络属性。我们可以向Protel公司建议。

* r, N; C: q  h: U* k; r问：如何免费获取以前的原理图库和pcb库
复：那你可以的WWW.PROTEL.COM下载

  y: F% E! Y  m. f1 _1 D问：刚才本人提了个在覆铜上如何写上空心(不覆铜)的文字,专家回答先写字,再覆铜,然后册除字,可是本人试了一下,删除字后,空的没有,被覆铜 覆盖了,请问专家是否搞错了,你能不能试一下
4 I+ S5 V- n4 F6 T! e' Q复：字必须用PROTEL99SE提供的放置中文的办法，然后将中文（英文）字解除元件，（因为那是一个元件）将安全间距设置成1MIL，再覆铜，然后移动覆铜，程序会询问是否重新覆铜，回答NO。

问：画原理图时，如何元件的引脚次序？
8 y7 e9 \5 ^8 T% Q复：原理图建库时，有强大的检查功能，可以检查序号，重复，缺漏等。也可以使用阵列排放的功能，一次性放置规律性的引脚。

问：protel99se6自动布线后，在集成块的引脚附近会出现杂乱的走线，像毛刺一般，有时甚至是三角形的走线，需要进行大量手工修正，这种问题怎么避免？
& O: O  B( ?# M: t0 @; V7 h复：合理设置元件网格，再次优化走线。
  s% @! L; F. u" W9 O; [' j
问：用PROTEL画图，反复修改后，发现文件体积非常大（虚肿），导出后再导入就小了许多。为什么？？有其他办法为文件瘦身吗？
复：其实那时因为PROTEL的铺铜是线条组成的原因造成的，因知识产权问题，不能使用PADS里的“灌水”功能，但它有它的好处，就是可以自动删除“死铜”。致与文件大，你用WINZIP压缩一下就很小。不会影响你的文件发送。

问：请问：在同一条导线上，怎样让它不同部分宽度不一样，而且显得连续美观？谢谢！
, T% V% U1 x/ s复：不能自动完成，可以利用编辑技巧实现。
( `' z! U  n! `" A7 A
liaohm问：如何将一段圆弧进行几等分？
fanglin163答复：利用常规的几何知识嘛。EDA只是工具。

# p  z" Y/ o& k! D5 ?问：protel里用的HDL是普通的VHDL
复：Protel PLD不是，Protel FPGA是。
  [$ |) I+ s$ E" K$ w2 J, ]
8 G6 p8 {4 c/ I4 ~问：补泪滴后再铺铜，有时铺出来的网格会残缺，怎么办？
复：那是因为你在补泪滴时设置了热隔离带原因，你只需要注意安全间距与热隔离带方式。也可以用修补的办法。

问：可不可以做不对称焊盘？拖动布线时相连的线保持原来的角度一起拖动？
复：可以做不对称焊盘。拖动布线时相连的线不能直接保持原来的角度一起拖动。
6 i( Z' Q! s, [/ I7 P
$ j" F8 T( I0 O+ ]* I% w6 Y6 U4 i问：请问当Protel发挥到及至时，是否能达到高端EDA软件同样的效果
复：视设计而定。

问：Protel DXP的自动布线效果是否可以达到原ACCEL的水平？
复：有过之而无不及。

+ e9 L8 R. q7 a* j: E% b问：protel的pld功能好象不支持流行的HDL语言？
! H+ f9 y% e8 i2 x' L. j复：Protel PLD使用的Cupl语言，也是一种HDL语言。下一版本可以直接用VHDL语言输入。

# D- Q; i5 E/ C3 c/ H. E* w( n问：PCB里面的3D功能对硬件有何要求？
: O/ m, h6 |$ k# W' v& j& Q4 ]/ E复：需要支持OpenGL.
5 l  |4 H5 ]6 _& Y3 l& o
问：如何将一块实物硬制版的布线快速、原封不动地做到电脑之中？
5 }  ?* ?( `. p1 k2 w' ~) P- c复：最快的办法就是扫描，然后用BMP2PCB程序转换成胶片文件，然后再修改，但你的PCB精度必须在0.2MM以上。BMP2PCB程序可在21IC上下载，你的线路板必须用沙纸打的非常光亮才能成功。
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问：直接画PCB板时，如何为一个电路接点定义网络名？
1 Q+ l- {% ?* v! w* `复：在Net编辑对话框中设置。
$ k) b/ c( K$ z, k1 P
' U( u$ ~+ X7 {1 E' W4 U" Q9 d( g, d问：怎么让做的资料中有孔径显示或符号标志，同allego一样
6 e8 |7 E5 ~$ x* y复：在输出中有选项，可以产生钻孔统计及各种孔径符号。

问：自动布线的锁定功能不好用，系统有的会重布，不知道怎么回事？
9 X2 t3 v) ~- k8 k/ @4 ]0 x复：最新的版本无此类问题。

问：如何实现多个原器件的整体翻转
! h% t7 Y$ W- m- U  s3 w  g8 D复：一次选中所要翻转的元件。

问：我用的p 99 版加入汉字就死机,是什么原因?
复：应是D版所致。
" V. T& I- B1 x: `
问：powpcb的文件怎样用PROTEL打开？
  O, U: s# F) `: X6 w' K复：先新建一PCB文件，然后使用导入功能达到。
) ~! @* i; U2 l& d7 ]7 u
问：怎样从PROTEL99中导入GERBER文件
1 {0 Y8 W* G. {2 |% u* k复：Protel pcb只能导入自己的Gerber,而Protel的CAM可以导入其它格式的Gerber.

问：如何把布好PCB走线的细线条部分地改为粗线条
复：双击修改+全局编辑。注意匹配条件。修改规则使之适应新线宽。
5 c+ F9 P" m% Y9 j# [
; q; \9 y' I- n4 |/ j7 i' g问：如何修改一个集成电路封装内的焊盘尺寸?  若全局修改的话应如何设置?
复：全部选定，进行全局编辑

问：如何修改一个集成电路封装内的焊盘尺寸?
复：在库中修改一个集成电路封装内的焊盘尺寸大家都知道，在PCB板上也可以修改。（先在元件属性中解锁）。
6 a4 `+ R) d! y5 q
5 F" \7 y" Y& [3 T/ ]$ [2 b问：能否在做PCB时对元件符号的某些部分加以修改或删除？
复：在元件属性中去掉元件锁定，就可在PCB中编辑元件，并且不会影响库中元件。

2 I6 }' D: g: x4 R8 _问：该焊盘为地线，包地之后，该焊盘与地所连线如何设置宽度
% r' \" J/ l% G复：包地前设置与焊盘的连接方式

% O0 \' C+ F0 T  x问：为何99se存储时要改为工程项目的格式？
' \4 q" Q+ f2 `: b复：便于文件管理。
( L2 c; A+ D1 B% g
' J* C" @4 C+ r6 r问：如何去掉PCB上元件的如电阻阻值，电容大小等等，要一个个去掉吗，有没有快捷方法
复：使用全局编辑，同一层全部隐藏

, f& l9 b3 d7 z/ v& F+ v: E问：能告诉将要推出的新版本的PROTEL的名称吗？简单介绍一下有哪些新功能？protel手动布线的推挤能力太弱！
; _& m- o$ b( {7 Q9 f2 }复：Protel DXP，在仿真和布线方面会有大的提高。

+ n+ T( C8 j* I/ u! |3 E7 f问：如何把敷铜区中的分离的小块敷铜除去
4 ]! f0 E* x3 g" }复：在敷铜时选择＂去除死铜＂
3 _5 p% G( X7 w/ @# W/ V1 \
( f' g8 a  ^9 H问：VDD和GND都用焊盘连到哪儿了，怎么看不到呀
复：打开网络标号显示。

1 T" \* r% s2 N/ f问：在PCB中有画弧线? 在画完直线,接着直接可以画弧线具体如DOS版弧线模式那样!能实现吗?能的话,如何设置?
复：可以，使用shift+空格可以切换布线形式

: _9 \/ o* |1 L( r' p1 i1 o问：protel99se9层次图的总图用edit\export spread生成电子表格的时候，却没有生成各分图纸里面的元件及对应标号、封装等。如果想用电子表格的方式一次性修改全部图纸的封装，再更新原理图，该怎么作？
复：点中相应的选项即可。

问：protel99se6的PCB通过specctra interface导出到specctra10.1里面，发现那些没有网络标号的焊盘都不见了，结果specctra就从那些实际有焊盘的地方走线，布得一塌糊涂，这种情况如何避免？
复：凡涉及到两种软件的导入/导出，多数需要人工做一些调整。

问：在打开内电层时，放置元件和过孔等时，好像和内电层短接在一起了，是否正确
" M& ?7 j" p; W2 F复：内电层显示出的效果与实际的缚铜效果相反，所以是正确的

问：protel的执行速度太慢，太耗内存了，这是为什么？而如allegro那么大的系统，执行起来却很流畅！
: }- H8 P* n7 L" y2 _# y复：最新的Protel软件已不是完成一个简单的PCB设计，而是系统设计，包括文件管理、3D分析等。只要PIII,128M以上内存，Protel亦可运行如飞。
% ^5 k7 Y, \) @5 ?, a$ |; X
5 K9 b+ C% d( T0 c问：如何自动布线中加盲，埋孔？
复：设置自动布线规则时允许添加盲孔和埋孔

问：3D的功能对硬件有什么要求？谢谢，我的好象不行
( F: T* y7 N9 k6 Y5 ?复：请把金山词霸关掉

1 H/ R" o5 Z! D" p! a问：补泪滴可以一个一个加吗？
/ j5 _/ @2 ~2 Z, h复：当然可以
4 M# J: p  g: z
问：请问在PROTEL99SE中倒入PADS文件， 为何焊盘属性改了，
( o) U5 [# s5 z复：这类问题，一般都需要手工做调整，如修改属性等。
1 t2 t  j# H  \5 J
问：protell99se能否打开orcad格式的档案，如不能以后是否会考虑添加这一功能？
复：现在可以打开。
. d+ b# U# B' n
5 {1 T( i8 z% F8 @+ j+ ^问：在99SEPCB板中加入汉字没发加，但汉化后SE少了不少东西！
复：可能是安装的文件与配置不正确。
4 G: m* d) `% z& ?
* ?9 E$ E! w$ ?& u, ]4 l. o2 d( i问：SE在菜单汉化后，在哪儿启动3D功能？
$ c$ w1 y' t% N3 }1 w$ E; V复：您说的是View3D接口吗，请在系统菜单（左边大箭头下）启动。
  @7 N  z) p( f6 w  {3 Y
& D1 }/ _- e  A0 h' u- X' w问：请问如何画内孔不是圆形的焊盘？？？
复：不行。

问：在PCB中有几种走线模式?我的计算机只有两种,通过空格来切换
复：Shift＋空格

问：请问：对于某些可能有较大电流的线，如果我希望线上不涂绿油，以便我在其上上锡，以增大电流。我该怎么设计？谢谢！
复：可以简单地在阻焊层放置您想要的上锡的形状。

" {7 v/ |6 v! H% J7 z, ?问：如何连续画弧线,用画园的方法每个弯画个园吗?
复：不用，直接用圆弧画。

9 Y- y" U& V& w6 w# a% r3 S0 c3 N问：如何锁定一条布线？
复：先选中这个网络，然后在属性里改。
3 {( ~2 p) }+ G1 U. L
2 ?2 U& l- _+ e: \& P0 t8 S4 z问：随着每次修改的次数越来越多，protel文件也越来越大，请问怎么可以让他文件尺寸变小呢？
复：在系统菜单中有数据库工具。（Fiel菜单左边的大箭头下）。
1 x8 x# p! A1 n. C
wangjinfeng问：请问PROTEL中画PCB板如何设置采用总线方式布线？
1 M4 o( }8 C. y* Z0 n高英凯答复：Shift＋空格。

问：如何利用protel的PLD功能编写GAL16V8程序？
复：利用protel的PLD功能编写GAL16V8程序比较简单，直接使用Cupl DHL硬件描述语言就可以编程了。帮助里有实例。Step by step.

问：我用99se6布一块4层板子，布了一个小时又二十分钟布到99.6％，但再过来11小时多以后却只布到99.9％！不得已让它停止了
* T: y' q3 l1 [6 t5 d/ M5 @复：对剩下的几个Net，做一下手工预布，剩下的再自动，可达到100％的布通。
& Z) [, w' ~: v% R2 x
问：在pcb多层电路板设计中，如何设置内电层？前提是完全手工布局和布线。
复：有专门的菜单设置。

% o4 q. P2 U9 g# n+ Z问：protel PCB图可否输出其它文件格式,如HyperLynx的?  它的帮助文件中说可以,但是在菜单中却没有这个选项
  p+ {0 {1 ]: V! j复：现在Protel自带有PCB信号分析功能。
8 x; j- g' {  _# C
问：请问pcb里不同的net,最后怎么让他们连在一起？
复：最好不要这么做，应该先改原理图，按规矩来，别人接手容易些。
% n; b  I% q0 {. C" E( j
& K5 R+ y3 G3 l" w问：自动布线前如何把先布的线锁定？？一个一个选么？
" ]3 p4 D) ^$ Q9 \5 K$ m复：99SE中的锁定预布线功能很好，不用一个一个地选，只要在自动布线设置中点一个勾就可以了。

2 K( w  `4 |& ~' z# t$ ?8 G1 Z  Z问：PSPICE的功能有没有改变
" A2 F: {& I3 ]+ Q, n) E+ s复：在Protel即将推出的新版本中，仿真功能会有大的提升。
  d' a7 z! x+ h% @3 a3 U# X& P
3 B9 F2 |+ i& d8 n; G2 g( L% Y问：如何使用Protel 99se的PLD仿真功能？
4 u: i' D+ L- ]! H复：首先要有仿真输入文件(.si)，其次在configure中要选择Absolute ABS选项，编译成功后，可仿真。看仿真输出文件。

问：protel.ddb历史记录如和删
复：先删除至回收战，然后清空回收站。
3 `2 y3 h: |6 X, H( u! c/ X3 Y
问：自动布线为什么会修改事先已布的线而且把它们认为没有布过重新布了而设置我也正确了?
复：把先布的线锁定。应该就可以了。
" A' v9 R! B" z- a8 [
$ c. K; `# X6 ~9 Q# k, R1 h问：布线后有的线在视觉上明显太差，PROTEL这样布线有他的道理吗（电气上）
复：仅仅通过自动布线，任何一个布线器的结果都不会太美观。

& K- N% z7 K# V" Z/ G0 M7 P4 C! @问：可以在焊盘属性中修改焊盘的X和Y的尺寸
) E! q# K- x5 N% h: C复：可以。
0 m* i; p5 j5 t2 `% @7 k, Q
问：protel99se后有没推出新的版本？
0 F" A7 B1 {0 A5 L复：即将推出。该版本耗时2年多，无论在功能、规模上都与Protel99SE,有极大的飞跃。

- C* g/ k: o4 }% d, ]: _问：99se的3d功能能更增进些吗？好像只能从正面看！其外形能自己做吗？
复：3D图形可以用  Ctrl   +   上，下，左，右 键翻转一定的角度。不过用处不大，显卡要好才行。
6 N# G; t6 ~1 _/ ^
问：有没有设方孔的好办法？除了在机械层上画。
8 H* n4 ]  y- b/ \+ w! u复：可以，在Multi Layer上设置。

0 E7 f. y0 D8 |' j# j" K- a问：一个问题:填充时,假设布线规则中间距为20mil,但我有些器件要求100mil间距,怎样才能自动填充?
+ S4 Y/ t% `& `7 m2 T& ?% F复：可以在design-->rules-->clearance constraint里加
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问：在protel中能否用orcad原理图
% n/ [: z/ L* K复：需要将orcad原理图生成protel支持的网表文件,再由protel打开即可.

问：请问多层电路板是否可以用自动布线
复：可以的，跟双面板一样的，设置好就行了。

一、印刷线路元件布局结构设计讨论
" p8 e" i; _! x- I
　　一台性能优良的仪器，除选择高质量的元器件，合理的电路外，印刷线路板的元件布局和电气连线方向的正确结构设计是决定仪器能否可靠工作的一个关键问题，对同一种元件和参数的电路，由于元件布局设计和电气连线方向的不同会产生不同的结果，其结果可能存在很大的差异。因而，必须把如何正确设计印刷线路板元件布局的结构和正确选择布线方向及整体仪器的工艺结构三方面联合起来考虑，合理的工艺结构，既可消除因布线不当而产生的噪声干扰，同时便于生产中的安装、调试与检修等。

: [6 P" A! y4 X) D9 `3 k　　下面我们针对上述问题进行讨论，由于优良“结构”没有一个严格的“定义”和“模式”，因而下面讨论，只起抛砖引玉的作用，仅供参考。每一种仪器的结构必须根据具体要求（电气性能、整机结构安装及面板布局等要求），采取相应的结构设计方案，并对几种可行设计方案进行比较和反复修改。印刷板电源、地总线的布线结构选择----系统结构：模拟电路和数字电路在元件布局图的设计和布线方法上有许多相同和不同之处。模拟电路中，由于放大器的存在，由布线产生的极小噪声电压，都会引起输出信号的严重失真，在数字电路中，TTL噪声容限为0.4V～0.6V,CMOS噪声容限为Vcc的0.3～0.45倍,故数字电路具有较强的抗干扰的能力。良好的电源和地总线方式的合理选择是仪器可靠工作的重要保证，相当多的干扰源是通过电源和地总线产生的，其中地线引起的噪声干扰最大。

, e$ I6 N: ~9 a) m　　二、印刷电路板图设计的基本原则要求
　　１．印刷电路板的设计，从确定板的尺寸大小开始，印刷电路板的尺寸因受机箱外壳大小限制，以能恰好安放入外壳内为宜，其次，应考虑印刷电路板与外接元器件（主要是电位器、插口或另外印刷电路板）的连接方式。印刷电路板与外接元件一般是通过塑料导线或金属隔离线进行连接。但有时也设计成插座形式。即：在设备内安装一个插入式印刷电路板要留出充当插口的接触位置。对于安装在印刷电路板上的较大的元件，要加金属附件固定，以提高耐振、耐冲击性能。
　　２．布线图设计的基本方法
- T( O- ]/ C1 Y8 J　　首先需要对所选用元件器及各种插座的规格、尺寸、面积等有完全的了解；对各部件的位置安排作合理的、仔细的考虑，主要是从电磁场兼容性、抗干扰的角度，走线短，交叉少，电源，地的路径及去耦等方面考虑。各部件位置定出后，就是各部件的连线，按照电路图连接有关引脚，完成的方法有多种，印刷线路图的设计有计算机辅助设计与手工设计方法两种。
) k6 P! Q4 Y4 E' ]! o0 Y* P3 b　　最原始的是手工排列布图。这比较费事，往往要反复几次，才能最后完成，这在没有其它绘图设备时也可以，这种手工排列布图方法对刚学习印刷板图设计者来说也是很有帮助的。计算机辅助制图，现在有多种绘图软件，功能各异，但总的说来，绘制、修改较方便，并且可以存盘贮存和打印。
5 U! N2 y& S) @4 A0 K　　接着，确定印刷电路板所需的尺寸，并按原理图，将各个元器件位置初步确定下来，然后经过不断调整使布局更加合理，印刷电路板中各元件之间的接线安排方式如下：
" L1 y* ^3 ]; V/ l　　（１）印刷电路中不允许有交叉电路，对于可能交叉的线条，可以用“钻”、“绕”两种办法解决。即，让某引线从别的电阻、电容、三极管脚下的空隙处“钻”过去，或从可能交叉的某条引线的一端“绕”过去，在特殊情况下如何电路很复杂，为简化设计也允许用导线跨接，解决交叉电路问题。
* u) D; q, ~/ C- s3 P　　（２）电阻、二极管、管状电容器等元件有“立式”，“卧式”两种安装方式。立式指的是元件体垂直于电路板安装、焊接，其优点是节省空间，卧式指的是元件体平行并紧贴于电路板安装，焊接，其优点是元件安装的机械强度较好。这两种不同的安装元件，印刷电路板上的元件孔距是不一样的。
　　（３）同一级电路的接地点应尽量靠近，并且本级电路的电源滤波电容也应接在该级接地点上。特别是本级晶体管基极、发射极的接地点不能离得太远，否则因两个接地点间的铜箔太长会引起干扰与自激，采用这样“一点接地法”的电路，工作较稳定，不易自激。
　　（４）总地线必须严格按高频－中频－低频一级级地按弱电到强电的顺序排列原则，切不可随便翻来复去乱接，级与级间宁肯可接线长点，也要遵守这一规定。特别是变频头、再生头、调频头的接地线安排要求更为严格，如有不当就会产生自激以致无法工作。调频头等高频电路常采用大面积包围式地线，以保证有良好的屏蔽效果。
　　（５）强电流引线（公共地线，功放电源引线等）应尽可能宽些，以降低布线电阻及其电压降，可减小寄生耦合而产生的自激。
　　（６）阻抗高的走线尽量短，阻抗低的走线可长一些，因为阻抗高的走线容易发笛和吸收信号，引起电路不稳定。电源线、地线、无反馈元件的基极走线、发射极引线等均属低阻抗走线，射极跟随器的基极走线、收录机两个声道的地线必须分开，各自成一路，一直到功效末端再合起来，如两路地线连来连去，极易产生串音，使分离度下降。

/ W# @- I' B3 {- o5 l　　三、印刷板图设计中应注意下列几点
　　１．布线方向：从焊接面看，元件的排列方位尽可能保持与原理图相一致，布线方向最好与电路图走线方向相一致，因生产过程中通常需要在焊接面进行各种参数的检测，故这样做便于生产中的检查，调试及检修（注：指在满足电路性能及整机安装与面板布局要求的前提下）。
　　２．各元件排列，分布要合理和均匀，力求整齐，美观，结构严谨的工艺要求。
9 k5 C; l& F" i  G: X/ ~- r　　３．电阻，二极管的放置方式：分为平放与竖放两种：
　　（１）平放：当电路元件数量不多，而且电路板尺寸较大的情况下，一般是采用平放较好；对于1/4W以下的电阻平放时,两个焊盘间的距离一般取4/10英寸，1/2W的电阻平放时,两焊盘的间距一般取5/10英寸；二极管平放时，1N400X系列整流管,一般取3/10英寸;1N540X系列整流管,一般取4～5/10英寸。
0 t" |& v4 W" v0 T: ]% K　　（２）竖放：当电路元件数较多，而且电路板尺寸不大的情况下，一般是采用竖放，竖放时两个焊盘的间距一般取1～2/10英寸。
　　４．电位器：IC座的放置原则
　　（１）电位器：在稳压器中用来调节输出电压，故设计电位器应满中顺时针调节时输出电压升高，反时针调节器节时输出电压降低；在可调恒流充电器中电位器用来调节充电电流折大小，设计电位器时应满中顺时针调节时，电流增大。电位器安放位轩应当满中整机结构安装及面板布局的要求，因此应尽可能放轩在板的边缘，旋转柄朝外。
* H+ A# K7 |: i# E) s0 _' J' ~$ m" ^　　（２）IC座：设计印刷板图时，在使用IC座的场合下，一定要特别注意IC座上定位槽放置的方位是否正确，并注意各个IC脚位是否正确，例如第1脚只能位于IC座的右下角线或者左上角，而且紧靠定位槽（从焊接面看）。
　　５．进出接线端布置
　　（１）相关联的两引线端不要距离太大，一般为2～3/10英寸左右较合适。
　　（２）进出线端尽可能集中在1至2个侧面，不要太过离散。
/ f: @( B. h5 m; [$ }9 m/ ~　　６．设计布线图时要注意管脚排列顺序，元件脚间距要合理。
　　７．在保证电路性能要求的前提下，设计时应力求走线合理，少用外接跨线，并按一定顺充要求走线，力求直观，便于安装，高度和检修。
$ T# B* h$ A7 U. J; W8 U　　８．设计布线图时走线尽量少拐弯，力求线条简单明了。
　　９．布线条宽窄和线条间距要适中，电容器两焊盘间距应尽可能与电容引线脚的间距相符；
　　１０．设计应按一定顺序方向进行，例如可以由左往右和由上而下的顺序进行

shenzhou8hao1

这也太长了，搞个附件多好

yugioh

真是好东西啊，多谢楼主了。

liaph

thands  

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shasha248

路过就顶一下,感谢楼主分享!

xdlifu

看看

失败男

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reflecter

Jimmy是个好Jimmy的

lqr1982

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fallswan

谢楼主分享！

lm7373

看看

rosexg

怎么没看到附件呀

kaiziyjl

路过，

ander19851128

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