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[HyperLynx] S3C2440 用HyperLynx仿真问题求助!

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发表于 2009-3-31 17:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我看他们做开发板的,数据线和地址线上都没有端接电阻做阻抗匹配!可小弟用HyperLynx做S3C2440 到 SDRAM 133M 频率的仿真时,在没加电阻的情况下,却不行啊~~~~~
* W( ]; l5 {' [/ w* Z9 u% O! m
. G2 [, N( e" L) [
/ \, Q% ^4 b5 s% D% a
  @  p) Z+ [6 t" [" { ' U6 U6 j" R' k) c% |

! P3 w9 C( H  X) t8 I* Y! G, }0 _( A
8 n8 i% }& d; t3 z0 @6 C1 [" p不知道为什么?
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发表于 2014-5-27 11:31 | 只看该作者
楼主,模型可否发一下,学习学习!649102837@qq.com

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发表于 2014-5-15 13:22 | 只看该作者
可以贴个S3C2440 IBIS模型吗" v8 }* i' J. }8 s9 f

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发表于 2009-4-1 09:38 | 只看该作者
所谓的端接匹配,可以在板子上实现,也有部分是可以on the die termination的
sagarmatha

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 楼主| 发表于 2009-4-8 08:22 | 只看该作者
呵呵,还是有点不明白。主要是看了SMDK2440的原理图地址线都加了端接电阻,而很多开发板子上都是没有的。: W" ]- a- l$ j+ [$ t+ U2 t: Z
. m. j/ s! C! L( i% K' y
所以在取舍,但不知道依据是什么,也不知道是不是自己仿真的有问题?' \+ j% G3 C0 @2 i3 h

  c% p3 `( }2 S0 U4 n2 K期待有兄弟帮忙解惑一下~~~~~
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发表于 2009-4-9 13:29 | 只看该作者
端接电阻的呈现形式3 f5 N6 K  L' C9 z
1.在PCB板级呈现,可以在板子上看到端接电阻。
! o. t* A7 J; }' }, V2.端接电阻集成在了芯片内部,板子上是看不到的。
3 x8 a# \7 g  A9 t' {" x( D5 X" K2 |( y
9 W% T' K+ X1 k; D3 h当然,如果板子信号质量是可以接受的那么就不用添加端接电阻
sagarmatha

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发表于 2009-4-9 14:10 | 只看该作者
端接电阻的呈现形式% _4 y, B& E# ^1 r! f8 \8 W) d
1.在PCB板级呈现,可以在板子上看到端接电阻。7 t! `7 U  p! e
2.端接电阻集成在了芯片内部,板子上是看不到的。
" R5 I  v3 k8 _. j7 N5 L# S! D& y* q* @5 l! i9 N* `& @" m$ y
当然,如果板子信号质量是可以接受的那么就不用添加端接电阻
sagarmatha

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发表于 2009-5-30 22:47 | 只看该作者
为方便调试还是加上吧

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发表于 2009-5-31 16:27 | 只看该作者
加串联端接的目的是为了消除信号的源端反射,原则是:驱动器的输出阻抗+端接电阻=线路阻抗(即PCB走线阻抗)。楼主可以看看PCB走线阻抗是否满足?

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发表于 2009-5-31 19:32 | 只看该作者
请问楼主的HyperLynx软件是在那里找到的

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发表于 2009-8-28 15:20 | 只看该作者
请问2楼一个问题,on the die termination是不是DDR2和DDR3才有的?普通的SDRAM没有吧

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发表于 2010-3-11 15:02 | 只看该作者
楼主我用的是2410,仿真时也遇到和你一样的问题呀,一直在纠结呢
Long long way to go!

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发表于 2010-4-4 16:38 | 只看该作者
学习了

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发表于 2010-4-27 15:48 | 只看该作者
学习学习

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发表于 2010-4-27 21:47 | 只看该作者
1. 若連源端接電阻都要省,可能途徑是再把 Microstrip 的特性阻抗再設計低一點 (30 ~ 40 Ohm),然後把Trace 再走短一點,看有沒有改善。
% v& n5 f$ f2 z; G5 V# j  K+ N( v' m
# b5 k: G4 k' v4 _, Z2. SDRAM 是沒有 ODT 的。

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发表于 2010-5-13 21:35 | 只看该作者
我也在做S3C2440的板子,有时间讨论一下,

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发表于 2010-5-13 21:38 | 只看该作者
可以加我,QQ:195517713
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