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DDR高频电路怎么样控制EMC,EMI呢 ?

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发表于 2009-3-27 08:39 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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DDR高频电路怎么样控制EMC,EMI呢 ?走线规则是什么?那些需要走差分先,那些需要走等长线的呢?
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发表于 2013-12-31 17:25 | 只看该作者
shiningstars 发表于 2009-3-27 09:50
8 n( l$ e  ?: f3 G- X0 Q# ?这个很关键,我一个同事最近就被DDR的EMI搞死掉了,120M主频,480M超标,走线都是等长线,而且时钟都是包地 ...

/ o- G! x9 G5 {2 ?上屏蔽罩

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发表于 2015-3-13 13:50 | 只看该作者
当原理图和layout都基本没有设计缺陷的时候,也许可以看看是不是 CPU内软件设置出了问题.这也是一大隐患.

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发表于 2014-3-28 10:56 | 只看该作者
这方面还欠缺  还得好好跟大家学习

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发表于 2009-3-27 09:50 | 只看该作者
这个很关键,我一个同事最近就被DDR的EMI搞死掉了,120M主频,480M超标,走线都是等长线,而且时钟都是包地(当然地线上打了很多孔),想了很多办法都搞不定,目前怀疑是阻抗匹配出了问题!其他高手还有什么招,救救他吧!!
把爱情交给时间,一切会不了了之!

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发表于 2009-4-1 15:49 | 只看该作者
如果能确定是DDR的问题话,首先要确定是不是,比如DDR降频,看EMI的谐波是否还是跟DDR的频率吻合。
* F, a% g& r5 {如果确定话,也可能不能确定。- s4 G4 u& V: W% s* n$ U
DDR如果出现EMI的话,叫无规则EMI,就是总线EMI,频点复杂不好处理。不过比较简单的方法,就是看信号的过冲是否很大,过冲大,含有的谐波能量就大,容易产生辐射。最好信号线上串有电阻,用来抑制。如果上拉到VTT电源,VTT电源在pin处也需要下拉电容1nF.如果能给出一些测试信息大家可以帮你看看!

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发表于 2009-9-8 18:42 | 只看该作者
用機構解

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发表于 2009-9-9 16:10 | 只看该作者
单单需要注意是没有用的,要看实际设计才能讲清楚
7 v# b8 z( A' k( b# i, B6 Y  e4 T% }+ G我看过DDR2的布线中竟然有几条数据线线宽从0.075变到0.1MM5 O+ f. |& A; c6 T& {- x
数据线为了等长绕了个弯(非蛇形布线)0 h" \4 D1 s4 c0 M' c
什么九七十八弯的走法都有
! S# ?& r. Z* _最厉害的竟然是这板子过了FCC的EMC1 [6 M' \5 z* q
我吐血了
Work as an engineer!!!

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发表于 2009-9-18 10:21 | 只看该作者
单单需要注意是没有用的,要看实际设计才能讲清楚/ @# j3 a8 I( u3 Z" F
我看过DDR2的布线中竟然有几条数据线线宽从0.075变到0.1MM. P" D3 e9 j) f+ V# {
数据线为了等长绕了个弯(非蛇形布线)
$ p9 T# ]1 p8 N4 {* ^) D, G4 [2 v什么九七十八弯的走法都有
7 Y0 U0 x  U* I最厉害的竟然是这板子过了FCC的EMC ...
' u5 K( ?, ^6 A9 Bevatan 发表于 2009-9-9 16:10

! o. D0 v) y- k0 C7 ?4 h这个很正常,特别是一些工控板的DDR都是这样布的

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发表于 2009-10-14 21:06 | 只看该作者
怎么不发一点东东上来看一下呢!那样才明白多了!

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发表于 2009-12-23 20:34 | 只看该作者
测试一下信号是否有串扰、过冲...
毛主席要求“原子弹要有,氢弹也要快”。

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发表于 2009-12-23 20:54 | 只看该作者
注意總線阻抗匹配。; |& T. l* r" T3 X" C2 R. d: ~8 Y( ?
注意電源走線及去偶位置。1 c$ z% H- X. v. V/ k% B9 K
注意信號回流是否完整。

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发表于 2010-1-6 09:33 | 只看该作者
回复 2# shiningstars
& |. S9 b+ T( r. f2 e: W/ N- y- E3 ?# w3 S
" ?1 S" Z; }8 |/ v( J
    现在是什么结果?说出来大家学习下啊

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发表于 2010-2-19 01:34 | 只看该作者
数据线和时钟线上串排阻,可以调整emi

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发表于 2014-5-13 13:48 | 只看该作者
地址和数据线的参考平面是什么?

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发表于 2014-5-13 16:39 | 只看该作者
可能是参考平面没处理好
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