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如何把两个不同的网络用铜皮连接起来?

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发表于 2018-5-2 23:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题所示,allegro是否有PADS的copper bridge功能,可用一铜皮把连个不同的网络连接起来,DRC时不报警。+ n6 o8 ^, l4 _( X# _
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发表于 2018-5-7 14:13 | 只看该作者
打过孔,
8 a. K; e0 I: A  V7 b/ [8 M% C( F/ W. v

, \  B+ M( q: l5 @' K# U/ p9 A" p/ Q  \* Z" Y' T

+ m* a# c" W9 o  c( x深圳市惠达康科技有限公司8 l# h2 Z! \7 I; ]* D8 |, f
PCB层次:2-40层2 p  g  U- d: a
产品类型:PCB,FPC, R&F PCB.
/ c5 L" _. _. ~$ X1 k" s' l( `最大尺寸:双面1200mm*1500mm 、 多层1000mm*1200mm# u6 V* O8 m0 Q
按材质分:FR4、铝基板、铜基板、陶瓷板、无卤素、高Tg、高频板(Arlon、Taconic、Rogers、Isola)6 v  R  R$ |1 T+ z1 J
表面处理:OSP、喷锡、沉金、沉银、沉锡、镍钯金、厚金板(最大金厚40U")
' y+ U- z" \9 b% Z8 N1 j  O" H9 _制程能力:线宽线距3mil、激光孔0.075mm、机械孔0.15mm7 t4 h! S$ e& y
铜    厚:1/3OZ--28OZ
3 G% z( c. A& A, h& {杨先生竭诚为您服务! 13316575121(微信同号)   sales007@witgain.com
  `% W) o2 t6 n' x$ i

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发表于 2018-5-4 09:10 | 只看该作者
tangqianfeng 发表于 2018-5-3 19:20
) f% I3 D' e9 @: M3 gnet_short属性只有pad 或via有

2 J" d# f& m! V: Z# a我给一个pin via都定义  net_short属性,但是用cline线连接的时候,会排斥,铜皮会避让

点评

使用静态铜皮,就不会避让了  详情 回复 发表于 2018-6-21 00:06

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发表于 2018-6-21 00:06 | 只看该作者
王开鑫55 发表于 2018-5-4 09:10
- s1 e  J$ j/ l! {( s我给一个pin via都定义  net_short属性,但是用cline线连接的时候,会排斥,铜皮会避让

9 H9 W' m5 O; r( |4 ]! y使用静态铜皮,就不会避让了
0 \; B. E7 o- @$ |8 {, b; i; z, e: m; |( m/ l2 v8 k

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发表于 2018-5-3 00:30 | 只看该作者
应该没有,短路肯定会报DRC的,DRC隐藏即可,没必要纠结!

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发表于 2018-5-3 04:34 | 只看该作者
有, 可把不同的网络连接起来.
4 ]" Y6 a; X, kDRC时不报警.
/ w* L7 J. m- k- g% f( P, ?4 F5 ~% Z: C

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发表于 2018-5-3 07:14 来自手机 | 只看该作者
有的,要给他们定义net_short属性

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定义了net_short属性后,还是不能用连线或shape把不同网络连接起来。  详情 回复 发表于 2018-5-12 21:06
allegro中 edit properties没有找到net_short属性??  详情 回复 发表于 2018-5-3 09:19
这个办法好  详情 回复 发表于 2018-5-3 08:58

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发表于 2018-5-3 08:58 | 只看该作者
tangqianfeng 发表于 2018-5-3 07:14( h2 V8 Q6 g$ q3 C4 P- t
有的,要给他们定义net_short属性
4 C! K# v1 E7 B) m% v% d
这个办法好
: s  q/ Y3 L5 t3 E

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发表于 2018-5-3 09:19 | 只看该作者
tangqianfeng 发表于 2018-5-3 07:14
# |7 l* |; x9 Z8 m; R& l有的,要给他们定义net_short属性

% }& g4 ^% @. X3 K* ^* @/ Eallegro中  edit  properties没有找到net_short属性??. [- s7 K! p* l2 u; n. m$ K: @% a

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net_short属性只有pad 或via有  详情 回复 发表于 2018-5-3 19:20

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发表于 2018-5-3 10:03 | 只看该作者
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发表于 2018-5-3 10:54 | 只看该作者
两个不同的网络连在一起,不报错,怎么可能呢。

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pads就有此功能。  详情 回复 发表于 2018-5-3 23:52

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发表于 2018-5-3 19:20 来自手机 | 只看该作者
王开鑫55 发表于 2018-5-3 09:19
8 Q+ ~' \9 o7 s, eallegro中  edit  properties没有找到net_short属性??
' X$ \! t4 x5 h" I* q
net_short属性只有pad 或via有
( y' V2 O0 L( W2 g( T( V. i4 e. C

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我给一个pin via都定义 net_short属性,但是用cline线连接的时候,会排斥,铜皮会避让  详情 回复 发表于 2018-5-4 09:10

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 楼主| 发表于 2018-5-3 23:52 | 只看该作者
利涉大川 发表于 2018-5-3 10:54% F, i6 E/ b' Z+ ^+ s; {
两个不同的网络连在一起,不报错,怎么可能呢。

+ D' i& z' p6 ]0 n8 T9 T- n7 Ypads就有此功能。
; l' T8 r) Z: K9 X- ~

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我感觉应该是隐藏了DRC,你要是用CAM350去跑开短路都跑不出来的话,那这个功能就会出大问题的。  详情 回复 发表于 2018-5-4 09:12

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发表于 2018-5-4 09:12 | 只看该作者
myexpma 发表于 2018-5-3 23:524 Z, I- R3 f* V
pads就有此功能。
' J: J$ u2 N( U1 ^4 f6 `
我感觉应该是隐藏了DRC,你要是用CAM350去跑开短路都跑不出来的话,那这个功能就会出大问题的。6 [0 S5 Q. ?( g
( s" s4 D2 }/ E: U

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发表于 2018-5-7 11:17 | 只看该作者
可以把铜皮画在其它层,出光绘时注意要把这个铜的层加上
& z$ m- g5 P0 m) L8 _/ D% L2 C0 n* D: E5 O+ v

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已经使用此方法,但是感觉不完美。  详情 回复 发表于 2018-5-12 21:04

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 楼主| 发表于 2018-5-12 21:04 | 只看该作者
superlish 发表于 2018-5-7 11:17
( b2 c" Q8 h& s( `) S3 q可以把铜皮画在其它层,出光绘时注意要把这个铜的层加上

" Y" U4 s! Q$ b, z5 }* Z4 J- \已经使用此方法,但是感觉不完美。
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