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EDA365电子工程师网»技术社区 › 电子技术社区 › QA检查（免费服务） › 2017年11月5日QA检查报告节选
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2017年11月5日QA检查报告节选

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发表于 2017-11-6 10:14 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.匹配电阻应该靠近连接器放置' J/ T1 H' C7 E7 U$ `% v6 U8 A
: \& Z3 c5 J( j; {; R! o2 m" c
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发表于 2017-11-6 17:44 | 只看该作者
EDA365QA 发表于 2017-11-6 10:16
  [% E9 \4 l2 @: x6.高速线不哟啊在挖空的隔离焊盘下方走线
1 m( K! w6 m. p( E# l
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。( G+ Y5 N$ [# f/ d

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ccccindy
我的理解是不能在挖空区域底下过 这样参考平面不完整 落在分隔区 走线应该完全落在参考平面上  详情 回复 发表于 2017-11-28 15:40
剑铮奇迹
不是器件，是差分过孔反盘，穿反盘导致那块参考不连续，这种情况是可以避免的  详情 回复 发表于 2017-11-7 15:58
EDA365QA
高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。  详情 回复 发表于 2017-11-7 09:03
Jamie_he2015
应该是，不要在两个过孔之间的挖空区走线  详情 回复 发表于 2017-11-6 18:54

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发表于 2017-11-28 15:40 | 只看该作者
1023598725 发表于 2017-11-6 17:441 [4 m+ X6 E- P: U9 N3 O* c
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。
; \5 y5 }4 c3 z: G2 Y
我的理解是不能在挖空区域底下过  这样参考平面不完整  落在分隔区  走线应该完全落在参考平面上7 Q  F2 C% t! R* T

2.jpg (69.57 KB, 下载次数: 0)

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1023598725
谢谢  详情 回复 发表于 2017-12-4 08:28

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发表于 2017-11-8 09:56 | 只看该作者
EDA365QA 发表于 2017-11-6 10:15
3 M( ]" Q# q, U1 o5 [2 E' {4.CAN没有按照差分走线
- }5 z' y. [% n7 ~  u7 l$ l8 d
CAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。% c4 Z8 X7 @5 J0 K- H& }
这个家伙很懒，从来不写个人签名。

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 楼主| 发表于 2017-11-6 10:14 | 只看该作者
2.电源没有来源5 v7 z, ~& Y5 o' a5 A

& P5 J; e% z# I: v

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 楼主| 发表于 2017-11-6 10:15 | 只看该作者
3.网格部分应该是表层禁布
. L. Y& N9 R  t6 ]- b. x
, m! o5 e# ~" }' r; r1 F5 Z# i3 C

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jiangriver
为什么要禁止布线? 没听懂.  详情 回复 发表于 2017-11-7 19:02

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 楼主| 发表于 2017-11-6 10:15 | 只看该作者
4.CAN没有按照差分走线
* v% u1 i+ ?* w8 O) [8 Q
4 \! O* T2 c& h

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fengyu6117
CAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。  详情 回复 发表于 2017-11-8 09:56
LiuTao166462139
can为什么要走查分呢  详情 回复 发表于 2017-11-7 15:49

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 楼主| 发表于 2017-11-6 10:15 | 只看该作者
5.串口电容加粗处理
4 p0 t4 q& E" `5 ]
% K  x# T5 T7 \; Y, c9 V8 b" ~, c

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 楼主| 发表于 2017-11-6 10:16 | 只看该作者
本帖最后由 EDA365QA 于 2017-11-7 09:02 编辑 & f* ?; @' k8 ~
& B3 ], d3 |6 B% D( e
6.高速线不能在挖空的隔离焊盘下方走线, ]6 Y; j. t5 H6 V0 x( K* \
9 B! X1 W/ O0 R6 U- }4 w3 L

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剑铮奇迹
也不能说不能走线，完全可以把高速线neck模式不走4/4.改成3.9/3.5或者3.5/3.9，满足背钻要求，也可以穿的啊  发表于 2017-11-7 15:54
1023598725
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。  详情 回复 发表于 2017-11-6 17:44

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 楼主| 发表于 2017-11-6 10:16 | 只看该作者
7.此电源不需铺平面
; `  P  C- y4 M  h6 t
6 }, L+ ~' g6 w  J& o/ x

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 楼主| 发表于 2017-11-6 10:16 | 只看该作者
8.开路
. ?7 @* y! O7 z- \+ r% @ ! R3 @2 f4 M3 j" C9 J

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 楼主| 发表于 2017-11-6 10:17 | 只看该作者
9.相邻走线层的走线重叠较多5 H: g" q. g; Q# N. i- g) }2 l" g
. Q$ c" I! @5 d( J# |0 @! |' ]

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 楼主| 发表于 2017-11-6 10:17 | 只看该作者
10.485没有走差分
1 Y0 F4 T; f+ A! l. ~: l$ D
# T6 w4 z; K" |0 D# A9 e. v( W, o

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Jamie_he2015

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发表于 2017-11-6 18:54 | 只看该作者
1023598725 发表于 2017-11-6 17:44) X& P8 r5 x, t: A# ?" ?/ c  S
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。

1 A; r3 X! t9 R3 f- U2 v  b; J应该是，不要在两个过孔之间的挖空区走线

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谢谢。  详情 回复 发表于 2017-11-7 11:10

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发表于 2017-11-6 20:16 | 只看该作者
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edapcbsyc

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发表于 2017-11-6 21:45 | 只看该作者
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 楼主| 发表于 2017-11-7 09:03 | 只看该作者
1023598725 发表于 2017-11-6 17:44
3 R: x3 X# S9 j& l你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。
; W: ^! y1 g' d3 A
高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。
3 |% q% h+ H" k, [

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1023598725
受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:10
1023598725
受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:09

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