Net wire has multiple net name

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在使用AD10的时候出现以下编译错误
( F9 q( b: T8 W8 \Net wire has multiple net name（Net label SRAM_A0. Sheet Entry U_SRAM_Interface SRAM_A0(passive)）
Wire SRAM_A0
: {6 m/ s0 T$ L  TNet label SRAM_A0
Sheet Entry U_SRAM-Interface SRAM_A0(passive)
! {4 w, q& `* A7 w5 f' l; ~8 i
sheet symbol的图纸

# m- [$ ^) G- g
1 q" V: ?- q% d: X; p$ q- i总的sheet的图纸

. V0 u+ F! v/ R# C( r+ ]+ W
为什么我所有的net name都是sram_a0，他还是说我在一根线上有多个net name。而且仅仅是warm，导入到PCB还是sram_a0, 不影响PCB layout
# E+ ?0 l0 t, ?4 C很纠结，因为一编译message满是这种错误，也不知该如何解决。很烦

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仅当我将project->project option中的Net identifier scope更改为
Global (net label and port global)
) g6 W& d+ t: l) R$ _1 w& |4 A编译错误会没有，但是这非我所愿，很纠结