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本帖最后由 Yu_Shuang 于 2013-10-20 17:10 编辑 5 X2 t( T$ O( B7 p! P
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小弟我又来了。
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& `9 S2 l8 i, H! d现在奉上我的最新进展。6层板改成了八层板,自己给自己降低一点布线难度,同时也给我老师增加了一点经费预算{:soso_e127:} $ Q. z9 F. e' @2 ?$ O* }7 `
$ X+ }. Z2 A! K; F我在大神的指导下,已经把ddr2部分的addr和控制线做了预布通。用的是远端拓扑。: l0 Y( R5 l4 a/ s( W
请各位大神过目,给出改进意见,并指导我下一步工作。
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2 M9 N, P0 J, z/ q我的思路是: [, X$ H9 x+ t
1.看看当前的方案和走线有什么问题,哪些地方需要改进和调整。
5 \9 K4 p0 {5 k- R2.接下来要把板外的去耦电容放进来,放进来的同时调整已有的过孔和走线。
- k6 Y A0 U# L! q9 r3 K: k5 I+ e3.然后把地址线什么的都连起来。3 m9 {$ ^" z |& Z1 n
4.都布通之后,再设置约束规则,做等长,等长做完之后呢,ddr2部分就算完工了,也算是整板的核心部分吧。
5 P& o: ~" Z. L& g5.接下来开始布bga除ddr2部分的走线。+ t. u8 S6 T$ `: d) T% M+ V
。。。
1 b- C7 _" k, c1 U9 t/ l9 V' K; `) R- I+ @
大神告诉我说,要学习基本的走线技能,电源部分如何打孔,如何走线,ddr的走线方式什么的,起码要培训几个月以上,才能真正的开始走线。+ R$ y0 {; v& G+ |7 [* A
我确实被吓到了。。。。这些我确实不会。我也知道我需要学习的还有很多很多,布置电容时如何预留走线空间啊。。去耦电容到底如何放置啊,如何走线和打孔啊,(虽然看书上已经知道了个大概,但是到实际操作时,还是不知道如何是好)。约束规则设置成多少合适啊,依据是什么啊。走线的宽度和过孔的大小,是否易于加工啊,板厚和孔径怎么根据具体情况选择啊,等等等等。。。+ C8 }) p: J) z3 a
5 ~% G' t9 |) s# r1 h, M K但是我现在的目的只有一个,尽快做完这块板,制板,测试成功,就万事大吉。
% _7 K: y J0 }4 I' l很可能我做完这块板,我以后不会再做高速PCB的布线了,最多就是画画单片机,和100多m的低速板,根本不需要做等长约束啊神马的,连通即可。% K" W8 \6 v& x; w
所以呢,嘿嘿,我只要把这个板搞出来,就谢天谢地谢大神。- P* V- V4 J1 c1 w# w
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其实通过这个学期的学习,我对PCB产生了浓厚的兴趣。如果我后面有机会从事PCB工作,我想我一定会好好学习的。
# W, h6 E N C* t7 ~: G2 H- S {1 T但是现在,我只关心如何尽快能把这个板子做出来。我要学的不是整套PCB走线理论, j4 \ ?% K4 E& y
而是:做这块板,应该怎么做成功,重在如何做,而不是为何这样做。) v5 F- {% L' c7 p" L3 m r
我的目标也很明确,就是做出PCB,能用!还请各路大神不吝赐教。: l5 ]8 d2 z. R# N+ g: O. O9 E
) G9 @0 ~" S' v) f; z* B. K8 K第一次奉上原理图。3 }4 Y# ?+ b9 G: r( N, X) Y6 }5 ?
9 I. _0 k) ]8 u3 d$ a. p原理图 PDF
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SCHEMATIC-S5PV210.zip
(352.26 KB, 下载次数: 56)
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: v4 v, s$ @6 V9 L% rPCB cadence16.3以上(含16.3)- f9 o$ \; o7 K" u
S5PV210Core_20131019_V0.0.51.zip
(647.42 KB, 下载次数: 110)
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