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好奇怪的shape避让问题,请大家帮看看

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发表于 2013-7-29 18:27 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
10E币
约束管理器设置了shape到shape的距离是0,但是铜皮之间会避让,避让的间距是5mil,不知道这个5mil是哪里来的,下面发图:* A1 O2 q$ w6 w' Q/ g
+ Q! H  v, S" G6 f7 c  }% k. x
VDD_5V铺铜和GND 铺铜避让
, v- k/ b6 a+ l/ w( k- O/ r5 G' n+ U8 T+ K
0 t7 c, S7 O$ g. H$ |9 u7 s
设定的shape和shape的间距是0
8 \7 d& n- L1 R$ X5 N& @; B; D' e1 m6 j
. f/ B7 ?& {+ y1 G# |, m
shape参数
$ y8 ^6 J2 Y) i2 \  c9 d2 O0 |* C) }/ n5 Q* p3 d" ~7 m& V$ x
$ K1 {& z4 b) m9 I5 d
约束规则报告

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发表于 2013-7-29 18:32 | 只看该作者
为啥要设置为0?

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发表于 2013-7-29 20:38 | 只看该作者
我用16.3试了下,是可以实现的。楼主需要说明自己所使用的版本。
: g- ]* G; v8 u而且,楼主的第一个图的信息不完整,没有包括DGND的shape间距设置。

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 楼主| 发表于 2013-7-30 08:23 | 只看该作者
软件版本是16.3 。我在人家板子的基础上修改的,改好之后板子已经发出去了发现了这个问题,这个地方是避让了,但是万一其他地方没有避让,又不报drc错误就惨了,如下是gnd shape的规则:
1 z3 {; [0 v4 g! |! H+ d8 |# n; A

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 楼主| 发表于 2013-7-30 08:28 | 只看该作者
李明宗伟 发表于 2013-7-29 20:38
) h, x' |4 Q2 ~$ Y, _我用16.3试了下,是可以实现的。楼主需要说明自己所使用的版本。
: ~7 |# T. b/ z+ E" i5 w而且,楼主的第一个图的信息不完整,没有 ...

2 X6 c4 y+ F0 J是可以避让还是不能避让,避让的间距是多少,有没有drc错误报告,我的是16.6版本,GND的shape约束见上图

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发表于 2013-7-30 17:51 | 只看该作者
这里有没有设置

QQ图片20130730175111.jpg (75.42 KB, 下载次数: 0)

QQ图片20130730175111.jpg

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发表于 2013-7-30 21:23 | 只看该作者
httpftpli 发表于 2013-7-30 08:28
+ q# j7 f. o0 _, h1 w: n, ^是可以避让还是不能避让,避让的间距是多少,有没有drc错误报告,我的是16.6版本,GND的shape约束见上图

* `7 I+ `/ B7 q" s可以不避让的。
; q8 J0 y2 c8 I& N5 M
: _; `6 d2 F' q4 [至于你的文件避让的具体原因,没有工程文件我断定不了。。。

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 楼主| 发表于 2013-7-31 12:04 | 只看该作者
Able 发表于 2013-7-30 17:51
  A- w6 L+ H) k5 @% C这里有没有设置
, T" T' R) {  H* o7 Q
没有设置,已经上传了工程文件

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 楼主| 发表于 2013-7-31 12:08 | 只看该作者
李明宗伟 发表于 2013-7-30 21:23
5 F6 q& m! l+ d- P: T* Q8 u# a4 }0 I可以不避让的。* a* n1 _' i5 V$ @4 {
% }1 A2 q: K% x2 z2 t
至于你的文件避让的具体原因,没有工程文件我断定不了。。。

1 J/ n) \* z$ j' j: ?; d上工程文件  
) ?1 w  }% u2 R6 E
  O$ m$ [) v- e4 b5 Z, o BONE_PCB(1).zip (1.71 MB, 下载次数: 30)

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发表于 2013-7-31 13:39 | 只看该作者
httpftpli 发表于 2013-7-31 12:08
. @3 n6 @# G( ~4 f. q上工程文件

/ E- R" M$ K( r! L1 N! W& {, g确定文件没穿错?

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发表于 2013-7-31 13:55 | 只看该作者
因为你的VDD_5V Shape 已经定义成网络了,

QQ图片20130731135303.jpg (55.08 KB, 下载次数: 0)

QQ图片20130731135303.jpg

QQ图片20130731135351.jpg (87.71 KB, 下载次数: 0)

QQ图片20130731135351.jpg

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发表于 2013-7-31 14:09 | 只看该作者
静态铜和动态铜的属性不一样

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发表于 2013-7-31 21:29 | 只看该作者
本帖最后由 李明宗伟 于 2013-7-31 21:30 编辑
! L% j8 l) ^6 \% h( F0 t; p1 u
, K  k* Q* {2 G7 P) n5 K$ D! v楼上那位说了一大堆原因,有自己动手试试么?8 ~+ M& ]' B# w# C' s# ]! V
用16.3打开工程文件后,没有做任何设定改动,直接给DGND铺了一片动态铜,结果与VDD_5V的铜皮是直接接起来的,没有出现有5mil间距的现象。所以楼主的问题无法重现。6 x* W6 \5 P' K

: }' w! |3 E7 i7 v( x

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 楼主| 发表于 2013-7-31 21:30 | 只看该作者
Scott.Dong 发表于 2013-7-31 13:39
# Q2 ^9 x( c4 M; |- N. R9 T/ h确定文件没穿错?
& p$ Z3 e! l# h1 ?+ y; k( U
这个文件不是我发帖截图的那个文件,但是一样存在这个问题的,我后来试了一下于博士视频教程中的工程文件,把shape的间距修改成0 ,也是避让的,避让的间距也是5mil,我怀疑可能是软件的限制了,我用的allegro 16.6   11号补丁。

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 楼主| 发表于 2013-7-31 21:31 | 只看该作者
Able 发表于 2013-7-31 13:55 % u8 J3 g0 }% r& i$ \  V
因为你的VDD_5V Shape 已经定义成网络了,
2 x- P/ O. {8 T  @' h
shape是有网络的,你第一个图是physical constrain,和间距应该没关系
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