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IIC电平为什么会被拉低?

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发表于 2013-2-27 09:02 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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我现在在调试一板子,3组IIC共用一组硬件IIC,接有3.3V上拉(standby后依然有电),在standby状态下,只要触摸IC的IIC在通讯,另两组IIC的IC均不供电,但这种条件下,IIC的电平被拉低至1.14V,导致触摸按键无作用。
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发表于 2013-2-27 09:17 | 只看该作者
应该是上拉电阻的阻值大了,换个小的试试……

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 楼主| 发表于 2013-2-27 09:19 | 只看该作者
386019920 发表于 2013-2-27 09:17
- E0 P2 t* p- Y# {应该是上拉电阻的阻值大了,换个小的试试……
; d& v5 x4 y* ?& f/ z. x
上拉电阻本来是10K的,我换了个4.7K的上拉,依然不行

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发表于 2013-2-27 09:45 | 只看该作者
licvin 发表于 2013-2-27 09:19
! w5 f  Q& P) a, \上拉电阻本来是10K的,我换了个4.7K的上拉,依然不行
7 v% \) M% n  q  t7 b! L" G8 x
IIC的电平被拉低至多少?

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 楼主| 发表于 2013-2-27 10:01 | 只看该作者
386019920 发表于 2013-2-27 09:45
, I" w( }, {! l! @IIC的电平被拉低至多少?
& r' D/ f! G0 O: s: l; h
上拉电阻接1K,电压被拉低至1.16V。

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发表于 2013-2-27 10:09 | 只看该作者
除非有芯片被击穿,否则不会被拉低。你说的是I2C在通讯的时候,直流电压测量是1.16V吧,说明有信号和时钟在走,这是对的,用示波器一看就知道什么回事了。

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发表于 2013-2-27 10:23 | 只看该作者
查一下另两组接口的资料。仔细看看。曾碰到过类似的问题。最后是更新了另外一组的代码就搞掂了。那一组的IIC在不上电或没复位的状态下是低的。

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 楼主| 发表于 2013-2-27 14:25 | 只看该作者
reval 发表于 2013-2-27 10:23
/ i/ N/ O: F) v- c! v7 C查一下另两组接口的资料。仔细看看。曾碰到过类似的问题。最后是更新了另外一组的代码就搞掂了。那一组的II ...

  o8 B) o3 `' Z9 {5 }3 R6 _" x% m我也这么认为,所以有跟软件工程师沟通过,但他们说另两组在不通讯的时候,是设置为1的。用示波器测试过波形,CLK,DATA波形都是正常的,就是电平有3.3V变为1.14V。

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发表于 2013-2-27 14:43 | 只看该作者
明显的被软件当作IO在操作

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发表于 2013-2-27 16:11 | 只看该作者
另外两组IIC 的IC 有没有供电?如果没有供电,会将电压下拉。

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发表于 2013-2-27 16:18 | 只看该作者
可能发原理图上来,大家参考一下,也可以拆掉不同的组,很容易搞掂

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 楼主| 发表于 2013-2-27 17:51 | 只看该作者
reval 发表于 2013-2-27 16:18
. X. b; P  K3 @; {% q可能发原理图上来,大家参考一下,也可以拆掉不同的组,很容易搞掂
* x$ @# T' U0 l) |  m) S
去掉另外两组IIC,依然无法正常通讯,所以我在想,是不是需要三组IIC同时通讯,才可以正常运行?!按理说,各组IIC是互不影响的。在standby下,只有触摸IIC WT5700正常供电。

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发表于 2013-2-27 23:54 | 只看该作者
本帖最后由 超級狗 于 2013-2-28 00:12 编辑 ) f. b& L! j1 L$ k
" u8 h7 a4 a. v0 g  Y
I2C 的雙向架構是由兩個部份所構成,送的部份是一個 Open Collector 或 Open Drain 線路;收的部份則是一個 CMOS Input線路和前述的 Open Collector 或 Open Drain 線路並接在一起。6 g# l4 V9 V3 K  t1 f( ]
& D: [# n  ~' N
當你不給電時,Open Collector 或 Open Drain 的電晶體(Transistor)Gate 沒有電壓,電晶體有可能處於半開或全開的狀態。4 ?. z& h8 Q- s/ S( {
$ ?6 u( Z& D# b0 F6 J* l1 T
另一方面 CMOS 線路沒電時,電晶體(Transistor)Gate 沒有電壓,電晶體也是可能處於半開或全開的狀態。
# f: O6 |; x3 r3 W( P  {/ o5 T
5 Q5 j2 i" C; b' I# @如果你的問題是其它 2 個 I2C Device 給電就不會發生,那就應該是漏電把電位(Voltage Level)拉低的。4 o7 j" T! i3 O
% N2 ~0 {* ]- f: E4 Y; _" L
任何 IC 如果沒特別說明不給電時 I/O 腳位是高阻抗(Hi-Z 或 High Impedance)狀態,都有可能會透過 I/O 接腳造成漏電。
% X7 @$ V( g+ M. ~7 D% v6 Y0 t; u+ @7 g% F: A
如果你的設計為了省電,會有部份系統斷電(Partial System Power Off)的需求,一般我們的解法是去找一顆有電源隔離(Power Isolation)Buffer 或 Level Translator 把 Bus 兩端的 Device 隔開。6 f" s( c( P* T( {1 `2 I3 l

' B; A" I3 s" c+ o  d+ c$ U: e所謂有電源隔離(Power Isolation)的 IC,是這種 IC 會個別吃兩端系統的電源,當任一邊的電源消失時,IC 所有的I/O 接腳都會變成高阻抗(Hi-Z 或 High Impedance)狀態,這樣就可以防止漏電的情況發生。2 ~' X3 @4 g: J0 K- w" i: p4 A4 {; w( t

$ o3 |: [0 O4 c: S詳細您可參照TI I2C Level Translator TXS0102 的 Datasheet!
, J) c* Y  P& w; Z* v/ Q8 a8 \! n0 Y7 s
http://www.ti.com/lit/ds/symlink/txs0102.pdf1 ~" L% M" G$ E# I2 K

0 a4 _. ?7 |8 G/ `9 ~4 w{:soso_e176:}
1 b4 h1 V: U( X( `( b- M* W' W, W: M/ h. V6 @

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发表于 2013-2-28 00:10 | 只看该作者
如果你所謂的去掉 2 組不供電的 I2C 是把 33R 電阻拿掉,但其它 2 個不給電的 Device 還是有其它接腳和 MCU 或其它有電的 IC 相連,這樣還是有可能有漏電的危險。
( m: v0 Y/ [3 v* P3 q2 f% c4 N
1 a6 M. F3 w: t, d% I  O漏電造成 IC 不完全或是不正常的工作!# {4 u5 \3 }5 Z& |. x
/ m. S6 q" J. _0 j3 d: a
其實你只要用電錶量其它 2 顆不供電的 IC 上的電源或 I/O 接腳,只要能量到一些類似 0.3V、0.6V 這種微弱的電壓,那就表示有漏電的狀況發生了!
8 a9 x* n# x! F) I' G
: X* K/ o# q+ K! y) A漏得嚴重的還可能會量到超過 1V。" s% h, Q. r9 R2 |5 t8 [+ p7 ?  c
% v# r# y9 a" O) l  S/ S9 v

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发表于 2013-2-28 07:15 | 只看该作者
按楼主的意思是取掉其它两组的电阻,在STANDBY状态下,IIC电压还是低的。那就去查程序吧。
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