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Allegro constraint manager 里的pin delay 可以手动修改?

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发表于 2011-10-11 14:39 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 july2424898 于 2011-10-11 14:43 编辑
  ~& u: @4 [( i# a( z* R- S
8 \* R4 J8 u3 q! h8 q# C( n1 e- F那么修改后的作用是什么呢?" \" a4 G( C  C* n( K2 c
比如一对差分线,两线走线的长度差很大,我在pin1加上一定的delay,这样两线的长度差就控制在2mil以内了。但是我感觉这个不能随便加,它应该是个固有属性啊···求解释···
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 楼主| 发表于 2011-10-11 15:02 | 只看该作者
本帖最后由 july2424898 于 2011-10-11 15:03 编辑
/ j2 o  R- [3 J' v( L2 w! M- c
" h! I! c) ?4 ]6 R  W8 Z5 zpin delay 应该就是隐藏的线长度,线的总长度应该是包括pin delay的长度,对吧?

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发表于 2011-10-11 15:26 | 只看该作者
july2424898 发表于 2011-10-11 15:02 ( M7 E: Z9 G% s" B
pin delay 应该就是隐藏的线长度,线的总长度应该是包括pin delay的长度,对吧?

& h+ [* Z6 L/ }6 n) x0 j7 k对,包括 pin delay

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 楼主| 发表于 2011-10-11 15:36 | 只看该作者
wpcgood 发表于 2011-10-11 15:26 5 F2 G/ m0 y' p# p! W7 P6 c
对,包括 pin delay
  K2 f- G  j/ a* S- ~- e0 N
那任何差分走线都可以用添加 pin delay 来实现等长,那就不需要弯曲走线来匹配线长了。随便加 pin delay 有神马副作用?谢谢回答~

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发表于 2011-10-11 16:04 | 只看该作者
Pin Delay 是用來宣告 IC 封裝內度的走線長度. 當您做了這個宣告後再進行走線長度控制時, CM 會先檢調兩端的Pin delay 長度, 剩下的才是您可以用的走線長度. 當然  Pin delay 的資料不是自己亂設定的, 這些資料都是要由 IC  的  data Sheet 裡面去找到., J/ F3 N1 X. O1 |

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 楼主| 发表于 2011-10-11 16:14 | 只看该作者
procomm1722 发表于 2011-10-11 16:04
, i4 F" S4 @+ C+ I9 FPin Delay 是用來宣告 IC 封裝內度的走線長度. 當您做了這個宣告後再進行走線長度控制時, CM 會先檢調兩端的 ...

4 I0 j' x$ a7 Q* F* E# r- {% z恩,谢谢回答,从data sheet 里找到资料,然后对pin delay 宣告,再去走线。请问:对pin delay 的宣告,在哪进行呢?

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 楼主| 发表于 2011-10-12 10:51 | 只看该作者
大神在哪啊啊啊啊

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发表于 2011-10-17 22:20 | 只看该作者
在CM 裡面或是 File Import / Pin Delay

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发表于 2011-10-17 23:36 | 只看该作者
pin delay一般通过查询数据手册或根据器件模型得到,是芯片内部到管脚的延时,不能随便设置。
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