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PCB Net List Errors Report - 实验.sch - Sun Jun 12 21:33:09 20119 l* b+ C* Z- ~. A2 Z& [
------------------------------------------------------------------ M1 P5 W, u! b1 R! F$ y
Design to Library Part Consistency Check
# p9 j% n# V# T* R5 @, w1 z1 d----------------------------------------+ T) `2 s, ]/ l; n8 K
No Library consistency checking errors.& }$ _9 g8 R- |. r6 {6 g
& K, s2 _5 b- n2 `& Y
Single/Zero Pin Net Warnings- G7 e* m4 R) l
----------------------------8 v1 m8 G% I) g T: K
Net +5V has less than two pins in PCB net list file.
5 {& w0 T S1 T) GNet +12V has less than two pins in PCB net list file.0 a0 m5 f* W- V/ j z+ N
2 J$ k% i( ~- C) ^6 V
Schematic Connectivity Errors. A! N2 n- _: e9 t% E* X1 H. M
-----------------------------3 }) b5 Q ?( y. n* P0 T
No connectivity errors or warnings.
; l! {& J& W& B. U% l0 r- v% C' T% O. R8 S
* L# T X' m9 o0 s! E$ d8 t
这是什么 错误，我刚学pads，不太懂，能不i能解释解释一下 |
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发表于 2011-6-12 21:36
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