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如此简单的电路,到底错在哪里?

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发表于 2011-6-9 17:22 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 liwei 于 2011-6-9 17:23 编辑
  t# t2 Y+ w  U, I( r$ i3 V; g) z
" G- t5 c4 a# d  \! O4 d5 ?2 A5 | 8 h" T, j& ~$ c  J

& s7 Z. k  c/ b6 u7 ]  x就2个电阻和电源地,检查竟然报错,请问到底错在哪里?
, \" ?3 {9 b1 Q- `0 V
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发表于 2011-6-9 17:33 | 只看该作者
一般來說電阻兩個腳位都是Passive的型態,可以先確認一下Pin Type.
! [, w2 s( q9 Z另外的是你這個型態的錯誤一般都是在Project Option中設定為Warning的等級,不會設定為. \, J1 U% x! |- v% z
error的等級.如果只是要更新到PCB作電路,可以先忽略這個錯誤訊息.

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发表于 2011-6-9 17:39 | 只看该作者
在电路中这个不是错误,是软件规则检测的问题,说是没有驱动,可以忽略你要是想让他不提示错误,把R1电阻下面那个引脚改为output,R2电阻上面那个引脚改为input。或者在那里放个NO DRC。

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发表于 2011-6-9 17:40 | 只看该作者
ERC不是DRC说错了。

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 楼主| 发表于 2011-6-10 09:42 | 只看该作者
奇怪了,今天再检测又没有那个错误提示了,看来是软件自身的问题

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发表于 2011-6-11 00:09 | 只看该作者
建一个工程  把原理图放到工程里就行了!

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 楼主| 发表于 2011-6-11 09:25 | 只看该作者
谢谢楼上的,真的是这种情况

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发表于 2011-6-11 13:06 | 只看该作者
把两个电阻拉开一点,用线连接起来也是不会报错的.
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 楼主| 发表于 2011-6-13 10:11 | 只看该作者
jimmy 发表于 2011-6-11 13:06
- ?+ D; C) M8 {5 {, k/ `1 R把两个电阻拉开一点,用线连接起来也是不会报错的.
( P4 H) ~. g0 r- X  L
试了下,这样还是会报错

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发表于 2011-6-13 11:28 | 只看该作者
因为你的电源和地是单接网络.
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发表于 2011-7-4 20:07 | 只看该作者
不知道呀!!

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发表于 2011-7-5 10:45 | 只看该作者
初学者飘过2 W1 S+ G/ o! l

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发表于 2011-7-5 18:38 | 只看该作者
本帖最后由 wanghanq 于 2011-7-5 21:28 编辑
" S: V3 t  R% T, `, p) P0 O1 ^. D9 z9 ?, z
wh:在这里出现这样的提示是DXP,AD的bug(误告)(如果你的图更大,则会出现大面积的不伦不类的误告)。9 m+ ]" g9 d" \8 r$ ?3 O: c% a
        从网上提供的信息看,当前规避方法多是建议在项目中进行编译检查4 }0 C' W' B$ f+ L
Project Compiler Error Reference_2007.pdf (513.75 KB, 下载次数: 23)
6 H6 B7 Z# q# W! W( N! S单文件和项目时报错对比( 以前用AD时没遇到这样的情况_没在非项目中编译过...):2 f! X" i& D# V" j  Z
$ G% t# k' c. S2 U
----------------------------------------------------------------------
3 e/ \- t9 A' m6 @$ b ( _* }) E- J6 P3 [$ Z4 P* m: b* C
9 f. b$ i* U$ b: Z8 L( Y+ m4 d1 z4 r
) D9 b  n: C/ T2 D0 C
其它相同的文章:- ~$ i/ @* @  ~; U' X" [! Q. J6 e
“signal has no driver/load”的解决方法
) `; s! h$ l: w; n7 Y$ D3 K# M9 D" zhttp://blog.csdn.net/erazy0/article/details/6140847   (此帖注明“原”,但看到下面的主题及内容这个也只是一个整理贴)
0 Q1 U( x1 Q2 j& s1 o- ~' w% E3 F! k' O5 U
发现老早帖子“protel DXP 2004 Signal PinSignal_C1_1[0] has no driver 问题的解决方法 [转贴 2007-11-18 14:12:31]”' ], @% l' n- V$ n! }. }6 Q

; M- q( L) x. e" k& t. i按理说DRC规则在SCH也应该可以设置为好,但AD现在只能在项目下进行DRC规则设置(Project Option)...6 i9 S* [' e/ y, R4 X2 t! o
8 w* w+ v# l2 ]. L4 M  P
算是AD的胎生bug之一?再举例对初学者误导的胎生bug:( J3 }- D$ j" X2 O6 r- T9 D! ~
- ]* ?% a7 @5 {* |  L
从AD6.9到AD10版本都有如下图的错误提示?& I1 ^4 p% ?* N4 a0 _) {
  ) g$ o1 u  w2 S0 f; y
下载 (22.03 KB)
' I+ j8 a7 g7 Y+ E  x/ ^* q: ]2011-4-2 21:511 [$ t) L5 H0 R* u
7 I2 X2 v' Y+ t* c; v) R* J0 q" [

/ y( F# n0 Q' c/ h
9 j9 S$ w$ @6 R3 r1 E* Q; Y0 O栅格尺寸中对应的指示位置图示有错,易误导初使用者。! ]+ i6 u* a- W# B1 b
栅格尺寸是相邻两导线中心线之间的距离,如果用当前的图描述的话,至少也应是一个在线的下边沿,一个在上边沿。5 [2 \* F, V$ o
显然若是画出图示中所标尺寸的铺铜,栅格尺寸需要设为:28mil(即: Grid Size  28 mil)。
/ Y3 \$ F: l" I) V! w! v这个在开始使用AD6起就反馈过,但一直如此(不知道是哪出了问题)
* S5 I" k5 q( M& y- V8 i
/ r' D" ?5 b/ c. Z
6 X( m+ s/ b- g4 z

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发表于 2011-7-5 19:04 | 只看该作者
学习了,谢谢

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发表于 2011-7-6 23:47 | 只看该作者
学习,谢谢!
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