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orcad同步到allegro的问题

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发表于 2011-1-14 15:48 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位高手,请教一个问题,在下将一个orcad和pads完全同步的原理图和PCB,想转成orcad和allegro文件之后再同步,已修改完很多问题后,能生成网络表,但是不能同步到allegro,强行同步后,所有的无件丢失,但走线还在,manual place里面提示所有的元件处于未放置状态,在同步的时候提示下面这些问题
0 [3 X7 o. M! jWARNING: P7 component device pin number mismatch; cannot replace.
# J& V$ h( t4 }$ Q9 V+ z  ]. H#1   ERROR(SPMHNI-191): Device/Symbol check error detected.
+ Z( m. x& |; d6 @; T+ _ERROR(SPMHNI-197): Symbol 'C0501' for device 'C_2_C0501_100U/35' has no refdes.
5 l6 v+ w# H1 J#2   ERROR(SPMHNI-191): Device/Symbol check error detected.
- @, b+ m# w8 V2 K9 ^. s2 TERROR(SPMHNI-197): Symbol 'C1004' for device 'CAP_C1004_470U/35' has no refdes.( \2 ]$ ~  d9 F% a/ h: s' P
#3   ERROR(SPMHNI-191): Device/Symbol check error detected.# a* o) p3 F! N/ I% u0 H; w# J* X
, W5 B; S8 S3 T' s9 b
请问各位大侠出问题的原因是什么,怎样解决???: H+ f+ O. }$ q
在小用的是cadencd16.3
' z7 \$ ~$ X, m* ?/ C/ O8 c. F9 y, F% Z3 I2 {
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发表于 2011-1-14 22:11 | 只看该作者
Symbol 'C0501' for device 'C_2_C0501_100U/35' has no refdes.
. ?6 U) W; o3 U0 P- }6 o5 L=======================================
( v( S) d1 u% x请问你是看不懂英文还是怎样?
250 字节以内
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 楼主| 发表于 2011-1-24 14:56 | 只看该作者
导入pads格式的PCB 导入到allegro之后再与orcad格式的原理图同步的全过程经验总结9 X& k) \5 J- P
步骤
2 Q9 F2 m$ e2 W1,先将orcad原理图与pads PCB严格同步,同时保证pads的每一种元件的库都有元件序号和值的label(两个label),不然会出现同步allegro传送网络表时会出现没有标示的问题" K8 G0 |/ v- D9 ]$ G
2,pads输出powerpcb3.5格式的asc文件
- L, |2 Z0 y, G$ O5 e" \3,在allegro里面导入asc文件# o+ n- |+ M  ]  X4 P' Y/ }0 i0 r
4,在allegro导出库文件  t0 |, Z1 _& `3 T( y9 f, ]. I4 _: d* Z
5,在用户设置里面,设置焊盘和flash的两个库文件的路径,都指向刚从allegro导出的库1 l" t9 K$ X4 Z: J9 N
6,打开orcad,输出网表,选择要同步的allegro PCB,并指定要生成的allegro PCB6 @3 i* g8 C6 M
7,执行同步。(此过程会产生很多问题,大部分的问题原因是,
8 B; i; c: X5 a" _/ r, E/ X                           原理图的焊盘个数与PCB库焊盘个数不一致,   修改原理图,保证与PCB库一致# a3 J/ q4 j! X  p
                           原理图封装信息也PCB不一致或有非法字符 如。+?、/等符号,重新修改原理图封装信息,并保证与PCB库一致
* }+ c* p9 w$ [" k  E) i  n3 J                           原理图库元件信息里面的路径信息也不能有非法字符。+?、/等符号,解决此问题只得重新做库和调用cadence2 }" ?' l" b: T! u/ w4 y1 v6 c9 ]  }
                           源库替换掉原来有非法路径信息的库元件
/ z0 }( [# x. v7 M$ e  n2 W+ Q                           元件的引脚也要严格区分,如某个引脚定义为output 则该引脚不能连到地。这也会造成同步失败
* c! ^& t1 P9 h; U                           元件的引脚名和引脚号不能分别不能与另一个引脚有重复的部分)- s! t' p, _8 e8 b# \8 ^
+ F7 k' Z3 z' z6 I& O/ J; N
5 K4 d8 v8 z% [; w0 A7 G

点评

归纳下,就是借用不同软件的库文件,再正常导入设计。这也是各种不同软件设计杂交设计的标准方案,而布局文件及走线可以后期导入。当然库文件都是需要优化的,特别是走pads->allegro流程的转换方法。  发表于 2013-3-1 18:14

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发表于 2011-1-27 08:42 | 只看该作者
ding

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发表于 2013-3-1 17:54 | 只看该作者
祝自己在的新的一年里,开心快乐多,伤愁离别少。
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