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发表于 2010-1-30 20:32 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
本帖最后由 xxb 于 2010-1-30 20:33 编辑
6 p" g" Y/ B) Z$ ^, s: f' ~4 Y' a- y  x3 f! C! G# v6 ]5 D3 c6 X$ B9 ^
生成网表时提示下面的错误
* d% |* h& n1 g/ \6 X7 x/ ^是什么意思啊?
) p6 f4 v8 F6 g' h. [. X谢谢!
" e, U5 N: }. Q7 F5 }[FMT0003] Duplicate pin U7 pin 16. Possibly a complex hierarchy in logical view or duplicate part reference in physical view.
- w& J1 S5 g$ S+ N# W, b& S; Z[FMT0018] Errors processing intermediate file
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发表于 2010-1-31 21:41 | 只看该作者
U7的pin脚冲突了?& K, |" B5 [& v8 u3 @% e/ s
DRC有没有做过?

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 楼主| 发表于 2010-2-3 16:02 | 只看该作者
DRC没有做过$ W) L9 a/ h& s+ {7 r# v
问题解决了
* f% F, O+ A, N. j: S# k谢谢楼上

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发表于 2010-2-3 21:24 | 只看该作者
如果楼主能把怎么解决问题的方法发出了就好了,0 M  J0 ~* u0 T6 @0 B8 U* L
让大家都学习一下。

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 楼主| 发表于 2010-2-3 22:44 | 只看该作者
回复 4# ger11 : r# Q2 s! k; h; e3 Z+ ^. Q

: j- `2 Y' ?, j9 J
* q: ?* T! B8 g; Y$ I    如1楼所说,生成网表前没有做DRC检查,原理图中元件名重了(两个U7),改过之后没错了。
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