1932个焊点的FPGA如何扇出 求指教 要多少层

liuchao6102616

1932个焊点的FPGA如何扇出  求指教 要多少层

GHOST

这个说不准的吧，叠层还得看板厚，板厚不够也叠不出来高层的
另外还得看多少网络， PIN间布一根线还是2根线也是不同的
5 ^2 o; B# L1 B- C9 e3 t估计要到18-20层左右

kevin890505

看芯片具体功能引脚分布了，同样封装的BGA，扇出层数差距大大的。有些厂家会针对BGA引脚分布做优化，就可以节约层数，有些很随意就比较蛋疼。

liuchao6102616

GHOST 发表于 2017-12-26 11:55
& H, S$ A. r( M6 ~* h# G! c这个说不准的吧，叠层还得看板厚，板厚不够也叠不出来高层的
另外还得看多少网络， PIN间布一根线还是2根 ...

! i# f; g7 ]( z* s! I- f) ]多谢
# i. l1 \! k; o6 U. Q8 ^) _6 \# V

liuchao6102616

kevin890505 发表于 2017-12-26 14:12
( `8 i# V) Z# x0 w* g) w. [: F' ?看芯片具体功能引脚分布了，同样封装的BGA，扇出层数差距大大的。有些厂家会针对BGA引脚分布做优化，就可以 ...

多谢  12层应该差不多

zyh610710

可以自己预估一下，前两排走表层，3，4排走背面，后面的就用内层去算，单端信号，还是差分信号，看信号的分部来评估板子的层数，至于超板厚不能加板厚就只能叠相邻层

這侽孓譙悴丶

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* ^0 [( `2 Z" I自己导入后根据网络的分布（如果功能用得多网络自然就多，如果有些功能没用到自然就有些地方有空Pin，有没有空Pin对布线影响很大）以及布局大概散出一下评估就差不多了，前两排可以拉出去，加上FPGA可以换PIN有些网络顺序就不用担心了，然后再看看电源通道，自己大概评估下！

cjkao

XILINX 有份文件可參考看看
https://www.xilinx.com/support/d ... ce-design-rules.pdf

南林维京

这FPGA应该是1mm的，
, R: a7 c! H1 Z2 }4 J1 u: R1.首先最外面2排的pin,可以拉出去打孔
% c8 q  K$ X6 r1 V2 |) U6 W% j+ E3 F2.通常情况下2个pin之间可以走2根线，你可这样大概走一下，算下多少层能走完，
) {+ m3 v& u" `, Q$ w- K3.当然你要把电源用到的层也要算进去；
* h2 n9 }$ ?% O' M# [5 W3 u4.还有就是要考虑，走线是不是顺的，交叉多不多。有没有特别信号等，不过FPGA，是可以做SWAP pin.
* e+ d0 j0 M. G( Q! m$ m& u  E3 `5.同时也要考虑板厚，厚比等

8 A& H, |- `" Q5 k/ H以上个人意见。

liuchao6102616

南林维京 发表于 2017-12-28 16:06
8 M( J; M$ _+ F这FPGA应该是1mm的，
$ a4 y- v! {, N& _( @8 J1.首先最外面2排的pin,可以拉出去打孔
2.通常情况下2个pin之间可以走2根线，你可这 ...

" l  C0 h# ]: i- _$ D+ r: u+ m了解了  多谢！
% x1 X# H4 Y7 Q; |- J- r3 Z0 `

liuchao6102616

cjkao 发表于 2017-12-26 15:59
6 h' _6 H# w; L! ~+ M) ?XILINX 有份文件可參考看看
https://www.xilinx.com/support/documentation/user_guides/ug1099-bga-devic ...

. h7 D0 z5 v; X$ v0 t; s! a2 p- q多谢！
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liuchao6102616

這侽孓譙悴丶 发表于 2017-12-26 15:32
. v: V" O0 K  ^自己导入后根据网络的分布（如果功能用得多网络自然就多，如果有些功能没用到自然就有些地方有空Pin，有没 ...

了解了  多谢！
- j5 s5 F3 S7 X

liuchao6102616

zyh610710 发表于 2017-12-26 15:31
0 s) ~8 ]4 M2 X; q9 G0 n可以自己预估一下，前两排走表层，3，4排走背面，后面的就用内层去算，单端信号，还是差分信号，看信号的分 ...

/ P! ~% [( ^0 G了解了  多谢！
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