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一个关于DDR走线的问题

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发表于 2008-10-27 16:38 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在线请问各位,DDR的地址线也一定要走等长吗?现在有一块板子(一款高清DV)上面有片DDR,频率有570M,在录像的时候就会死机,有五台机子,都是同样的情况,硬工调了好久,总找不出原因来.最后下结论应该是PCB DDR走线的问题.当初我是把地址线分高八位和低八位各分一组走等长.CK/CK#,LDQS/LDQS#,UDQS/UDQS#走差分,其它的地址线和控制线没怎么特殊地约束它,现在出现上述现像.会是PCB的问题么?如果是的话怎么改进?各位讲讲,谢谢了!
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发表于 2014-5-13 09:51 | 只看该作者
想问下 当时设计的时候 DDR的线的参考平面是什么属性啊.

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发表于 2017-5-2 16:31 | 只看该作者
地址线都等长会好些。。。。。。。。

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发表于 2013-12-13 16:36 | 只看该作者
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发表于 2008-10-28 08:59 | 只看该作者
可以测一下DDR的时序让软件稍微调整应该能解决问题。你的线距是多少。

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 楼主| 发表于 2008-10-28 09:58 | 只看该作者
回楼上edqin,我的线距最小的位置是6mils,
' B: v/ [& i6 k$ K9 v别外一块板子也是同样的方案,我测了一下它的走线,基本上走了等长,; T/ h, S2 ~8 d, v
但不严格,最大的差入有200多mils,但是DDR离DSP很近,能正常工作,2 R( Y4 W  @6 z2 F7 @
难道是软件的问题?

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发表于 2008-10-28 12:39 | 只看该作者
CK/CK#和地址已经控制线要求等长,一般偏差在50~100mil,
1 s( G4 g, @$ @$ ^5 W( X  k" c) YLDQS/LDQS#,UDQS/UDQS#和数据线要求等长,一般偏差在50~100mil.4 J; ~* x2 x6 g! o: i
所有线的等长要求,不是很严格,但是一般不会超过100mil.# z0 j# h- f7 Z& }% C9 i
等长跟采样点有关,相关原理你看看DDR的手册。

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发表于 2008-10-28 17:15 | 只看该作者
不一定只是用软件来解决此问题代价要小一点。

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发表于 2008-10-30 13:24 | 只看该作者
是一开始录像就死机还是录了一会儿再死机?

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 楼主| 发表于 2008-11-7 14:24 | 只看该作者
回楼上的,是录了一会再死机.开机是很正常的.

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发表于 2008-11-7 16:30 | 只看该作者
哦这样的话,跟你的DDR走线没有多少关系.

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 楼主| 发表于 2008-11-8 10:33 | 只看该作者
当初HW是这样分析的:开机时DDR要交换的数据量不大,所以能正常,但是录像之后,因为是高清的,数据量比较大.所以就跑不起来了,想想也并非没有道理.当初我的地址线没有走等长,比数据线要长,是不是在读(写)数据时先要找地址,而我地址线太长而找不到地址(频率比较高)所以我的数据线走等长就没有意义了呢?

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 楼主| 发表于 2008-11-8 10:34 | 只看该作者
目前已经修改PCB了,等新PCB调试结果....

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发表于 2008-11-10 10:00 | 只看该作者
希望你改板后能有所改善. 建议此段时间你可以试试其它品牌的DDR./ a: R$ T( D% f# d
不过我的愚见是:这个问题是你们的硬件有问题而不是板子有问题.2 d4 v0 m' T; S
静待佳音!

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发表于 2008-11-13 11:06 | 只看该作者
频率高了对于走线长度是有限制的,走线较短的情况下等长就不是要求很严格了,如果走线较长尽量走等长,你的高8位等长,低8位等长的设置是有问题的,出现群体性差异,数据锁存是以时钟为准的。
善良 正直 无畏 执著

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发表于 2008-11-13 15:40 | 只看该作者
过来学习 等待楼主的好消息

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发表于 2008-11-14 10:21 | 只看该作者
我也来学习一下!等待是否解决问题!

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 楼主| 发表于 2008-11-20 13:55 | 只看该作者

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