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pads中关于ECO TO PCB 的问题 急死我了!!

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发表于 2008-10-24 09:20 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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最近一直在画FPGA部分,发现了很多操作上的问题。
8 w* ?" V3 A# b$ L9 R' n在原理图中,FPGA的PART TYPE是由多个DCEAL组成的,在PCB布线过程中难免会在不同的管脚间进行网络的交换,当把所有要连到FPGA的线整齐地放到它周围,就等着调整FPGA管脚后,才发现,原来FPGA管脚网络改变后,从LOGIC ECO 到 LAYOUT后所有原来放置好的线全部被删除,也就是说,凡是调整过的网络的连线都被删除了,这样会给布线带来很大的麻烦,不知道大家是怎么样做的?7 M- |* ]6 t2 ?! a4 G( c& m6 E
谢谢大家回答咯
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发表于 2008-10-24 09:55 | 只看该作者
可以ECO PCB TO LOGIC
, j( A. i$ j  a( w+ G( }這樣可能要好點
凡是有膽量來到這個世上的人都知道,誰也別想活著離開這個世界

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发表于 2012-12-18 12:06 | 只看该作者
以后要慢慢抛弃pads了,太不好用了。问题还很多,ECO模式删个器件,GND的孔全掉了;平时删个孔如果其他的地孔不保护,如果没有线连接的话也TM全掉了,什么破软件。

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发表于 2012-12-18 13:09 | 只看该作者
将FPGA周围连好的线做成reuse。然后再进行eco to pcb.
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发表于 2012-12-18 13:10 | 只看该作者
kdc252626658 发表于 2012-12-18 12:06
; J; z; m6 n0 _0 O. C- X& {0 O以后要慢慢抛弃pads了,太不好用了。问题还很多,ECO模式删个器件,GND的孔全掉了;平时删个孔如果其他的地 ...

/ p$ b3 ]8 {$ s删除器件时,此项不要选* U, B1 `9 o1 y

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发表于 2012-12-18 13:11 | 只看该作者
删除器件前,也可将整板的过孔进行glued和stitching
$ w9 _* D) @: B3 ^- M( `2 {4 N: ?% A3 B
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发表于 2012-12-18 13:14 | 只看该作者
问题:删个孔如果其他的地孔不保护,如果没有线连接的话也全掉了
. L9 _3 O* o& G- S5 C( ^
$ h& Y9 H8 J  Z# k$ j: L  w答:只要你的过孔不是直接复制,而是通过select nets,选中某个器件的GND网络的管脚后来add via的,都不会掉。每个软件都有自己的特点,如果要用它,就只有去熟悉它的脾性才能更好的驾驭它。要不然,建议你换其他软件。
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发表于 2012-12-18 13:54 | 只看该作者
JIMMY,霸气!

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发表于 2013-2-17 15:59 | 只看该作者
jimmy 发表于 2012-12-18 13:14 # m1 \( J0 U0 T
问题:删个孔如果其他的地孔不保护,如果没有线连接的话也全掉了
5 y+ D. w' e# `- A" a5 X) U9 ]/ g- j
/ D) v9 Y! X0 a0 I  p! ?答:只要你的过孔不是直接复制,而是通 ...

1 k6 j# l6 y( O/ K, t8 f- q多谢指教,是自己太浮躁了。

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发表于 2013-2-17 16:01 | 只看该作者
jimmy 发表于 2012-12-18 13:10 - A1 M# f4 k# C, ~; |2 m% Q! H
删除器件时,此项不要选

% k+ W8 s3 l6 K5 p# o  i2 P7 s. |上边这个 delete routes 勾勾,我都勾掉的,但删除器件,相连的网络还是经常回掉,掉的非常干净,只能重新走一遍。哎,是我的器件有问题?

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发表于 2013-2-17 17:05 | 只看该作者
kdc252626658 发表于 2013-2-17 16:01 . X' D7 L& w% \9 j( o! p9 U8 l
上边这个 delete routes 勾勾,我都勾掉的,但删除器件,相连的网络还是经常回掉,掉的非常干净,只能重新 ...
  \/ e: u9 b. V! U7 C
可以将相关的PCB和最新原理图发给我试试看。
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发表于 2013-2-17 19:58 | 只看该作者
jimmy可以说是这方面的权威了啊
! m/ P. |8 }( Z; n, A) D9 @- ]

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发表于 2013-3-4 18:06 | 只看该作者
jimmy 发表于 2013-2-17 17:05 % c/ `; s' j/ a5 \# Z" F& D
可以将相关的PCB和最新原理图发给我试试看。
$ @$ u7 t2 C) m/ Z( E
; |  D- v$ z1 V/ |  q$ _5 _% T
) z' @' m# Q, {1 c8 T0 x
jimmy,你好!2 j5 C6 q# \5 L# y4 _5 `( _

( j; c, L/ ^# O7 o" F/ p    您能帮我检查问题真是十分荣幸!pcb是pads2007画的,原理图是用orcad画的。把原理图映射到pcb是用到导出网表的方法。
2 {% F; B9 y% X- t" T原理图几经易手,画的比较凌乱,器件命名也很不规范,勿见笑。9 M: o% a( n+ ^/ j3 @# D3 V" Q6 b

  h5 D- Y  Q( t! b2 W; U0 s举例:拿删除连接器U6来说,在eco模式下删除,即便勾掉delete routes,软件同样会提示与之相连的网络会删除(点到点的会删除,有分支的则不会)。
: B5 w/ ^% Q: x    多谢释疑!" |( c4 w# H2 \
3 ?. X, `, M4 W1 {/ A/ H

- I7 _/ J- G7 g还有另外一个问题,如果我的板子原本6层,后改版降为4层,不知有没有简便的方法操作。我之前的做法是把要减掉的两层的所以信息全部删除,包括贯穿的VIA才能降层成功,否则总是提示要删除的层上还有东西。因为动作实在过大,之后我就不减层了,只是是布线的时候空出某两层,一根线都不走,一片铜都没有,出gerber的时候只出有效的层的信息给板厂,这样也可以解决问题。但总有一丝遗憾。出的gerber中,过孔的信息显示的还是6层,总是要给板厂解释。不知道是否有其他简便的方法?还请多多指教!谢谢!

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发表于 2013-3-4 18:07 | 只看该作者
jimmy 发表于 2013-2-17 17:05 . @9 A8 `% S8 Q$ W0 m$ _1 b5 h
可以将相关的PCB和最新原理图发给我试试看。

5 n/ C& m' u. \1 T RC01_V1.0-PCB&SCH.rar (198.28 KB, 下载次数: 34) . m( v0 k; R- \, ~6 ]

' e1 d- y) }- b附件丢了,补上。

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发表于 2013-3-4 18:07 | 只看该作者
zhangjinhe 发表于 2013-2-17 19:58
7 ~( |# |4 e+ Xjimmy可以说是这方面的权威了啊
+ f+ l9 r8 z3 q: q8 q
那是,膜拜!
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