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两个工程,各一个原理图一个PCB,如何将两个PCB和合并到一块?

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发表于 2015-9-11 14:06 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
1E币
本帖最后由 any_014 于 2015-9-12 16:03 编辑 : I) \) M* [9 \* Z6 [
. n/ J, F! u8 k
其中一个是核心板,一个是母板。原来是分开的,通过排针链接。
: l1 I0 ]: c  M) |现在想一个母板中直接嵌入两个核心板,就是都在一个板子上。& k! U; @0 x% m0 p" H' k+ n
有什么办法呢?头疼。1 o: V8 V- z2 u4 H
0 f9 r- C) h$ [1 [' b4 P& y
---------------------------------------------------------------------------7 n1 W$ I9 n- O" q
: c7 q' F0 R' Y
总结一下吧。  U! K$ C$ h$ t, g7 c
层次化原理图设计,将核心板原理图repeat两份,后来的这份按照之前画好的执行copy room formats后,可变成排列走线一样(貌似敷铜没有复制成功)。! i6 p6 g# w% j0 N
原来的原理图是sheet2,对应的pcb图上的两部分网络和元件名都自动加上了_sheet21和_sheet22。
6 x& S  q* o( F# b: ~然后又把母板的原理图和考进工程来,因为之前的元件名和网络名都自动加上了后缀,所以基本上不可能和现在家的母板有重名(电源网络除外)。* g* @' @8 V, k+ \  }. n
把母板pcb再拷贝添加进现有的pcb里来,就可以和原理对应上了。$ C  X. Z  y( I) v( Z& [/ {: g! E
6 e% k2 {/ M! U2 a$ |- a
最后遇到的问题我另发帖询问吧,这个算是结贴了。+ w& I) n+ r# S1 W) ?2 Q0 X' x4 x/ a

最佳答案

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1. 强制合并:新建一个新的PCB,然后把你要拼的PCB复制,并粘贴到这个新的PCB上,粘贴时候记得勾选允许位号重复,保持网络这两个选项; 2. 普通合并:将原理图都放在同一个项目下,然后要新建一个顶层图,并放置sheet symbol,即使这两个板子上相互独立的,然后按照方法一新建PCB并进行合并; 特别要注意,新建的pcb的环境要跟你已完成的PCB的环境是一样的,比如规则,叠层。 如果层数或者厚度要求不一样,那还是放弃吧。
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发表于 2015-9-11 14:06 | 只看该作者
1. 强制合并:新建一个新的PCB,然后把你要拼的PCB复制,并粘贴到这个新的PCB上,粘贴时候记得勾选允许位号重复,保持网络这两个选项;' m& T8 U  K2 y. [7 z  Z
5 i3 s& U, A9 }/ D, s0 N, g, s( B
2. 普通合并:将原理图都放在同一个项目下,然后要新建一个顶层图,并放置sheet symbol,即使这两个板子上相互独立的,然后按照方法一新建PCB并进行合并;
; t0 M3 y. K  n
/ x+ C2 s" k1 m  w" l' c特别要注意,新建的pcb的环境要跟你已完成的PCB的环境是一样的,比如规则,叠层。3 ^# z: t  A8 t$ v( F

+ Q* w8 h# B; Z3 h! D6 f如果层数或者厚度要求不一样,那还是放弃吧。

点评

另画了个简单的工程测试了下。 画了个图,然后改成多通道画法,复用3次。更新到PCB后确实出现了3个ROM及相应元件,摆放好一个后,可以copy room formats,另外的room就变成了同样的摆放及连线。 但,回到原理图  详情 回复 发表于 2015-9-11 17:35

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 楼主| 发表于 2015-9-11 14:16 | 只看该作者
最好的办法是两个工程的原理图能对应上,元件编号不冲突,然后把两个PCB复制到一个PCB里,对应两个原理图。

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 楼主| 发表于 2015-9-11 16:22 | 只看该作者
谢谢回复。7 E* B2 G3 n& ]# u4 H. c
粘贴时允许位号重复,这个选项在哪里找呢?
2 d. |* L, r8 K7 N4 B9 L或者,粘帖的时候,能否元件标号自动重新分配?

点评

特殊粘贴!可以实现位号重复!  详情 回复 发表于 2015-9-12 08:35

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 楼主| 发表于 2015-9-11 16:40 | 只看该作者
本帖最后由 any_014 于 2015-9-11 16:43 编辑 ; x  x  I; E4 [( |( {

; a$ ^7 O5 i! _5 \' }2 J试着放置sheet symbol,然后将其对应原来的原理图sheet2,又设置其属性为repeat(sheet2,1,2)8 |5 X' v+ n( L" K* p0 q
结果出了两个room,分别为:sheet21和sheet22,但原Pcb上的所有元件都被移除了。8 h7 Y! y: `8 c: |
: A$ `! C& P3 r

5 f$ \7 T* R1 y$ K& S( L' k我是按附件中的说明操作的。
0 H; m% c; Y7 a Altium Designer 中原理图及PCB多通道功能设计 by pkkong.pdf (1.51 MB, 下载次数: 48)
; a  J% s4 {, T8 W) ~1 w  Q
7 y$ H' J% Z. L* y& R, l: J9 k

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 楼主| 发表于 2015-9-11 17:35 | 只看该作者
himonika 发表于 2015-9-11 16:01  j8 u+ y& m% Z& O7 ^3 K
1. 强制合并:新建一个新的PCB,然后把你要拼的PCB复制,并粘贴到这个新的PCB上,粘贴时候记得勾选允许位号 ...
& }+ e; d" X- Z
另画了个简单的工程测试了下。9 F8 o& P' i% E# L) m6 b
画了个图,然后改成多通道画法,复用3次。更新到PCB后确实出现了3个ROM及相应元件,摆放好一个后,可以copy room formats,另外的room就变成了同样的摆放及连线。
0 P. d% o6 R  i6 b: A
7 }' V: S' ^) N& }. ^. h0 E但,回到原理图后,改成复用5次,更新PCB后又出了2个ROM及相应元件,但再次copy room formats后,却提示:“the source and destination rooms are members of different channel chasses”
2 O! E+ Y5 Q$ j0 m8 ^$ T9 ~
; J: c: r9 n0 K( v( @4 x, g1 m6 f

点评

你是不是忘记把新的两个模块的room添加进跟老模块同一个channel class了??添加进去就可以了。  详情 回复 发表于 2015-9-14 17:29

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发表于 2015-9-12 08:35 | 只看该作者
any_014 发表于 2015-9-11 16:22
  q, C! J+ Q( N% F) c谢谢回复。
* N( C* q; ^; K; W9 s/ V粘贴时允许位号重复,这个选项在哪里找呢?' d- p. M, Q" O, D5 ^
或者,粘帖的时候,能否元件标号自动重新分配?

' e4 ]+ r% i. S3 y; n特殊粘贴!可以实现位号重复!) l% l% x8 {) q+ i$ w4 P0 k  g

点评

谢谢,特殊粘帖的话,可以实现元件号重名,也可以保持原来的网络,但这样两部分电路不是就有很多飞线了吗? 今天试了层次化原理图设计,复制成功了,但敷铜没复制过来。  详情 回复 发表于 2015-9-12 11:22

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 楼主| 发表于 2015-9-12 11:22 | 只看该作者
2723498933 发表于 2015-9-12 08:35& z* r4 j. p8 U' K/ Z4 `; S
特殊粘贴!可以实现位号重复!
2 k$ F( @2 b# Y% Q( [! `( _( U$ C+ o
谢谢,特殊粘帖的话,可以实现元件号重名,也可以保持原来的网络,但这样两部分电路不是就有很多飞线了吗?0 X: N% |; Y; i9 J. _9 J
6 j1 a8 _/ v7 W& X' e% V( F: J
今天试了层次化原理图设计,复制成功了,但敷铜没复制过来。
( r: t  ^9 [" R2 P6 N

点评

很多飞线是无法避免的,除非你把两个原理图的网络都改成没有重复网络名的,这不现实; 一般你在复制之前,可以在各自的PCB检查DRC错,确认无错后在复制。 建议你把复制改为剪切,这样你可以确保是不是所有东西都  详情 回复 发表于 2015-9-14 17:33

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 楼主| 发表于 2015-9-12 15:07 | 只看该作者
本帖最后由 any_014 于 2015-9-12 15:09 编辑
% ^3 o, L; o4 H- R1 L
$ e( p. x+ G. W9 X9 P请教:sheet2复用了2次,对应的pcb中的电路为sheet21和sheet22,现在想将另一个原理图中的网络9连到sheet21网络里的9,不知道该怎么操作了。请过来人指点。
( L  o; |8 T4 T2 Q10,11,12这样连过去的话,sheet21和sheet22里的相应管脚都会连过去,不是我想要的。) l7 G. J, A# V& n# C
  X! Z$ s/ V: r* j. N/ F* c& e

' P) b+ e8 W0 {% G
/ f9 P4 [! }6 A另:本来想用总线连接的,直接联系啊[1..100]到另一个sheet里的[1..100],结果ad崩溃了。
8 \6 n- F, b, @+ b0 S" j8 ]

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发表于 2015-9-13 21:22 | 只看该作者
合并不是那么好做的,不过也还是有办法的,三言两语说不清楚。

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发表于 2015-9-14 17:29 | 只看该作者
any_014 发表于 2015-9-11 17:353 R: x9 ?% N$ H9 @& l# ~
另画了个简单的工程测试了下。
2 g% B2 \& U$ z: q2 S! m4 K' o& J3 |1 o画了个图,然后改成多通道画法,复用3次。更新到PCB后确实出现了3个ROM及 ...
  {8 D1 Z2 W6 G3 O- F
你是不是忘记把新的两个模块的room添加进跟老模块同一个channel class了??添加进去就可以了。( i+ B( e% p* ^( N1 v. }

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发表于 2015-9-14 17:33 | 只看该作者
any_014 发表于 2015-9-12 11:22- u% q7 a. c, t/ j9 q0 y
谢谢,特殊粘帖的话,可以实现元件号重名,也可以保持原来的网络,但这样两部分电路不是就有很多飞线了吗 ...

6 v- E. D; Q5 S. s( G很多飞线是无法避免的,除非你把两个原理图的网络都改成没有重复网络名的,这不现实;: A/ x5 y; v/ ~; k: A! U
+ b) @$ g' Z7 N0 ^& H5 M) a- O
一般你在复制之前,可以在各自的PCB检查DRC错,确认无错后在复制。
8 O1 V8 W" h. T  j! i! Q建议你把复制改为剪切,这样你可以确保是不是所有东西都被你复制了,剪切完源文件不要保存就可以了。% V; T6 L0 A) I0 ^( y8 X
0 n1 T: e$ r& b4 N: J
敷铜没复制过来这个问题,你试试复制的时候,对于重新铺铜的提示选择“否”% M7 h( N, H, Q8 [6 a5 N9 t
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