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EDA365电子工程师网»技术社区 › 电子技术社区 › Mentor论坛 › xDX Designer 打包的时候提示如下ERROR,是什么原因呢？
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xDX Designer 打包的时候提示如下ERROR,是什么原因呢？

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忘顰

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发表于 2015-5-11 16:44 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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xDX Designer 打包的时候提示如下ERROR,是什么原因呢？
4 ]1 g- E; a6 Z2 A- L6 R

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发表于 2015-5-11 17:52 | 只看该作者
专业顶帖的:lol:lol

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xiesonny

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发表于 2015-5-11 20:44 | 只看该作者
我是回复捞分的

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prince_yu

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发表于 2015-5-12 13:46 | 只看该作者
去检查你的AD9240的封装吧，报错信息很明显了，一般是库没建对，Pin脚没有Map上啥的

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菜鸟小泽
请问 打包的时候出现图中圈出的警报，该如何在原理图中消除呢？  详情 回复 发表于 2015-5-19 22:43
忘顰
确实是库的原因，Pin Name 中不能有空格出现  详情 回复 发表于 2015-5-13 13:52

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忘顰

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 楼主| 发表于 2015-5-13 13:52 | 只看该作者
prince_yu 发表于 2015-5-12 13:46
, c8 C$ J$ N& H* o" ~去检查你的AD9240的封装吧，报错信息很明显了，一般是库没建对，Pin脚没有Map上啥的
" O) k3 D1 H- Y: o8 E
确实是库的原因，Pin Name 中不能有空格出现" a) g0 B' l% R" R
8 x7 J4 g* q* p. n2 ]' g, L

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siminliu88

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发表于 2015-5-13 14:27 | 只看该作者
学习了

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菜鸟小泽

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发表于 2015-5-19 22:43 | 只看该作者
prince_yu 发表于 2015-5-12 13:46
/ Q1 d3 |1 h& f$ d7 n去检查你的AD9240的封装吧，报错信息很明显了，一般是库没建对，Pin脚没有Map上啥的

) p' Q& c: n+ X9 k1 C请问 打包的时候出现图中圈出的警报，该如何在原理图中消除呢？, u; K0 ?# R6 k* g) a; ?0 X3 e

IMG_20150519_093519.jpg (274.1 KB, 下载次数: 0)

IMG_20150519_093519.jpg

点评

prince_yu
警告不用管了，你如果是非DxDesigner画原理图，是其他的如pads，cadence的原理图的话，那是没有CES这个约束管理数据库的，所以警告也是正常，因为本身就没有，但这并不代表不能画PCB 如果是Dxdesigner还出现这个  详情 回复 发表于 2015-5-19 22:57

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prince_yu

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发表于 2015-5-19 22:57 | 只看该作者
菜鸟小泽 发表于 2015-5-19 22:43
2 F2 |! Z3 v4 e3 k4 Y% ~请问 打包的时候出现图中圈出的警报，该如何在原理图中消除呢？

4 z3 h! c' L. N" M6 M* V警告不用管了，你如果是非DxDesigner画原理图，是其他的如pads，cadence的原理图的话，那是没有CES这个约束管理数据库的，所以警告也是正常，因为本身就没有，但这并不代表不能画PCB9 T, e) p" D5 P4 S

5 I1 p0 G  J/ ?/ f- _3 s5 x如果是Dxdesigner还出现这个错误，那应该是工程文件不完整，建议你新建一个全新的prj，然后用file-open-block的方式打开现在的原理图，一页一页地拷贝过去，在新的工程里打包试试，只要库没问题，这样做肯定也没问题的。
% j) q( J( d. r& _4 G7 z* e% _

点评

菜鸟小泽
好的，我尝试一下，谢谢  详情 回复 发表于 2015-5-19 23:02

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菜鸟小泽

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发表于 2015-5-19 23:02 | 只看该作者
prince_yu 发表于 2015-5-19 22:57
0 E' Q0 S! U/ X3 _6 n+ X4 ]5 i警告不用管了，你如果是非DxDesigner画原理图，是其他的如pads，cadence的原理图的话，那是没有CES这个约 ...

' n0 ?% ]4 R1 ?好的，我尝试一下，谢谢( o. ?' U8 |4 i  U

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falw985

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发表于 2015-5-20 15:31 | 只看该作者
xuexiyixa

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