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二层板DDR3走线 两个信号线周围包着地是什么作用呢,

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发表于 2014-1-7 12:37 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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各位好:* r! C$ j; O: |& V  P
      图上黄色箭头指示,二层板DDR3走线 两个信号线周围包着地是什么作用呢,

二层板DDR3走线.jpg (192.59 KB, 下载次数: 10)

二层板DDR3走线,

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发表于 2014-2-11 21:47 | 只看该作者
1.阻抗要求  侧面的GND也可以控制impedance 1 t4 v4 G& J0 d& d
2.GND为了更好的信号质量,减少COMMAND间的crosstalk

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发表于 2014-2-12 13:37 | 只看该作者
1、很显然是阻抗控制用的8 ^. x: H, y- V% }5 L9 A
2、阻抗计算公式:Zo=[87/( Er +1.41)1/2]xln[5.98H/(0.8W+T)],从公式中可以看到阻抗和ER、W、H有关。其中和ER、H成正比,和W、T成反比。3 [6 T6 I0 S* c
3、在多层板中,阻抗是通过调整线框、线和参考平面之间的距离来控制单端线的阻抗的,线越细阻抗越高,平面间的间距越大,阻抗越大。但是在双面板中,由于板子厚度就是平面间距,这种情况下阻抗已经无法控制了,因为如果你要控制50欧姆阻抗的话,那么你就将需要很大的线框。- p8 u4 h  {. z# h5 e; T
3、但是DDR3对阻抗是有要求的,怎么解决呢?那就是楼主中板子的做法,采用共面线的方式来解决,即相邻的地线是信号线的参考,离的越近阻抗越小,在满足加工线宽的同时阻抗可以控制在70欧姆到80欧姆之间。对于一些普通的消费类产品,如网络机顶盒这种价格竞争惨烈的领域。DDR3的速率在800MBPS,则即便没有控制到50欧姆仍然可以跑起来的同时又将价格杀到最低从而增加竞争力。

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发表于 2014-2-12 21:25 | 只看该作者
lxizj 发表于 2014-1-7 13:241 F4 ?# p2 T1 V
1.两层板不能控制阻抗。2 a+ _! q4 [5 _; q& W  [. M
2.信号线走位包地是用来做信号的伴随地的,因为从你板子上看,bottom是没有完整地 ...
2 \0 R; O: V+ N. B9 ]4 q
谁说两层板不能做阻抗控制了,呵呵,只要下面完整完全可以啊,下面不行同层旁边也可以啊

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发表于 2015-9-24 15:33 | 只看该作者

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发表于 2014-2-12 13:39 | 只看该作者
liuxy 发表于 2014-2-12 13:37
: D1 X' `) O( f$ Y6 y. G5 A! k6 r: M# l1、很显然是阻抗控制用的+ }8 U5 [- p; K# U! |  f
2、阻抗计算公式:Zo=[87/( Er +1.41)1/2]xln[5.98H/(0.8W+T)],从公式中可以看 ...
" j; _& |: u( E7 b# p; ]
另外,楼主这个板子应该是阿里的方案

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发表于 2014-2-11 16:26 | 只看该作者
阻抗是要控制的,但是很难到达控制单端50R,这样经过信号中有地面,是提高回流性能,减小回流路径,使信号能稳定工作!

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发表于 2014-2-9 13:57 | 只看该作者
现在的智能电视方案像Mstar的都是这样走,人家还能跑1333M。

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发表于 2014-1-28 14:42 | 只看该作者
目测是海思平台的3520D的芯片,我说的对不对?

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发表于 2014-1-13 22:28 | 只看该作者
多了解了点。

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发表于 2014-1-13 16:31 | 只看该作者
这个13、14楼说的很清楚了!!就是做阻抗控制用的!!

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发表于 2014-1-11 22:37 | 只看该作者
两层板做阻抗控制叫做共面阻抗

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发表于 2014-1-10 10:52 | 只看该作者
不会上图,见附件。

2014-01-10 10 50 07.png (31.33 KB, 下载次数: 2)

2014-01-10 10 50 07.png

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发表于 2014-1-10 10:51 | 只看该作者
F:\cross\2014-01-10 10 50 07

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发表于 2014-1-9 23:37 | 只看该作者
我告诉你,两层做阻抗不再是与底面的参考层,而是与线两侧的地做。是做阻抗的。而且数字信号隔地本就减少串扰。其实原则上任意要求阻抗的线都应该两侧配地,只是现在阻抗的变化对信号的影响还在能接受的范围内。
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