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在层次式原理图设计过程中,怎么把底层的修改同步到顶层中?

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发表于 2013-12-6 09:37 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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各位:  N& n) i/ X+ n. ?, @
    小弟第一次使用层次原理图设计,所以存在很多疑惑,望大哥们解答。
0 @3 G6 H3 U/ L! o, d    采用cadence 16.5进行层次原理图设计过程中,我把底层某个部分画好以后,我在顶层生成一个块。之后发现底层有些小问题,需要进行修改。但是发现当修改以后,顶层没有随着变化。我觉得应该有个什么命令,让顶层和底层同步起来。
8 L: `/ W# E* h( [求解答!
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 楼主| 发表于 2013-12-6 15:48 | 只看该作者
chunhai6669 发表于 2013-12-6 13:54
7 K2 O8 P4 _& N$ K! `5 _我用的16.2,我以前是在顶层更新的,即选中顶层相应模块—>右键—>Synchronisze Up,然后底层的端口就被更 ...

  _( u% n% \4 X6 r) V恩! 我自己摸索,也是这么弄的! 调整顺序太惨了!6 C$ Q5 q- ]9 B9 u5 w- \. i: {3 f
我是先画好底层,在引出我需要引出的端口出来的。5 c. f9 y1 J1 }  O
之后在用画好的底层来形成block!

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发表于 2013-12-6 13:54 | 只看该作者
我用的16.2,我以前是在顶层更新的,即选中顶层相应模块—>右键—>Synchronisze Up,然后底层的端口就被更新到了顶层,自己再根据自己需要调整顺序,不知道有没有更好的方法,我也想学习学习
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