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Allegro DRC 问题

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发表于 2013-10-27 18:31 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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x
本帖最后由 tiantangzero 于 2013-10-27 18:31 编辑
! b7 n) I/ E5 U. a5 [' N2 E1 P. ]$ f8 _2 W( X. \1 t* ^. x
  今天在绕DDR Data等长时,发现为什么有时候显示DRC,有时候不显示DRC,也Update DRC和DB doctor都没有作用,求解?
4 e0 e. }/ P+ r) I/ t) v% @, u: t4 Z: S# ]; ?9 K8 h
约束区设置线距:18.5
; G- O9 l% B/ k/ g* n# J" N( a+ o5 i
图片所示:, S  [' Z4 U3 k
上面一节为10的线距
0 Q! C' I# r/ k. r2 e下面一节为18.5的线距.
6 e% Q5 w2 A  l3 q为什么上面不报错,下面的会报错,求解!
, O, g5 f- s) T  E4 b& \8 I* z+ f, U+ ^5 j* h- y3 \7 K

DDR等长.jpg (33.73 KB, 下载次数: 0)

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发表于 2013-10-28 22:33 | 只看该作者
看看报的是什么DRC,对症下药;
不疯魔,不成佛.

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发表于 2013-10-28 15:58 | 只看该作者
很有可能是下面有区域规则

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发表于 2013-10-28 14:02 | 只看该作者
上面是不是有区域规则?

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发表于 2013-10-28 13:34 | 只看该作者
可能上面的有画constraints,你打开看看
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