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rx_78gp02a 发表于 2012-4-5 21:57 * E! Q6 J1 V! ?& j2 N5 ^& i首先,你要得到fpga的顶层文件和管脚分配约束,然后在综合工具中出ibis模型,这样,你的脚是什么用途的就 ...
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rowen 发表于 2012-3-14 09:23 / g) Z5 Z* t# t3 \7 Q3 @2 j这个操作我知道,FPGA的IO口都是一样的,不会针对具体的管脚作指定的
reddevils1986 发表于 2012-3-13 21:28 9 I( l9 ?1 N h3 j3 I- q& g吧相应的IBIS模型转成DML格式 加载到SI库
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