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6层高速板 叠层阻抗控制请教

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发表于 2012-2-26 15:02 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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本帖最后由 qwea 于 2012-2-26 15:06 编辑 * r) X; R# s9 R1 W. S4 Y

7 U6 P" N' c. J: F      有一款arm板,用ddr3内存跑1066.  6层设计。叠层方式 top ,gnd ,sig1 ,power,gnd,bottm。
9 C- z: C7 i6 h9 g; b+ `4 r- vtop --   1.9mil
8 i" Q. J$ R8 Q* Ypp --     3.8mil$ S; T" N0 s( Z. L( ?5 K; g
gnd--   1.2mil5 h; j0 ]+ l: h* a& G; e( C& K
core -- 5.12mil9 v/ l- [6 E) M' p
sig1 --  1.2mil
1 |: ]$ Y5 i! UPP --  36.552mil, a" Q# j! h' p& q/ k
power--1.2mil
6 D, b7 b% e: x4 [0 U2 T* Dcore--  5.12mil2 r( }$ M, O! L' ]" k+ k$ V5 O
gnd --  1.2mil
5 B0 u$ W- H9 l; \7 R' @( `pp  --  3.8mil
  ?  n/ s* B+ v* y5 {bottm -- 1.9mil
  `( r: f$ h0 @3 \. Q& f! A# |, O5 S" W, W
要求 top,sig1,bootm   5mil 单线 50     4.5/7.8mil  差分100  ]2 ^5 A5 s. a+ c5 W% Q: n, i  E

$ W& X+ N* p3 J9 ~不知到sig1 是否可以做到阻抗?
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发表于 2012-9-10 22:11 | 只看该作者
另外你这个是假8层结构啊,很多板厂需按8层板收取工程费的!建议换位思考一下.

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发表于 2012-9-10 22:10 | 只看该作者
另外你这个是假8层结构啊,很多板厂需按8层板收取工程费的!建议换位思考一下.

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 楼主| 发表于 2012-9-10 10:32 | 只看该作者
dsws 发表于 2012-3-7 00:03 / ?7 a/ U$ I7 x; r7 @
建议你的4 5层交换一下,阻抗可以控制,ZTE常用这样的叠层。
9 F- }! g: B- v$ P
4 5层交换的话,bottom层的参考平面会容易夸分割

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发表于 2012-3-7 00:03 | 只看该作者
建议你的4 5层交换一下,阻抗可以控制,ZTE常用这样的叠层。

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发表于 2012-3-6 23:03 | 只看该作者
当然可以啊,在我的帖子里:关于多层板50欧姆和100欧姆的阻抗设计方案里有类似的喔!有空我帮你用Polar软件计算一下吧.

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发表于 2012-2-26 15:26 | 只看该作者
你这种层叠属于非常规叠层,我最近也有做过类似的叠层,你的电源层对你的第三层走线层阻抗影响不大,可以忽略,他主要还是参考第二层的地。
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