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在PADS Logic转到LAYout中怎么检查电气性是否正确和匹配

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发表于 2011-9-6 09:51 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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在PADS Logic中怎么检查电气信号。通过什么方式像Protel99中那样显示出来电路是否连接正确(电气连接线是否完好和元件PCB封装是否正确),笔者遇见画好原理图转入PCB时,不知怎么检错,而且自己画好的封装导入到PCB中找不到器件?
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发表于 2011-9-6 20:33 | 只看该作者

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发表于 2011-9-6 11:41 | 只看该作者
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 楼主| 发表于 2011-9-6 11:28 | 只看该作者
jimmy 发表于 2011-9-6 10:51 1 `" X$ [* z6 B6 a5 v
1,你在PCB界面,导入asc时,软件会自动弹出相关的信息
' p: _' K# p6 D8 B$ Z# U% G: t2,你在PCB软件这里也是要将对应的库加载进来的.
$ e0 i' D' r1 b0 r$ r6 A
多谢版主{:soso_e183:} ,问题解决了,我加载的库没有没有在同一个路径下面

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发表于 2011-9-6 10:51 | 只看该作者
1,你在PCB界面,导入asc时,软件会自动弹出相关的信息8 F; P/ Q6 |' ^1 `2 X
2,你在PCB软件这里也是要将对应的库加载进来的.
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 楼主| 发表于 2011-9-6 10:45 | 只看该作者
jimmy 发表于 2011-9-6 10:37
; v4 _( U, o0 A0 F& C" d1,logic生成网表后,导入PCB时,会提示相关的错误., G0 S, b, J: X4 M5 m
2,找不到封装,是库路径没有指定好.FILE->LIBRARY

+ _& u- A" u0 A( }1、会提示相关的错误,是怎么检查!; G& O% B0 i$ i: x# f% U
2、这个封装是我在制作Logic元件库的时候配对加载进去

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发表于 2011-9-6 10:37 | 只看该作者
1,logic生成网表后,导入PCB时,会提示相关的错误.2 @% D8 v% J0 f1 p. m. w$ T( j' y
2,找不到封装,是库路径没有指定好.FILE->LIBRARY
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 楼主| 发表于 2011-9-6 10:36 | 只看该作者
各位高手指教,在acsii文档中的显示/ J1 c( e# d! m6 Q% ?: M0 ]  ]  ~$ W- i  f
*Part name not found U15 ^9 u6 D7 d/ M
C9.2 C7.2 C6.2 U1.7 U1.9
" s9 z& e1 o+ ?7 {*Part name not found U1
; `% ?3 `/ n  f" M) OR21.2 Q6.C D16.K U1.5 # r: `0 k( J: f+ E' g! k/ P+ A
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6 A6 w: \* w+ O2 u8 m; h, xR21.1 R22.1 U1.8 U1.10
/ C" K! k5 o8 ^3 A2 [  E*Part name not found U1
) j. [: k5 H8 w  LQ2.C D8.K R9.2 U1.2
- _7 y! [  c% V) Z! y*Part name not found U1$ q# g& J5 \2 o1 F) k
Q3.C D10.K R12.2 U1.3 " M% o! v7 R+ P! |6 g9 i0 i
*Part name not found U15 ]; c; Z3 y4 d" k: x
Q4.C D12.K R15.2 U1.4 1 M' L  V4 f0 c  @" M4 A
*Part name not found U16 }8 M- `+ G" a5 i7 X" T! n# D1 V
R18.2 Q5.C D14.K U1.6
3 k1 R( a4 t1 t/ G6 H, ~*Part name not found U1: }6 x' I4 _1 o& ~
Q1.C D6.K R2.2 U1.1
8 L) l( U- O9 \$ K9 ]) ]**INPUT WARNINGS FOUND**
  d* ~2 q  o0 x9 x2 z+ [在原理图是中bom中有U1器件(自作的10P排针),导入到Layout中就没有U1的影子?& i7 h' q3 _6 Y$ u5 F$ i
求解!多谢

点评

你在PCB软件这里也是要将对应的库加载进来的.  发表于 2011-9-6 10:51
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