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EDA365电子工程师网»技术社区 › 电子技术社区 › SI/PI仿真论坛 › 急！！！关于hyperlynx仿真的问题
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[HyperLynx] 急！！！关于hyperlynx仿真的问题

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cccccc32

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发表于 2011-6-29 17:50 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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本帖最后由 cccccc32 于 2011-7-4 13:42 编辑
* k4 U8 V% n' U* k0 E) L4 y8 h/ S# {" z
各位好！5 J9 ?7 d  ]% p: t. i5 p6 [) d5 j
      请教一个问题，我用hyperlynx7.5仿真，导入的ibis模型不能识别，ibis模型的修改日期是2011.1.25，请大家帮忙确认一下会不会不是hyperlynx版本太低打不开这个模型呢？
6 L# ]" S9 L4 o+ _     另外有没有人遇到此类问题啊？9 ?9 X" r5 h( ~9 ?( H
     谢谢！9 o, |$ l. n' f9 e8 J, y
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cccccc32

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 楼主| 发表于 2011-7-8 16:26 | 只看该作者
回复 icy88 的帖子
" X7 K3 D' H3 ?- e  y
. V4 r+ C9 e4 h  e9 X% @! c好的，我目前正在做仿真，做完后我整理一下，把遇到的问题和解决方法跟大家分享一下，不过可能只适用于入门级的，呵呵！& K0 R" R4 _! d, l4 i
我以前用过hyperlynx7.5版本的，但已经三年不用都忘记了，现在用8.0版本的，所以基本上是从头学起了。: O- z9 R5 F9 h; y

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icy88

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发表于 2011-7-8 16:23 | 只看该作者
楼主有时间分享下你遇到的问题的解决方案吧，让 大家学习学习啊

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cccccc32

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 楼主| 发表于 2011-7-8 12:45 | 只看该作者
回复 forevercgh 的帖子- K4 q  \/ c- L- ]9 @; O
9 w/ b/ u/ q/ N$ w0 N: R8 y
嗯，谢谢！呵呵，以后有问题还请您再多多指点。0 f5 B8 L  y2 L, A; I

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forevercgh

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发表于 2011-7-8 12:39 | 只看该作者

) u8 w; S  q2 _! a& r- m恭喜下，终于搞定了
sagarmatha

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 楼主| 发表于 2011-7-8 09:59 | 只看该作者
回复 forevercgh 的帖子
3 E! G4 v, Q# V' S+ c; w3 W* s. O; A  x% F7 V6 B. {
您好！1 H0 L9 C9 F, U0 M9 s2 A, G, o
      问题已经解决了，是我没有进行叠层参数设置造成的； 谢谢您的帮助！
* y" y% x, O, M& t4 a, ~. K

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 楼主| 发表于 2011-7-8 09:58 | 只看该作者
已经解决了，是我没有进行叠层参数设置造成的； 谢谢的帮助！

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cccccc32

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 楼主| 发表于 2011-7-6 11:59 | 只看该作者
回复 forevercgh 的帖子
6 g  y- F% [! y+ d8 ~2 x- O. [/ F( _$ Q0 w& ]* L% O# |: I4 z
您好！
. j  Q  W8 n% t9 R7 B     我导入的时候已经能看到铺的铜了，但是打开的时候还是出现错误提示，我抓了两个图，请您看一下，万分感谢您的指点！6 q: ?* ^# w$ P4 A

警告1.JPG (35.79 KB, 下载次数: 0)

警告1.JPG

警告2.JPG (36.29 KB, 下载次数: 0)

警告2.JPG

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 楼主| 发表于 2011-7-6 11:44 | 只看该作者
回复 forevercgh 的帖子. d1 D; i" d( i* R; O
  ^+ V1 {3 l6 l- V( E
您好！; L- V8 b3 Z& u; Y# l
      我检查看了一下PCB本身的叠层参数设置是没问题的，导入hyp以后editor stackup的叠层设置也跟PCB一样，板子的OUTLINE也没问题，重新导入打开还是和原来一样，不知道是怎么回事。哎
2 n3 ~' G+ p+ @3 w9 s6 ]. d! U/ K5 J

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 楼主| 发表于 2011-7-6 11:31 | 只看该作者
回复 forevercgh 的帖子0 n( S, X( C( u6 C9 k4 f( Y0 R
& I+ Z  u, G9 I5 D" h! v
是我板子OUTLINE的问题呀？我再重新导出试试，谢谢您的指点，谢谢！
0 |: q. L1 M% T; c2 n7 G

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shuanzi998

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发表于 2011-7-5 16:05 | 只看该作者
xuexi

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发表于 2011-7-4 20:26 | 只看该作者
你源PCB文件的叠层 和 板框 没有正确设置。造成导出phy文件异常。
3 J5 d" G- T/ l: _
sagarmatha

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 楼主| 发表于 2011-7-4 13:30 | 只看该作者
回复 forevercgh 的帖子& P3 X* T0 ^$ @

7 y- ?# g, s: Z$ p- @* t! I您好！7 X: S7 v# b0 d+ U
      .hyp文件已经上传，PCB文件没办法上传，很抱歉；不过PCB文件时没有铺地及没连接网络或者相关的DRC错误，只有几个thru pin之间间距的DRC，这类错误是一个封装做错了导致的；7 o/ u( w7 C4 s. G- }! l- \. J7 `
      谢谢您的帮助，非常感谢！/ i+ m3 Y9 g! J4 [2 p7 I3 d

svpas.zip

209.56 KB, 下载次数: 12, 下载积分: 威望 -5

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forevercgh

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发表于 2011-7-4 12:32 | 只看该作者
上传PCB源文件以及你生成的hyp文件
sagarmatha

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 楼主| 发表于 2011-7-4 09:20 | 只看该作者
回复 forevercgh 的帖子3 y$ C6 x8 r  ]' R

2 N4 c+ t- k0 D& u: a5 S2 X0 p, W你好！
* V; e: ?# H) i9 r. s3 f      我重新从PCB导出文件，应hyperlynx打开是没问题的，但看不到有铺地的铜皮啊，是不是这样就代表还是有问题呢？, W8 J+ ^5 I* f, u

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