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[仿真讨论] 关于IBIS的bufferdelay问题

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发表于 2011-4-24 17:05 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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本帖最后由 chuxuezheyao 于 2011-4-24 17:05 编辑
* X6 A, p( d! P. |2 Y2 h* B- W3 E7 o& X  J! P9 Y  e
学习了各位高手关于SQ时序仿真的精彩论述,收益匪浅,做了一个测试,有点疑问:- _( g, X' _8 U( {$ z3 l8 |3 T
IBIS模型:$ c( j& C/ ]  ^& p2 m. f+ S
6 E5 ~, ~/ R# }; `' t: x; m0 x3 D
按照模型建立拓扑:# u* A& X/ N* S) r: G: s( Q
9 W0 a% O# l: G7 z5 k# i; R1 }
设置delaymeasurement:, B& X9 I4 t& g% A& S' d0 U

! R6 v- k9 e# v  L9 Y! b仿真结果如下:5 Q2 q) M! |( A+ ^! t( M  d" }, ?' K
8 a0 p7 ^- P2 `. H0 Y
9 ?7 C7 M2 r  K9 \2 \9 @* g% b
图中bufferdelay与IO波形重合2 y% C: P+ Z* l; h3 }1 N: w# J
由于测试条件与数据手册中不一致,按照数据手册设置并仿真:
* ?, x  z- B. i8 I+ _% K $ P' P' ^5 l. q/ @! r% Y

( S* ^1 y. q& n4 |4 k4 a& a0 r图中,bufferdelay波形与IO波形不再重合,但bufferdelay波形没有变化。这与大家提到的bufferdelay与实际负载相关的观点不一致。
8 C; O1 T8 G% i! F继续测试:# N& @& b8 X* D! O* Q

. G( ?9 a0 S+ S' C$ `! k改变测试条件并仿真:5 e/ j. N; _# {2 ^! q
; L# r2 `; P' G: M
4 G. w/ {& ?+ j8 l5 V) {

" D+ T0 n) s2 ^8 l: @* J5 v) e' G% q$ o根据数据手册改变delaymeasurement:' C7 N" ~# u6 x: Q  l/ U4 N
2 O2 p3 H9 o5 o! c# S+ Q7 H% |7 G

8 A5 v& w  ]) Q4 h( S. K1 q" Ebufferdelay的波形始终都没有变,难道设置delaymeasurement中的textfixtures对仿真没有影响(我的理解应该是有影响的,但测试中没有影响),既然没有影响为什么“中兴通讯手册”中专门提到修改这个值呢?

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发表于 2011-5-26 13:01 | 只看该作者
本帖最后由 dzkcool 于 2011-5-26 13:40 编辑 2 \+ x3 \3 H2 L9 o* H8 Q' X( A, a- z
3 b2 t. B* t) _% e0 d5 Z4 {
经过实验,发现delaymeasurement里面的测试负载值会改变Buffer的波形;* |' r6 G, J6 E
在相同的delaymeasurement里面的测试负载值情况下,而仅仅修改拓扑的负载,改变的是接收端的波形,对Buffer的波形不会有任何改变。: k& ]/ a, J+ F  Q; ~8 \. Y' V( T

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 楼主| 发表于 2011-5-6 22:00 | 只看该作者
在library里的modelbrowse里修改测试条件会改变IBIS模型里的数据的

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发表于 2011-4-30 16:20 | 只看该作者
按照你的拓扑,不同的测试条件下的IO波形即是BufferDelay的波形。5 I& K% ~) K9 \1 S0 p, j
如果你在仿真参数里面设置的BufferDelay是On-the-fly的话,那不管你用什么样的测试拓扑,BufferDelay的波形都不变,除非你把ibis模型里的测试条件改了。

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发表于 2011-4-28 13:52 | 只看该作者
影响i/o啊!

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 楼主| 发表于 2011-4-28 12:44 | 只看该作者
数据手册中给出的时序是在一定的测试条件下的,计算时序要用到这些参数,但IBIS模型测试条件与数据手册不一致,但根据手册更改测试条件,仿真结果不受影响,我想弄明白这是为什么?

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发表于 2011-4-27 17:05 | 只看该作者
激励是理想的波形,ibis的buffer输出波形,跟ibis中rising ,falling曲线等有关系,ibis确定后,其相关曲线数据也就是一定的,这些相关的数据得出也是由芯片厂商测试所得,因此要设置测试条件,来保证I/O输出的正确性。

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 楼主| 发表于 2011-4-27 14:52 | 只看该作者
bufferdelay measure 设置测试条件,按理说测试条件不同,bufferdelay会不同的,但我的试验是没有影响的,这是我的疑惑,我认为激励既不是IO输出也不是buffer的波形,是没有经器件内部逻辑输出之前的理想波形。我是新手,说的不对,请大家拍砖!

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发表于 2011-4-27 09:04 | 只看该作者
楼主做的实验bufferdelaymeasure会影响I/O输出么?我们所用的激励是i/o输出还是buffer的波形呢?

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发表于 2011-4-25 11:34 | 只看该作者
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