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我在pads9.3中的一个低级错误,大家别再犯了!

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发表于 2011-4-13 14:25 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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我画好logic图后,直接与layout连接,开始工作,过了一会儿发现有一个元件就是没有,怎么弄就是不对,$ j  n) B& x  i7 K
折腾半天发现,是我没有把库加到layout里,总结经验如下:
- e3 W0 k1 t* u6 P1、在logic画原理图,在库管理中加入自己做的库后,在layout中要重复这一步骤,同样要加入,我这次的错误就是为了尝鲜,从2007.4转到9.3画第一个板子,没有注意加库;7 I# x3 q7 ~8 U; c! c/ @9 t
2、没有找到封装,pads有时候报错,有时候不报错,报错的时候如果是没有封装,第一反应要查看是否把库加了
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发表于 2011-10-17 13:02 | 只看该作者
总结是一种良好的习惯,分享是一件快乐的事情,这个工作就是喜欢范低级错误!

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发表于 2011-10-17 10:25 | 只看该作者
回复 shenzhou8hao1 的帖子* V# F1 w4 R$ Y1 w4 k) E" P6 [7 A

( h* W9 j- i7 g' i7 u; S+ g8 J6 H9 v% X做完原理图后DRC检查一下,这些问题都可以检出来! # O9 L# U3 @$ f0 d+ o* l- d
" ~! v! k8 G, N% n) o

. R# x6 w# ]- X/ X/ Q原理图怎样弄DRC,请指点一下!

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发表于 2011-10-10 08:35 | 只看该作者
我也有这样的事,不过我自己找到方法; O+ J0 _8 O. ]% Q6 g3 v7 \

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发表于 2011-5-14 21:51 | 只看该作者
学习!

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发表于 2011-5-14 21:31 | 只看该作者
原理图怎么DRC

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发表于 2011-4-14 23:14 | 只看该作者
那是

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发表于 2011-4-14 20:50 | 只看该作者
哈哈,万事开头难,多总结总是好的。

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发表于 2011-4-14 20:02 | 只看该作者
回复 shenzhou8hao1 的帖子
+ L9 z* u# g+ V$ c* E( w% }  T: B
做完原理图后DRC检查一下,这些问题都可以检出来!

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发表于 2011-4-14 14:25 | 只看该作者
回复 shenzhou8hao1 的帖子
6 p1 b% N0 @4 ~. M* O) g- [8 t+ \" U+ `' W2 A' ?% i' b
导入网表后再看一样的吧。我就是这样看的。

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 楼主| 发表于 2011-4-14 13:40 | 只看该作者
问题是开始的时候没有报错,后来新建了一个logic和pcb文件试验,才报错,才发现问题。

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发表于 2011-4-14 13:02 | 只看该作者
我也刚学,这问题只是库的使用的问题,和版本没关系,不过我还有个问题,就是做好原理图后,因为之前没注意每个元件是不是都有PCB封装,那么这时候,在导入Layout前怎么检查元件都有没有PCB封装?有什么快捷的方法吗?
' {7 U6 K2 q& W( A: V

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发表于 2011-4-13 16:00 | 只看该作者
哈哈,和哪个版本无关啦,主要是元件库的关系没弄明白哦。

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发表于 2011-4-13 15:46 | 只看该作者
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