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求助,用capture生成的tel网表导入allegro发生错误

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发表于 2010-4-20 14:03 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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别人发的brd和dsn。用capture生成网表。用的是other, telesis.dll。生成网表时没有报错。cobined property那栏也填了 PCB Footprint。 当导入allegro时,出现# w  |1 \* L6 d
4 W: y# U3 S- U# Y* C$ H
ERROR(SPMHNI-113): Expected ';' , found an illegal character, line ignored.- `1 B1 V& F4 i: Z! N4 S, V6 y$ D  _
-------------------------------------------------------------------------------
& Q+ n, }- b+ n/ w( G& z- ?
9 O9 x3 G9 A; a2 q# K/ R请问这是怎么回事呢?哪里出了问题?应该怎么改?大概有13处这种问题。先谢谢大家了。
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 楼主| 发表于 2010-4-21 10:48 | 只看该作者
谢谢大家。后来发现是PCB的封装里将元件的定位孔定成了管脚,而原理图里没有这个管脚,所以对应不上。用别人的东西真的是要仔细查呢。

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发表于 2010-4-20 19:49 | 只看该作者
把PCB Footprint换成 'PCB Footprint' 试试

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发表于 2010-4-20 19:39 | 只看该作者
回复 2# leemy
1 [! g6 k6 X3 n9 l- q% m% O; [: b/ T% E# ^8 K0 b* c2 l% k
/ \* q: k3 P/ t/ W
    如何用第三方软件去掉非法字符

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发表于 2010-4-20 17:38 | 只看该作者
原理图有非法字符,你可以用第三方软件去掉非法字符
高效率的工作:快速,低成本,零偏差,三者缺一不可。
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