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pads 连通性检查出错？

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leoyin

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发表于 2009-10-28 16:25 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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本帖最后由 leoyin 于 2009-10-28 16:26 编辑 & V- M  w* ~- \

3 j: v# ?; o; I请问各位大虾：我的pcb设计中明明已经有走线连通，为什么connectivity检查时还会报错啊？？？

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 楼主| 发表于 2009-10-29 15:53 | 只看该作者
把VIA里的STITCHING VIA全部勾掉的话，stitching via的错误消失了，不过还是有些明显连通的via或引脚上会报错.

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leoyin

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 楼主| 发表于 2009-10-29 15:39 | 只看该作者
是啊，物理上我是用走线连通了的，但是有的飞线还是存在，是什么原因呢？

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zhuxiaping2009

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发表于 2009-10-29 15:19 | 只看该作者
用的是PADS2007么，如果是的话。把VIA里的STITCHING VIA全部勾掉

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gaojun39

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发表于 2009-10-28 19:53 | 只看该作者
看到还有很多飞线怎么能叫全连了？

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