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2017年12月20日QA检查报告节选

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发表于 2017-12-21 09:00 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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1.CLK应做等长5 K& n% t: x9 E0 A% h3 U1 B* y& M
, T- ]7 O* Y2 C1 @( }
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发表于 2018-1-2 09:50 | 只看该作者
EDA365QA 发表于 2017-12-21 09:019 P- q' n  u- ^
4.46V内层孔与铜的间距加大到30MIL。

2 w) _! m7 ]/ W- h, h+ F& H* u请教一下:一般电压超过多少时会要求孔与铜的间距加大?! |' a$ p3 R& }6 a9 A3 r9 `' E8 c4 \

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发表于 2018-1-5 17:11 | 只看该作者
EDA365QA 发表于 2017-12-21 09:01
7 ^8 G$ i9 q9 d- Y- G, O3.DVI的线需做等长

* p1 [) f5 {5 r# Y右边这个net框可以同时这样高亮一组线?以前还真没这么用过。

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 楼主| 发表于 2017-12-21 09:01 | 只看该作者
4.46V内层孔与铜的间距加大到30MIL。
; L0 J7 r6 j- B/ |+ K. }  j 7 x, t( O4 b" Y

点评

请教一下:一般电压超过多少时会要求孔与铜的间距加大?  详情 回复 发表于 2018-1-2 09:50

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