2017年9月25日QA检查报告节选

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pcb

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南林维京

最好加路径上详情回复发表于 2018-1-15 15:21

pcb

测试点应加在布线的路上. 详情回复发表于 2017-10-17 13:58

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EDA365QA

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EDA365版主(50)

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推荐

楼主| 发表于 2017-9-26 09:04 | 只看该作者

2.器件中间的散热焊盘没钢网，需要修改封装

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南林维京

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25^#

发表于 2018-1-15 15:21 | 只看该作者

bingshuihuo 发表于 2017-10-17 08:49. e8 L$ S* x% D1 x, E& v
时钟测试点应该怎么加？

最好加路径上

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fengyu6117

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24^#

发表于 2017-11-1 17:37 | 只看该作者

这个家伙很懒，从来不写个人签名。

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biblejj33

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23^#

发表于 2017-10-24 23:51 | 只看该作者

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小四月

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22^#

发表于 2017-10-23 13:05 | 只看该作者

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陆大少

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19^#

发表于 2017-10-16 18:18 | 只看该作者

EDA365QA 发表于 2017-9-26 09:05
% @1 o2 F# G! Q, A( V6.光耦前后隔离

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wx_SHOh21dw

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18^#

发表于 2017-9-28 22:37 | 只看该作者

感谢分享

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攻城拔寨

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17^#

发表于 2017-9-27 09:32 | 只看该作者

传道受业解惑

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qilinwang66

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16^#

发表于 2017-9-27 09:02 | 只看该作者

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guhanzuiying

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15^#

发表于 2017-9-27 07:54 | 只看该作者

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紫菁

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版务助理

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14^#

发表于 2017-9-26 17:15 | 只看该作者

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Pang8343569

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13^#

发表于 2017-9-26 10:43 | 只看该作者

谢谢

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zhm

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12^#

发表于 2017-9-26 09:35 | 只看该作者