EDA365电子工程师网

标题: 动态铜不避让np孔(没有网络属性,不镀铜的孔) [打印本页]

作者: gavinhuang    时间: 2017-9-8 15:22
标题: 动态铜不避让np孔(没有网络属性,不镀铜的孔)

2 r# ^' ]/ X6 W* }: |为什么动态铜不避让np孔(没有网络属性,不镀铜的孔)?其它有网络属性的都避让好好的,这是怎么回事?
8 x& v7 J* l2 l' F以前画过类似np孔的,都避让了啊,constraint manager里面的shape to hole 也设置避让了。" w; t1 l, P9 L0 `- p

7 m  O+ q5 }9 s1 v  n" P. q  e. [
  F  G" u+ p9 O5 J* K- S
2 T. C, Q6 G5 m1 w0 s
作者: paul_iw    时间: 2017-9-8 15:49
把铜皮update一下
作者: 紫菁    时间: 2017-9-8 15:57
画一个禁布区
作者: gavinhuang    时间: 2017-9-8 16:04
paul_iw 发表于 2017-9-8 15:49
( Q2 a5 R' }+ ?把铜皮update一下
( {5 Y$ b4 ^6 [# S: v0 s
试过update铜皮,不行
. i) G5 P0 V. T- [
作者: gavinhuang    时间: 2017-9-8 16:07
紫菁 发表于 2017-9-8 15:571 j0 h8 n. D8 N
画一个禁布区

2 z: _; l3 }  B7 T5 ^6 Q- E2 X- A. T如果这种孔比较多呢?或者漏掉哪个孔呢?挨个画禁布毕竟不是长久之计。我画上个板子的时候这种情况能够自动避让,不知道为什么这个板子不行,没找出哪里有问题。
9 }1 }2 {7 o) |! p5 t
作者: a2251247    时间: 2017-9-8 16:11
gavinhuang 发表于 2017-9-8 16:07. C/ m5 r. Q8 W: M8 O) z' }) ~
如果这种孔比较多呢?或者漏掉哪个孔呢?挨个画禁布毕竟不是长久之计。我画上个板子的时候这种情况能够自 ...
) N& W2 w& l+ O. }/ }4 g1 |
发PCB出来4 |1 b9 S7 |+ c" k" K

作者: gavinhuang    时间: 2017-9-8 16:14
a2251247 发表于 2017-9-8 16:11" R* B& g6 V4 u6 P8 w/ x
发PCB出来
, G, p3 F3 o% f5 ]( d6 c% s- c
公司的在研产品,发PCB出来不合适啊
3 u3 R' `6 X; P  f8 y
作者: yangjinxing521    时间: 2017-9-8 16:20
哈哈。。。不合适。。。。
作者: gavinhuang    时间: 2017-9-8 16:45
yangjinxing521 发表于 2017-9-8 16:20
3 m. r7 h4 @1 M) ^哈哈。。。不合适。。。。

9 l4 y2 r9 p7 @7 [  w: E$ g$ u5 j你有没有遇到过这个不避让的问题?求赐教啊
; p0 @2 `1 `4 G/ T9 @
作者: wx_QrS6HGIt    时间: 2017-9-8 19:21
update
作者: Chen_ZS7V2    时间: 2017-9-8 22:15
参考附图,设置下Hole到其它的Space

新建位图图像.png (57.13 KB, 下载次数: 3)

新建位图图像.png

作者: gavinhuang    时间: 2017-9-11 11:37
wx_QrS6HGIt 发表于 2017-9-8 19:21. ?" R: h4 M& j6 z
update
& D! _" {* B- e7 m- i; A1 ~
update之后也不行
' B* Z; v3 G. E5 u+ e
作者: gavinhuang    时间: 2017-9-11 11:37
Chen_ZS7V2 发表于 2017-9-8 22:15* X) H- a* Z+ w: G! N5 S7 n4 e: E! L
参考附图,设置下Hole到其它的Space
" Z  X% T. Q- e6 z
你说的这些设置都设置过了,也不行
, P; V; G6 w3 e% ]- H
作者: eda1057933793    时间: 2017-9-11 13:21
你看下规则管理器里设置的shape到hole的间距是多少。
作者: gavinhuang    时间: 2017-9-11 13:28
eda1057933793 发表于 2017-9-11 13:21
8 P+ V# f3 z8 ]- O6 c- `$ D' Z& L* n你看下规则管理器里设置的shape到hole的间距是多少。

# f; G- v" o- G, U) |我在规则管理器中设置的shape to hole距离是15mil
0 _& N9 u3 X' j! T5 w0 \
作者: eda1057933793    时间: 2017-9-11 13:36
那你看下板上其他位置的非金属化孔避让没有
作者: eda1057933793    时间: 2017-9-11 13:37
本帖最后由 eda1057933793 于 2017-9-11 13:40 编辑
/ m; ]3 W" V4 V; q2 v: X2 S: Z( D; L" H' ?' J& C
或者是不是没注意把这个非金属化孔连上网络了。# d# r; U& `5 s% C8 ?

作者: gavinhuang    时间: 2017-9-11 15:02
找到原因了,这个np孔在Pad_Designer建立的时候勾上了Mech pins use antipads as Route Keepout;ARK,而anti-pad设置为NULL(应该默认是0)。
, Q( q! G4 f3 l; T+ g$ P
( p4 ?% h) F( u$ R  [# v所以,以后建立np孔的pad的时候,以下的做法应该二选一(目前还不知道哪个好):: D( K/ G0 `' C
1、不勾选Mech pins use antipads as Route Keepout;ARK的话,anti-pad的值可以不设置(NULL),动态铜避让的距离应该就是你在规则管理器里设置的shape to hole的值(如果anti-pad设置了值应该也不会有问题,我猜应该是哪个值大按哪个避让吧);
# l6 ~% \8 d8 \( B7 M& L2、勾选Mech pins use antipads as Route Keepout;ARK的话,anti-pad的值必须有值,动态铜避让的距离应该就是你设置的anti-pad的值。  Y5 g2 R: I) A3 V
2 ^* y- S* X2 E  Z. M$ C
; n6 a( `; x  ~) g! f8 _
) I" U- ^$ m: a% z' w
. ~% i& I+ Y" i  s

作者: eda1057933793    时间: 2017-9-11 15:10
anti-pad对负片层有效,正片层按照规则避让。
作者: gavinhuang    时间: 2017-9-11 15:12
eda1057933793 发表于 2017-9-11 15:10
; ~7 f6 r; M7 u1 f# W8 o# z& nanti-pad对负片层有效,正片层按照规则避让。
8 y/ d0 d3 y5 d" ^
我用的是正片
6 e; k  N& c6 N! @
作者: wx_QrS6HGIt    时间: 2017-9-11 15:40
wx_QrS6HGIt 发表于 2017-9-8 19:21
7 {/ K9 _; s) L. W- _! }/ Hupdate

) ^0 R! v6 n# a0 p& d  a禁步
作者: sketty    时间: 2017-9-12 14:10
为什么要勾上Mech pins use antipads as Route Keepout;ARK?从来没勾过。。。
作者: gavinhuang    时间: 2017-9-12 16:27
sketty 发表于 2017-9-12 14:10
7 H8 R. o* }5 J2 R为什么要勾上Mech pins use antipads as Route Keepout;ARK?从来没勾过。。。
1 F7 w7 O, b/ [9 q1 p% l+ p+ d
我自己建的时候也没勾过,我这个封装是用的开发板的,开始没注意到它勾了,而且我把它设置的anti pad给删了,所以才导致了这一系列问题
% p0 V! f6 n' z
作者: LIF0413    时间: 2017-9-19 09:30
gavinhuang 发表于 2017-9-12 16:27
/ R( X5 e- h& }3 ^我自己建的时候也没勾过,我这个封装是用的开发板的,开始没注意到它勾了,而且我把它设置的anti pad给删 ...

7 ]) u; w! L3 s" g4 l8 n我之前也有遇到过铜皮不避让NP孔,但是我的有网络,我研究了好久也不知道是什么问题,就像你说的所有设置都是没有问题的,板上有很多一样的NP孔唯独就是那一个不避开,只有重新覆一下铜就避开了,可这种问题没有找到根源以后要是万一再出现就麻烦了,一般检查板子都是看有没有DRC,谁还会注意到这种问题,我的没有勾上Mech pins use antipads as Route Keepout;软件还是出现BUG了
作者: zongqiaoyu    时间: 2017-10-20 13:24

# ]9 M- X; r% l6 x4 J  o: ?画一个禁布区




欢迎光临 EDA365电子工程师网 (https://bbs.elecnest.cn/) Powered by Discuz! X3.2