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2017年8月24日公益PCB评审报告节选

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发表于 2017-8-25 08:31 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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1.  参考层不一致.
6 Q8 q( u1 I5 |0 g * s1 T! @( c- D$ m: l8 {
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 楼主| 发表于 2017-8-25 08:32 | 只看该作者
4.  网口中心抽头加粗,还有一根黄色的没接通开路.6 C3 J) M0 i; f" I  l: A& n0 g

5 ]: e6 U( [: h7 b2 x

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 楼主| 发表于 2017-8-25 08:36 | 只看该作者
10.  天线隔层参考下有走线,参考面不完整." j/ d8 N! o( F& @9 |) E; _" i
; z. X, B' ^9 A$ c

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发表于 2017-8-28 08:37 | 只看该作者
6688hyc 发表于 2017-8-26 09:039 [0 J; ^5 _7 y, c
顺便问一下 clock匹配为什么要在末端?

2 J1 K! F& k6 S- q% r& o为了不产生反射.0 W( S2 q7 m) I+ ]

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发表于 2018-1-15 11:36 | 只看该作者
学习了,谢谢楼主分享!

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发表于 2017-8-29 16:51 | 只看该作者
学习一下

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发表于 2017-8-26 09:03 | 只看该作者
顺便问一下 clock匹配为什么要在末端?

点评

pcb
为了不产生反射.  详情 回复 发表于 2017-8-28 08:37

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发表于 2017-8-26 09:02 | 只看该作者
给力 我的哥

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发表于 2017-8-25 16:28 | 只看该作者
很棒
8 S. E* i) C0 g# ^1 u

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发表于 2017-8-25 09:16 | 只看该作者

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发表于 2017-8-25 08:56 | 只看该作者
支持,感谢分享

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 楼主| 发表于 2017-8-25 08:35 | 只看该作者
9.  CLK匹配应在末端,差分要多耦合.
: e( T, M3 f' X6 n
% ]$ g2 {: t; d! ?7 V

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 楼主| 发表于 2017-8-25 08:34 | 只看该作者
8.  模拟线加粗.5 R+ \2 J6 V: J

+ @4 C& @1 Z! x& r, F9 H/ f4 ?

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 楼主| 发表于 2017-8-25 08:34 | 只看该作者
7.  电源要加粗.4 l8 n) C, f. G& ]( Y  M/ c- |

. k2 n7 E3 V+ i9 F* T* ^

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 楼主| 发表于 2017-8-25 08:33 | 只看该作者
6.  器件没钢网.3 `: h( ^1 ]0 t$ R; Y; o/ L
; Z' {' O" @/ ]% d; f! e2 U

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 楼主| 发表于 2017-8-25 08:33 | 只看该作者
5.  有线跨分割.
" B* t9 f6 f( N: O- [
9 d9 H/ E7 N( B2 v* D
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