高速信号走线问题

lc1234 · 发表于 2016-9-25 14:42

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大师们！请教你们一问题，像这里的是以R1 R2 R3为组画在同层好还是以UP0 FP0 FP1 FP2 为组画在同层好了

lc1234 · 发表于 2017-4-1 00:33

lc1234 发表于 2016-9-27 22:24! {3 ?3 {2 r- [+ P' V4 V( c
呵呵

多谢

lc1234 · 发表于 2016-9-27 22:24

小帅哥在江苏发表于 2016-9-26 09:49

呵呵

lc1234 · 发表于 2016-9-27 22:24

不期而遇发表于 2016-9-27 09:33
2 U6 F4 s/ H: L% a& q同组同层好像是为了满足什么阻抗要求吧

呵呵！

lc1234 · 发表于 2016-9-27 22:23

lhyy511 发表于 2016-9-26 09:07! p P# k9 |% D& c# p5 C ~) a5 O- T* h
尽量满足硬件工程师需求吧

嗯！多谢

lc1234 · 发表于 2016-9-27 22:23

fei 发表于 2016-9-26 09:146 E3 b, l) N7 K! x3 f) Y0 R0 j
收发分层走，能在内层尽量走内层。你的高速线是多少G.你问下硬件哪是收发好像命名没分清。

明白了！多谢

lc1234 · 发表于 2016-9-27 22:22

lhycmyy_hawk 发表于 2016-9-25 16:461 i9 u% e9 c- [0 w
我的习惯是，顺序如下/ U5 }- t1 w6 @
1，看layout guide
; p+ R) P9 z1 t2，看参考设计

好的！谢谢

不期而遇 · 发表于 2016-9-27 09:33

同组同层好像是为了满足什么阻抗要求吧

小帅哥在江苏 · 发表于 2016-9-26 09:49

fei · 发表于 2016-9-26 09:14

收发分层走，能在内层尽量走内层。你的高速线是多少G.你问下硬件哪是收发好像命名没分清。

lhyy511 · 发表于 2016-9-26 09:07

尽量满足硬件工程师需求吧

lhycmyy_hawk · 发表于 2016-9-25 16:46

我的习惯是，顺序如下
1，看layout guide
2，看参考设计
3，怎样好看
4，和硬件工程师沟通

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