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EDA365电子工程师网»技术社区 › 电子技术社区 › Allegro&Orcad PCB论坛 › 请教个allegro ---route keepout的问题
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请教个allegro ---route keepout的问题

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DIY民工

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发表于 2016-6-22 17:31 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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问题是这样：
/ B. _) B0 Z- S  M, d       DDR封装的对角出有个90度直角的定位标志，是由两条金属（导电）属性的线组成，这个可能是做DDR封装的人故意这样做的，我的实际PCB板中TOP层铺铜我不想让GND进入DDR里面去，所以画了一个矩形的ROUTE KEEPOUT ，可是那个90度直角的定位标志也在里面且报错，请问哪位大神有办法把这个DRC给解决掉，如图：
8 H* Y( Y5 x! ]* i& [& m+ c6 I: Y! D9 }. C& o7 S! L; {7 N

. g& T) e5 f/ m; J  w# R
; m2 n1 }" h  ^* m) H
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leasing

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发表于 2016-7-19 17:40 | 只看该作者
不用route keepout画，用anti etch画，就不会有报错了

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骑驴撵大奔

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发表于 2016-6-30 15:48 | 只看该作者

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J蓝虹

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发表于 2016-6-23 16:37 | 只看该作者
DIY民工 发表于 2016-6-23 16:10
7 u* J3 a& O/ B. O  T谢谢大家的回复，我今天只能用挖空的方式处理，我在想我要是忽略这个地方的错误，后期直接出gerber会不会有 ...

4 @2 k9 X4 k' l3 |6 ~3 i, Z+ vDRC是自己加keepout引进来的，不是走线进到原本有的keepout上，waive掉不会有问题。觉得应该查一下这颗料为什么要建个trace在上面，如果不需要就删除掉

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DIY民工

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 楼主| 发表于 2016-6-23 16:10 | 只看该作者
谢谢大家的回复，我今天只能用挖空的方式处理，我在想我要是忽略这个地方的错误，后期直接出gerber会不会有什么问题 呵呵

点评

J蓝虹
DRC是自己加keepout引进来的，不是走线进到原本有的keepout上，waive掉不会有问题。觉得应该查一下这颗料为什么要建个trace在上面，如果不需要就删除掉  详情 回复 发表于 2016-6-23 16:37

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li262925

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发表于 2016-6-23 15:58 | 只看该作者
习惯性  VAIVE

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不要命的荨麻草

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发表于 2016-6-23 10:01 | 只看该作者
或者waive忽略掉也行啊

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980155498cai

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发表于 2016-6-22 22:16 | 只看该作者
把那两条线change到丝印层就好了，或者挖开也可以的

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584511743

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发表于 2016-6-22 20:33 | 只看该作者
挖开就行了。。。

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wwddss_1976

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发表于 2016-6-22 18:47 | 只看该作者
给区域添加允许走线的属性

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DIY民工

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 楼主| 发表于 2016-6-22 17:52 | 只看该作者
yangjinxing521 发表于 2016-6-22 17:44
8 H: [4 a9 i1 D; w: f; Q# o" Y  W挖开就行了。。。

/ Y% G: E7 u4 @" y除了挖 没有别的办法吗？6 K! e7 u* z, u9 P3 G
类似在route keepout里可以包含走线和过孔这样的方式处理  G: d* I9 g3 [8 b" v6 {: {

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yangjinxing521

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发表于 2016-6-22 17:44 | 只看该作者
挖开就行了。。。

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DIY民工
除了挖 没有别的办法吗？ 类似在route keepout里可以包含走线和过孔这样的方式处理  详情 回复 发表于 2016-6-22 17:52

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