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发表于 2016-3-24 07:32 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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发表于 2016-3-29 16:38 | 只看该作者
4层应该就能搞定.

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发表于 2016-3-28 15:25 | 只看该作者
建議你拆掉重走,疊構改成  TOP/L2GND/L3IN1/L4VCC_IN2/L5GND/BOT.
0 v6 e- ?2 s% @: U6 ?2 NTOP/L3 Ref L2 , BOT/L4VCC_IN2 Ref L5GBD.

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发表于 2016-3-25 17:40 | 只看该作者
参考自身的电源就可以
2 x# i5 |, w* ?) I个人感觉横着放比较好走  线也会短点

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发表于 2016-3-25 13:57 | 只看该作者
ddr走线都没有参考地,信号完整性会差一些。

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 楼主| 发表于 2016-3-25 11:26 | 只看该作者
修改了一下顶层和电源层的电源部分:
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1 B1 |4 m" O3 R! O! `9 ?
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发表于 2016-3-24 17:48 | 只看该作者
楼主不错!有钱途
辜负了岁月的人,没有资格抱怨!

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发表于 2016-3-24 10:21 | 只看该作者
走个ddr用了4层线,这个对于专业的pcb来说还差点意思

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发表于 2016-3-24 10:19 | 只看该作者
建议fpga的核心电源(vcc_1v0)铜皮加宽,目前进bga区域的铜皮太窄了,并且走的比较远。

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发表于 2016-3-24 09:21 | 只看该作者
为什么不把第四层全部作为电源层,第五次全部作为地层?

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发表于 2016-3-24 09:05 | 只看该作者
画得挺好的

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发表于 2016-3-24 08:57 | 只看该作者
brd放出来呗

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发表于 2016-3-24 08:28 | 只看该作者
比我画的好

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发表于 2016-3-24 08:21 | 只看该作者
画得很不错

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发表于 2016-3-24 08:20 | 只看该作者
看着还不错!
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