[求助] 关于2rank的DDR

l888888h · 发表于 2016-1-12 09:17

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有4个内存颗粒，组成2rank的DRAM
ca信号连接到所有这4个颗粒，一个rank enable时，另一个rank应该是disable的
那么对于disable的这个rank，ca信号所连接到的口处于什么状态？

雷霆之剑 · 发表于 2016-5-19 09:02

wcx · 发表于 2016-3-6 22:25

sunchengyao 发表于 2016-3-6 21:19
9 I$ F! e4 c# R/ i8 @) b( G0 h请教一下，2rank的数据线怎么连接？如果1个rank是64位，使用4片的16bit DRAM颗粒可以组成一个rank，那如果 ...

同样也是用的这64跟数据线连接，Dual Rank主要是片选，CK，CKE有区别

sunchengyao · 发表于 2016-3-6 21:19

请教一下，2rank的数据线怎么连接？如果1个rank是64位，使用4片的16bit DRAM颗粒可以组成一个rank，那如果是2rank的DDR，另外一个rank与CPU之间的数据线怎么连接？

yiting7466 · 发表于 2016-2-15 17:29

不应该是高阻态吗？

ljzyhjbfwh · 发表于 2016-1-15 13:57

l888888h 发表于 2016-1-14 15:599 q: {, b2 ]! V- D7 Y8 v+ x
谢谢
: G, F! g0 V! i, R* y2 C. R' W有没有相关的资料

这方面的倒没有，因为这样可以解释的通。

zcswinner · 发表于 2016-1-14 18:20

不懂帮顶

l888888h · 发表于 2016-1-14 15:59

ljzyhjbfwh 发表于 2016-1-13 09:538 o3 e; N6 V* j" C- R1 h( b( Q" m
是的。

谢谢
有没有相关的资料

ljzyhjbfwh · 发表于 2016-1-13 09:53

l888888h 发表于 2016-1-13 08:58
/ ?7 h: i9 D5 e# s9 D对于地址线来说，disable的rank上的口也相当于是正常的负载一样？

是的。

l888888h · 发表于 2016-1-13 08:58

ljzyhjbfwh 发表于 2016-1-12 16:52
$ x. M: o3 T6 _: Q" v- p/ `属于输入状态，因为Address线是复用的，如果是三态的话，会影响到enable的RANK的address信号。可以通过CS和 ...

对于地址线来说，disable的rank上的口也相当于是正常的负载一样？

ljzyhjbfwh · 发表于 2016-1-12 16:52

属于输入状态，因为Address线是复用的，如果是三态的话，会影响到enable的RANK的address信号。可以通过CS和CKE来控制选择所需要操作的RANK和disable的RANK，使disable的RANK不进行动作。

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